[发明专利]基于Xilinx的WCDMA基站锁定系统及方法有效
申请号: | 201110162798.6 | 申请日: | 2011-06-16 |
公开(公告)号: | CN102231920A | 公开(公告)日: | 2011-11-02 |
发明(设计)人: | 郝禄国;杨建坡;周云飞;马少立 | 申请(专利权)人: | 奥维通信股份有限公司 |
主分类号: | H04W88/08 | 分类号: | H04W88/08 |
代理公司: | 广州嘉权专利商标事务所有限公司 44205 | 代理人: | 谭英强 |
地址: | 518057 广东省深圳市南*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 基于 xilinx wcdma 基站 锁定 系统 方法 | ||
技术领域
本发明涉及一种锁定系统及方法,特别是一种基于Xilinx的WCDMA基站锁定系统及方法。
背景技术
术语解释:
AS(Active Serial):主动串行;
ADC(Analog-to-Digital Converter):模数转换器;
WCDMA(Wideband Code Division Multiple Access):宽带码分多址,是一种第三代无线通讯技术;
CMOS(Complementary Metal Oxide Semiconductor):互补金属氧化物半导体;
DAC(Digital-to-Analog Converter):数模转换器;
EPROM(Erasable Programmable Read-Only Memory): 可擦除可编程的只读内存;
FIR(Finite impulse response):有限长冲击响应;
FLASH(Flash Memory): 闪存;
FPGA(Field Programmable Gate Array):现场可编程门阵列;
ICS(Interference Cancellation System):干扰抵消系统;
IO(Input Output):输入输出;
IQ(IN phase Orthogonal):同相正交;
JTAG(Joint Test Action Group):联合测试行为组织;
LNA(Low-Noise Amplifier):低噪声放大器;
LVDS(Low-Voltage Differential Signaling):低压差分信号;
LVPECL(low-voltage positive-referenced emitter coupled logic):低电压伪发射极耦合逻辑;
NCO(Number Controlled Oscillator):数控振荡器;
PLL(Phase ):锁相环;
PA(Power Amplifier):功率放大器;
SPI(Serial Peripheral Interface): 串行外围设备接口;
VCO(Voltage Controlled Oscillator):压控制振荡器。
在数字无线直放站中,由于不能对接收信号进行筛选而同时放大所有接收信号,会导致可能出现导频污染。本发明公开一种基于自适应算法的基站锁定功能的实现方式,用于解决由数字无线直放站带来的导频污染问题。
现有技术方案:调整接收天线的方向和角度来避免多个功率接近的基站被同时放大。
现有技术缺点:这样的处理方案不但对导频污染现象的改善效果有限,而且会增加工程难度和降低产品应用的广泛性。
发明内容
为了解决上述的技术问题,本发明的目的是提供一种结构简单且升级方便的基于Xilinx的WCDMA基站锁定系统。
本发明的另一个目的是提供一种集成度高、处理效果理想的基于Xilinx的WCDMA基站锁定方法。
针对缺点说明本发明的目的:为了在直放站技术上能够实现从以硬件为核心的平台走向以软件为核心的平台,升级的时候不需改变硬件平台,只需更换软件版本即可实现不同的通信功能。
本发明解决其技术问题所采用的技术方案是:
基于Xilinx的WCDMA基站锁定系统,包括用于天线信号输入的低噪声放大器,所述低噪声放大器的输出端依次连接有第一混频器、第一滤波器、模数转换器、可编程逻辑门阵列模块、数模转换器、第二混频器和第二滤波器,所述可编程逻辑门阵列模块连接有ARM处理器,还包括时钟电路、锁相环和直流电源电路,所述时钟电路的输出端分别连接到模数转换器、可编程逻辑门阵列、数模转换器和锁相环,所述锁相环的输出端分别与第一混频器的输入端、第二混频器的输入端连接。
进一步作为优选的实施方式,所述直流电源电路包括9V稳压电路和5V稳压电路。
进一步作为优选的实施方式,所述可编程逻辑门阵列模块外部连接有串行FLASH芯片电路。
进一步作为优选的实施方式,所述可编程逻辑门阵列模块外部连接有SDRAM芯片。
基于Xilinx的WCDMA基站锁定方法,包括以下步骤:
A、缓冲来自ADC的输入数据;
B、数字下变频(DDC)处理;
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