[发明专利]进行节电处理的图像处理装置有效
申请号: | 201110168757.8 | 申请日: | 2011-06-22 |
公开(公告)号: | CN102300021A | 公开(公告)日: | 2011-12-28 |
发明(设计)人: | 中尾竹寿 | 申请(专利权)人: | 柯尼卡美能达商用科技株式会社 |
主分类号: | H04N1/00 | 分类号: | H04N1/00;G03G15/00 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 李芳华 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 进行 节电 处理 图像 装置 | ||
技术领域
本发明涉及图像处理装置,特别涉及进行将打印数据变换为光栅数据的处理的图像处理装置。
背景技术
作为电子照相式的图像形成装置,存在具备了扫描仪功能、传真功能、复印功能、作为打印机的功能、数据通信功能、以及服务器功能的MFP(多功能外围设备)、传真装置、复印机、以及打印机等。作为图像形成装置的功能之一,具有将打印数据变换为光栅数据并基于此在用纸上形成图像的功能。
即,图像形成装置具有图像处理装置。例如,图像处理装置将从PC(个人计算机)接收(输入)到的打印数据变换为光栅数据。这样的变换处理被称为RIP(光栅图像处理)处理。图像形成装置印刷通过RIP处理变换了的光栅数据。打印数据是用页记述语言(PDL:Page Description Language)所记述的数据。作为页记述语言,存在PostScript(PS)、PDF(Portable Document Format)、PCL(Printer Control Language)、XPS(XML Paper Specification)等。
在下述文献1中公开了具有读取原稿图像并输出相应于原稿图像的图像数据的读取单元、将相应于图像数据的图像记录到记录纸上的打印机单元的图像输入输出装置。图像输入输出装置对于在省电模式时被要求执行的作业中不需要的设备,不解除省电模式。即,图像输入输出装置在被要求执行作业时,电源控制单元首先提供除读取单元和打印机单元以外的系统的电源。然后基于作业的内容,对读取单元、打印机单元选择性地供电。
在下述文献2中公开了具有CPU(中央处理单元)、ASIC(特定用途集成电路)的图像形成装置。节能模式时打印机运转率低的时间带(例如深夜)且没有被要求打印速度的时刻指定打印时,在降低了CPU和ASIC的时钟频率和驱动电流的状态下进行打印,从而进行节电。
在下述文献3中,公开了具有高速打印模式的图像形成装置,在选择了该模式时,提高打印处理的时钟频率而提高性能。提高性能的同时,切断对于不参与打印处理的装置的构成部分的供电。由此,削减整体上的功耗。
[文献1](日本)特开2000-125057号公报
[文献2](日本)特开2002-86844号公报
[文献3](日本)特开2006-289917号公报
如上所述,作为在图像形成装置中进行节电的方法,存在停止对不需要的部分的供电的方法、降低CPU和ASIC的时钟频率和驱动电流的方法的两种方法。上述文献1和3是公开停止对不需要的部分的供电的方法的文献,文献2是公开降低CPU和ASIC的时钟频率和驱动电流的方法的文献。
其中,提出了将降低CPU和ASIC的时钟频率和驱动电流的时期设为待机时、休眠时等装置不进行打印的时期、如上述文献2那样深夜的时刻指定打印等打印速度可以较慢的时期。但是,在繁忙的白天等希望迅速提供打印物的时间带中,需要优先打印速度。为此,在繁忙的白天等中,一般除了装置待机时或休眠时以外,不进行降低时钟频率和驱动电流的处理。由此,在打印速度应被优先时,防止其下降。但是,另一方面,存在在繁忙的白天等中节电处理的程度低的问题。
发明内容
因此,本发明的目的在于提供一种能够进行有效的节电处理的图像处理装置。
为了达成上述目的,根据本发明的一个方面,图像处理装置包括:输入单元,输入打印数据;变换单元,将打印数据变换为光栅数据;测定单元,测定变换单元中的变换所需的时间;以及设定单元,基于测定单元的测定结果,进行用于使变换单元中的变换处理的速度放缓的设定。
根据本发明的另一方面,图像处理装置包括:输入单元,输入打印数据;处理装置,执行将打印数据变换为中间数据的处理和将中间数据变换为光栅数据的处理;存储器,存储通过处理装置变换了的中间数据;总线,在处理装置和存储器之间传送数据;测定单元,测定打印数据内的印刷区域的比率;以及设定单元,基于测定单元的测定结果,进行用于降低总线的动作频率的设定。
通过以下的结合附图的本发明的详细说明,本发明前述和其他目的、特征、方面及优点将更明确。
附图说明
图1是表示本发明的第1实施方式中的图像形成装置的图。
图2是功能性地表示图1的图像形成装置所具备的结构要素的方框图。
图3是表示图2的控制器单元150所具备的硬件结构的方框图。
图4是表示图3的CPU201功能性地实现的结构的方框图。
图5是表示图4的RIP处理单元201d的结构的图。
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