[发明专利]同步解码方法及其装置有效
申请号: | 201110202743.3 | 申请日: | 2011-07-12 |
公开(公告)号: | CN102256128A | 公开(公告)日: | 2011-11-23 |
发明(设计)人: | 黄军 | 申请(专利权)人: | 杭州华三通信技术有限公司 |
主分类号: | H04N7/26 | 分类号: | H04N7/26;H04N7/18 |
代理公司: | 北京鑫媛睿博知识产权代理有限公司 11297 | 代理人: | 龚家骅 |
地址: | 310053 浙江省杭州市高新技术产业*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 同步 解码 方法 及其 装置 | ||
技术领域
本发明涉及通信技术领域的视频监控技术,尤其涉及一种视频监控系统中的同步解码方法及其装置。
背景技术
视频监控系统以其控制灵活、信息容量大、存储和检索便利等优点逐步取代了传统的模拟视频监控系统,被广泛应用于监控、安防、质检等方面。随着计算机及网络技术的发展、普及和网络带宽的迅速扩大,视频监控已经发展到了网络多媒体监控系统,即将数字视频监控技术与网络技术相结合,在现场监控主机无人职守情况下,实现局域网或Internet远程监控的功能。监控业务由传统的模拟监控发展到网络监控,应用场景和范围不断扩展,由原来局部特定区域发展到覆盖整个园区、街道、城市,甚至多个城市。
如图1所示,视频监控系统中的编码器、解码器、管理服务器等设备通过网络实现互联互通。管理服务器用于管理各编码器、解码器。实况码流从编码器发送到解码器,实际传输过程中,可能经过多个网络设备,每路实况流经过的网络,引入的时延不完全相同。解码器和编码器可是一个设备、也可以是一个软件模块。编码器的实况码流经过网络传送给解码器,各解码器收到实况码流并解码。
编码器到解码器的网络路径不同,码流传输过程中不可避免的引入了延时。解码器收到实况码流,立刻解码输出。由于码流经过网络引入了延时,不同的解码器真正解码并显示时,实际相同时刻发生的事情将在不同的显示器上不同的基准时间显示,影响用户对实况的判断。
发明内容
本发明提供了一种同步解码方法及其装置,用以一定程度上解决因网络传输过程引入网络延时导致的解码不同步的问题。
本发明提供的同步解码方法,应用于视频监控系统,包括:
预先在解码器中指定一个主解码器,其余为从解码器;
当解码同步周期到达时,主解码器根据解码出的当前帧确定解码基准,并向从解码器发送同步报文,其中携带有主解码器确定出的解码基准信息;从解码器根据所述同步报文中携带的解码基准信息和网络延时确定解码基准,并根据确定出的解码基准解码接收到的码流。
本发明提供的解码器,应用于视频监控系统,包括:
第一同步基准确定模块,用于在本解码器作为主解码器时,在解码同步周期到达时,根据解码出的当前帧确定解码基准;
同步报文发送模块,用于在本解码器作为主解码器时,向从解码器发送同步报文,其中携带有主解码器确定出的解码基准信息;
同步报文接收模块,用于在本解码器作为从解码器时,接收主解码器发送的同步报文,其中携带有主解码器确定出的解码基准信息;
第二同步基准确定模块,用于在本解码器作为从解码器时,根据所述同步报文中携带的解码基准信息和网络延时确定解码基准;
解码模块,用于在本解码器作为主解码器时解码接收到的码流,在本解码器作为从解码器时,根据所述第二同步基准确定模块确定出的解码基准解码接收到的码流。
本发明提供的另一种同步解码方法,应用于视频监控系统,包括:
在解码同步周期到达时,各解码器根据解码出的当前帧确定解码基准,并向其它解码器发送同步报文,其中携带有本解码器确定出的解码基准;
各解码器接收到其它解码器发送的同步报文后,选举出本解码同步周期的主解码器,根据该主解码器所确定出的解码基准和网络延时确定解码基准,并根据确定出的该解码基准解码接收到的码流。
本发明提供的另一种解码器,应用于视频监控系统,包括:
第一同步基准确定模块,用于在解码同步周期到达时,根据解码出的当前帧确定解码基准;
同步报文发送模块,用于向其它解码器发送同步报文,其中携带有第一同步基准确定模块确定出的解码基准;
同步报文接收模块,用于接收其它解码器发送的同步报文,其中携带有同步报文发送者解码器确定出的解码基准;
第二同步基准确定模块,用于在所述同步报文接收模块接收到其它解码器发送的同步报文后,选举出本解码同步周期的主解码器,并根据该主解码器所确定出的解码基准和网络延时确定解码基准;
解码模块,用于根据第二同步基准模块确定出的该解码基准解码接收到的码流。
本发明的有益技术效果包括:
由于在确定解码基准时,将网络延时作为参考依据,因而一定程度上消除了网络延时对解码同步的影响,与现有技术相比,提高了解码同步精度。
附图说明
图1为现有技术中视频监控系统的组网架构示意图;
图2为本发明实施例提供的编码器同步编码基准时间的流程示意图;
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