[发明专利]基于逻辑电路的Farrow滤波器及其实现方法有效
申请号: | 201110325742.8 | 申请日: | 2011-10-24 |
公开(公告)号: | CN102412806B | 公开(公告)日: | 2017-08-25 |
发明(设计)人: | 陈永红;岳亮;苟春茂 | 申请(专利权)人: | 南京中兴新软件有限责任公司 |
主分类号: | H03H9/46 | 分类号: | H03H9/46 |
代理公司: | 北京康信知识产权代理有限责任公司11240 | 代理人: | 余刚,梁丽超 |
地址: | 210012 江苏*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 基于 逻辑电路 farrow 滤波器 及其 实现 方法 | ||
1.一种基于逻辑电路的Farrow滤波器,其特征在于,包括:
选通开关,用于根据配置的输入数据采样速率与输出数据采样速率的比例关系,控制所述Farrow滤波器的工作模式;
插值滤波装置,用于在所述选通开关的控制下,对输入数据进行插值滤波,并在所述插值滤波的过程中,按照第一设定位宽对中间数据进行截位操作,得到第一类定点数据;
抽取滤波装置,用于在所述选通开关的控制下,对所述输入数据进行抽取滤波,并在所述抽取滤波的过程中,按照第二设定位宽对中间数据进行截位操作,得到第二类定点数据。
2.根据权利要求1所述的Farrow滤波器,其特征在于,所述插值滤波装置与所述抽取滤波装置共用一组子滤波器,所述子滤波器支持系数在线配置功能。
3.根据权利要求1所述的Farrow滤波器,其特征在于,所述插值滤波装置包括一组子滤波器、一组乘法器和一组加法器;其中,
所述一组乘法器的每个乘法器连接有一个乘法截位器,所述乘法截位器用于按照第一设定位宽对所述乘法器的输出结果进行截位操作,得到第一类定点数据。
4.根据权利要求3所述的Farrow滤波器,其特征在于,
所述每个乘法器接收的时间系数为uiv=2*ui-I,其中,ui=μi*I,μi=mod(D*l,I)/I,I为设定的差值倍数,D为设定的抽取倍数;l为输出时钟域的数据索引;mod( )为取余计算。
5.根据权利要求4所述的Farrow滤波器,其特征在于,
所述一组子滤波器中的每个子滤波器的系数cm′(n)采用下述公式确定:
所述一组加法器与数据输出端之间设置有一个加法截位器,所述加法截位器用于截去由所述一组加法器运算的结果的低M位。
6.根据权利要求4所述的Farrow滤波器,其特征在于,所述Farrow滤波器还包括第一逻辑硬件系统,所述第一逻辑硬件系统包括:
第一复位器,用于对所述第一逻辑硬件系统进行复位,将uiv、rd_flag和临时变量t复位为初始值,其中,rd_flag为时钟域转换读地址标识;
第一变量处理器,用于在每个输出时钟到来时,设置t=t+D,并判断t是否大于I,如果是,设置t=t-I,并将rd_flag加1,如果否,t和rd_flag不变;
第一时间系数生成器,用于设置每个输出时钟对应的所述时间系数uiv=2*t-I。
7.根据权利要求1所述的Farrow滤波器,其特征在于,所述抽取滤波装置包括一组子滤波器、一组乘法器、一组累加器和一组加法器;其中,
所述一组乘法器的每个乘法器连接有一个乘法截位器,所述乘法截位器用于按照第二设定位宽对所述乘法器的输出结果进行截位操作,并将截位后的数据输入对应的累加器;
每个所述累加器与所述子滤波器之间设置有一个累加截位器,所述累加截位器用于对所述累加器输出的结果进行截位操作,得到第二类定点数据。
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