[发明专利]用于为多通路PCI特快IO互连提供故障保护的方法和装置有效
申请号: | 201110353120.6 | 申请日: | 2011-11-07 |
公开(公告)号: | CN102541790A | 公开(公告)日: | 2012-07-04 |
发明(设计)人: | P·A·巴克兰德;J·R·赫林;G·M·诺德斯托姆;W·A·汤普森 | 申请(专利权)人: | 国际商业机器公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/40 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 吴立明 |
地址: | 美国纽*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 通路 pci 特快 io 互连 提供 故障 保护 方法 装置 | ||
1.一种用于为第一PCIE桥与第一输入/输出(IO)设备之间的连接提供故障保护操作的方法,所述方法包括:
使用所述第一PCIE桥的第一组通路,通过第一链路在所述第一PCIE桥与所述第一IO设备之间交换第一组总线位;
响应于检测到所述第一链路中的故障,在PCIE桥端,从使用所述第一组通路调换为使用所述第一PCIE桥的第二组通路,以使用所述第二组通路通过第二链路在所述第一PCIE桥与所述第一IO设备之间交换第二组总线位,所述第二链路连接第二PCIE桥与第二IO设备;
响应于检测到所述第一链路中的所述故障,在IO设备端,从使用所述第一组通路切换为使用所述第二组通路,以使用所述第二组通路通过所述第二链路在所述第一PCIE桥与所述第一IO设备之间交换所述第二组总线位。
2.根据权利要求1所述的方法,还包括:
响应于检测到所述第一链路中的所述故障,将所述第一PCIE桥配置为停止使用所述第二组通路。
3.根据权利要求1所述的方法,还包括:
响应于检测到所述第一链路中的所述故障,将使用所述第一链路以使用所述第二PCIE桥的第三组通路来与所述第二IO设备交换第三组总线位的所述第二PCIE桥配置为停止使用所述第三组通路。
4.根据权利要求1所述的方法,其中所述第一PCIE桥和第二PCIE桥的每一个包括PCIE主桥(PHB)。
5.根据权利要求1所述的方法,其中所述第一IO设备和第二IO设备的每一个包括PCIE交换器。
6.根据权利要求1所述的方法,其中所述第一PCIE桥和第二PCIE桥被容纳于PCIE根复合体中。
7.一种用于为第一PCIE桥与第一输入/输出(IO)设备之间的连接提供故障保护操作的装置,所述装置包括:
第一链路,连接第一PCIE桥与第一IO设备,所述第一链路被用于使用所述第一PCIE桥的第一组通路通过所述第一链路在所述第一PCIE桥与所述第一IO设备之间交换第一组总线位,
至少一个第二链路,连接第二PCIE桥与第二IO设备;
其中响应于检测到所述第一链路中的故障,所述第一PCIE桥在PCIE桥端从使用所述第一组通路调换为使用所述第一PCIE桥的第二组通路,以使用所述第二组通路通过所述第二链路在所述第一PCIE桥与所述第一IO设备之间交换第二组总线位;以及
IO端的至少一个交换器,用于从使用所述第一组通路切换为使用所述第二组通路,以使用所述第二组通路通过所述第二链路在所述第一PCIE桥与所述第一IO设备之间交换所述第二组总线位。
8.根据权利要求7所述的装置,其中:
响应于检测到所述第一链路中的所述故障,所述第一PCIE桥被配置为停止使用所述第二组通路。
9.根据权利要求7所述的装置,其中:
响应于检测到所述第一链路中的所述故障,使用所述第一链路以使用所述第二PCIE桥的第三组通路来与所述第二IO设备交换第三组总线位的所述第二PCIE桥被配置为停止使用所述第三组通路。
10.根据权利要求7所述的装置,其中所述第一PCIE桥和所述交换器由中央处理单元(CPU)固件控制。
11.根据权利要求7所述的装置,还包括:
连接到所述第二IO设备的控制设备,用于控制所述交换器,所述控制设备由所述CPU固件控制。
12.根据权利要求7所述的装置,其中所述第一PCIE桥和第二PCIE桥的每一个包括PCIE主桥(PHB)。
13.根据权利要求7所述的装置,其中所述第一IO设备和第二IO设备的每一个包括PCIE交换器。
14.根据权利要求7所述的装置,其中所述第一PCIE桥和第二PCIE桥被容纳于PCIE根复合体中。
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