[发明专利]计算幅度调制信号接收信噪比的电路有效
申请号: | 201110401200.4 | 申请日: | 2011-12-06 |
公开(公告)号: | CN103152302A | 公开(公告)日: | 2013-06-12 |
发明(设计)人: | 王吉健 | 申请(专利权)人: | 上海华虹集成电路有限责任公司 |
主分类号: | H04L27/06 | 分类号: | H04L27/06;H04L25/03;H04L25/02 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 戴广志 |
地址: | 201203 上海*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 计算 幅度 调制 信号 接收 电路 | ||
技术领域
本发明涉及数字信号传输领域,特别是涉及一种计算幅度调制信号接收信噪比的电路。
背景技术
幅度调制是常用的信号调制方式,而信噪比的计算是各类产品,比如AM(调幅)收音机,非接卡等一切具有AM接收功能的产品普遍需要实现的功能。
目前计算幅度调制信号信噪比的方法包括:用数据中一部分已知的信息比如固定的同步帧头,或已知的一定格式的数据包头,计算接收信号中幅度调制信号的信噪比。
发明内容
本发明要解决的技术问题是提供一种计算幅度调制信号接收信噪比的电路,无需知道发送信息,就能计算出接收信号中幅度调制信号信噪比。
为解决上述技术问题,本发明的计算幅度调制信号接收信噪比的电路,包括:
一计数器,按照幅度调制信号的频率信号sig_freq的采样周期进行计数,频率信号sig_freq的采样信号sig_freq_samp为该计数器的输入脉冲信号,其周期等于采样周期,计数周期为2N+1,其中N为正整数;所述计数器有三个输出信号,分别为输出信号state0,输出信号state1,输出信号state2;当所述计数器的计数值小于2N时,输出信号state0为1,输出信号state1和输出信号state2为0;当所述计数器的计数值大于2N小于2N+1时,输出信号state1为1,输出信号state0和输出信号state2为0;当所述计数器的计数值等于2N+1时,输出信号state2为1,输出信号state0和输出信号state1为0;当所述计数器1的计数值在0~2N-1之间时,表示所述电路在计算平均值;当所述计数器1的计数值在2N~2N+1-1之间时,表示所述电路在计算均方差;
一第一累加器,用于有符号数的累加,其输入信号是幅度调制信号的频率信号sig_freq,输出信号为sum_freq;该第一累加器受所述计数器的输出信号state0,state2控制,当计数器的输出信号state0=1时,对其输入信号进行累加,得到输入频率信号sig_freq的和;当计数器的输出信号state0=0时,保持累加结果;当计数器的输出信号state2=1时,对第一累加器2清0;
一减法模块,其一个输入端输入幅度调制信号的频率信号sig_freq,作为被减数;另一个输入端与所述第一累加器相连接,输入第一累加器的输出信号sum_freq,作为减数;其输出信号为err_freq;
一取绝对值模块,其输入端与所述减法模块的输出端相连接,其输出信号为err_freq_abs,用于计算均方差所用的绝对值;
一第二累加器,其输入端与所述取绝对值模块的输出端相连接,其输出信号为sum_err_freq_abs;该第二累加器受所述计数器输出信号state1、输出信号state2控制;当计数器输出信号state1=1时,对输入信号累加;当计数器输出信号state1=0时,保持累加结果;当计数器输出信号state2=1时,对第二累加器清0;
一第一除法模块,其一个输入端与所述第一累加器的输出端相连接,输入第一累加器的输出信号sum_freq,作为被除数;另一个输入端与所述第二累加器的输出端相连接,输入第二累加器的输出信号sum_err_freq_abs,作为除数,其输出信号为snr_est;用于信噪比的除法运算,得到经过仿真计算的信噪比snr_est;
一查找表模块,其输入端与所述除法模块相连接,输入第一除法模块的输出信号snr_est,其输出信号为est_err;该查找表模块用于记录和输出,仿真时信道上加上的已知信噪比和经过仿真计算得到的信噪比snr_est之间的差值;
一加法器,其一个输入端与所述除法模块的输出端相连接,另一个输入端与查找表模块的输出端相连接;其输出信号为snr_cal;用于补偿经过仿真计算得到的信噪比snr_est与实际结果的差;
一第二除法模块,其一个输入端与所述加法器的输出端相连接,作为被除数;另一个输入端输入一个常数,作为除数;用于对信噪比中作为信号能量的频率信号做归一化处理;
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