[发明专利]具有PIN二极管隔离的高压电阻器有效
申请号: | 201110406344.9 | 申请日: | 2011-12-08 |
公开(公告)号: | CN102832211A | 公开(公告)日: | 2012-12-19 |
发明(设计)人: | 苏如意;杨富智;蔡俊琳;郑志昌;柳瑞兴 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L29/06 |
代理公司: | 北京德恒律师事务所 11306 | 代理人: | 陆鑫;房岭梅 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 具有 pin 二极管 隔离 高压 电阻器 | ||
1.一种半导体器件,包括:
衬底;
第一掺杂区域,设置在所述衬底中;
第二掺杂区域,设置在所述衬底中,所述第二掺杂区域与所述第一掺杂区域进行相反的掺杂;
第三掺杂区域,设置在所述衬底中并且在所述第一掺杂区域与所述第二掺杂区域之间,所述第三掺杂区域具有比所述第一掺杂区域和所述第二掺杂区域低的掺杂浓度等级;
绝缘器件,设置在所述第一掺杂区域的一部分之上;以及
电阻器,设置在所述绝缘器件之上。
2.根据权利要求1所述的半导体器件,其中,所述第一掺杂区域、所述第二掺杂区域和所述第三掺杂区域总体形成PIN二极管。
3.根据权利要求1所述的半导体器件,其中:
所述衬底为P型衬底;
所述第一掺杂区域包括N型掺杂阱;
所述第二掺杂区域包括P型掺杂阱;以及
所述第三掺杂区域包括轻掺杂N型本征区域和轻掺杂P型本征区域中的一种。
4.根据权利要求1所述的半导体器件,其中,所述第三掺杂区域为外延层的部分;所述第三掺杂区域具有范围在大约40微米至大约70微米之间的宽度。
5.根据权利要求1所述的半导体器件,其中:
所述电阻器包含多晶硅材料;以及
所述绝缘器件包含电介质材料。
6.根据权利要求1所述的半导体器件,其中,所述电阻器为伸长结构,并且具有之字形状、正方形状和螺旋形状中的一种。
7.根据权利要求1所述的半导体器件,还包括设置在所述电阻器之上的互连结构,所述互连结构包括:
第一接触部,电连接至所述第一掺杂区域;
第二接触部,电连接至所述电阻器中设置在所述电阻器的第一末端和第二末端之间的部分;以及
导线,将所述第一接触部和所述第二接触部电连接在一起。
8.根据权利要求7所述的半导体器件,其中,所述电阻器的部分大约位于所述电阻器的中点处。
9.一种高压半导体器件,包括:
衬底;
PIN二极管结构,形成在所述衬底中,所述PIN二极管包括位于第一掺杂阱和第二掺杂阱之间的本征区域,其中,所述第一掺杂阱和所述第二掺杂阱具有相反的掺杂极性,并且每一个都具有比所述本征区域大的掺杂浓度等级;
绝缘结构,形成在所述第一掺杂阱的一部分之上;
伸长电阻器件,形成在所述绝缘结构之上,所述电阻器件具有分别设置在所述电阻器件的相对端处的第一部分和第二部分;以及
互连结构,形成在所述电阻器件之上,所述互连结构包括:
第一接触部,电连接至所述第一掺杂阱;
第二接触部,电连接至所述电阻器中位于所述第一部分和所述第二部分之间的第三部分;和
导线,将所述第一接触部和所述第二接触部电连接在一起。
10.一种制造高压半导体器件的方法,包括:
在衬底中形成本征区域;
在所述衬底中形成第一掺杂阱;所述第一掺杂阱被形成为与所述本征区域相邻并具有大于所述本征区域的掺杂浓度等级;
在所述衬底中形成第二掺杂阱,所述第二掺杂阱与所述第一掺杂阱进行相反的掺杂并具有大于所述本征区域的掺杂浓度等级,其中,所述本征区域设置在所述第一掺杂阱和所述第二掺杂阱之间;
在所述第一掺杂阱之上形成隔离结构;以及
在所述隔离结构之上形成电阻器。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的