[实用新型]一种DVI/HDMI/DP/VGA信号的后级无抖校正装置无效
| 申请号： | 201120028857.6 | 申请日： | 2011-01-27 |
| 公开（公告）号： | CN202014319U | 公开（公告）日： | 2011-10-19 |
| 发明（设计）人： | 周春雷;张坛 | 申请（专利权）人： | 大连科迪视频技术有限公司 |
| 主分类号： | H04N5/262 | 分类号： | H04N5/262;H04N5/268 |
| 代理公司： | 大连东方专利代理有限责任公司 21212 | 代理人： | 李洪福 |
| 地址： | 116023 辽宁省大*** | 国省代码： | 辽宁;21 |
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| 摘要： | |||
| 搜索关键词： | 一种 dvi hdmi dp vga 信号 后级无抖 校正 装置 | ||
1.一种DVI/HDMI/DP/VGA信号的后级无抖校正装置，其特征在于包括：信号采集单元、核心处理单元I、时钟模拟单元、外存储单元、核心处理单元II和信号输出单元；所述信号采集单元通过数据线同核心处理单元I相连接，信号采集单元将采集到的的DVI/HDMI信号或VGA信号处理后发送到核心处理单元I中，所述时钟模拟单元通过数据线同核心处理单元I相连接，所述核心处理单元I通过数据线同外存储单元相连接；所述核心处理单元I和核心处理单元II通过外部数据线相连接，所述核心处理单元II通过数据线同外存储单元相连接，所述核心处理单元II同信号输出单元相连接，将外部数据线接收到的标准激励时钟CLKPLL、核心处理单元I生成的行信号H2和场信号V2，以及从外存储单元读取的RGB数据发送到信号输出单元中，所述信号输出单元对上述数据处理后输出给外部设备。
2.根据权利要求1所述的一种DVI/HDMI/DP/VGA信号的后级无抖校正装置，其特征在于所述外存储单元分为两个区域，所述核心处理单元I通过数据线分别同外存储单元的两个区域相连接；所述核心处理单元II也通过数据线分别同外存储单元的两个区域相连接。
3.根据权利要求1所述的一种DVI/HDMI/DP/VGA信号的后级无抖校正装置，其特征在于所述信号采集单元可由芯片SIL1161或者TDA19977、TDA19978、AD998x、ADV7441芯片构成；所述时钟模拟单元可由PLL602芯片构成；所述外存储单元由DDRIII，DDRII、SDRAM或AL460芯片构成；所述核心处理单元I和核心处理单元II的主芯片由cycloneII或者EasyPath-6FPGA芯片构成。
4.根据权利要求3所述的一种DVI/HDMI/DP/VGA信号的后级无抖校正装置，其特征在于还包括MCU通过数据线同构成核心处理单元I和核心处理单元II的FPGA芯片相连接。
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