[实用新型]一种利用时钟驱动器配置多片FPGA的装置有效
| 申请号： | 201120259179.4 | 申请日： | 2011-07-21 |
| 公开（公告）号： | CN202159285U | 公开（公告）日： | 2012-03-07 |
| 发明（设计）人： | 姚文浩;郑臣明;王晖;王英;柳胜杰;郝志彬;梁发清;邵宗有;刘新春;杨晓君 | 申请（专利权）人： | 曙光信息产业股份有限公司 |
| 主分类号： | G06F1/04 | 分类号： | G06F1/04;G06F1/10;G06F15/177 |
| 代理公司： | 北京安博达知识产权代理有限公司 11271 | 代理人： | 徐国文 |
| 地址： | 300384 天津市西青区华*** | 国省代码： | 天津;12 |
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| 摘要： | |||
| 搜索关键词： | 一种 利用 时钟 驱动器 配置 fpga 装置 | ||
【权利要求书】：
1.一种利用时钟驱动器配置多片FPGA的装置，其特征在于：包括配置芯片PROM，时钟驱动器和FPGA芯片；
其中，所述配置芯片PROM的CLK信号线和DATA信号线分别各连接1块时钟驱动器，与CLK信号线连接的时钟驱动器的输出端与FPGA芯片的时钟输入端相连接，与DATA信号线连接的时钟驱动器的输出端与FPGA芯片的数据输入端相连接。
2.如权利要求1所述的装置，其特征在于：所述时钟驱动器的每个输出端可以连接到两个FPGA芯片的输入端。
3.如权利要求1所述的装置，其特征在于：所述配置芯片PROM的时钟输入接口出与一个外部晶振相连接。
4.如权利要求3所述的装置，其特征在于：所述外部晶振提供的频率为5MHz。
5.如权利要求1所述的装置，其特征在于：所述FPGA芯片设置为Slave Serial配置模式。
6.如权利要求1所述的装置，其特征在于：所述时钟驱动器为P2P2305NZ芯片。
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