[实用新型]一种主变、母差、备自投出口逻辑测试装置有效
申请号: | 201120301917.7 | 申请日: | 2011-08-18 |
公开(公告)号: | CN202204884U | 公开(公告)日: | 2012-04-25 |
发明(设计)人: | 余嘉庆;许梅;周劲;李群军 | 申请(专利权)人: | 四川省电力公司广安电业局 |
主分类号: | G01R31/00 | 分类号: | G01R31/00;G01R31/327 |
代理公司: | 成都科奥专利事务所(普通合伙) 51101 | 代理人: | 王蔚 |
地址: | 638000 *** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 投出 逻辑 测试 装置 | ||
1.一种主变、母差、备自投出口逻辑测试装置,其特征在于:包括开入开出单元、CPU控制单元和液晶显示器,
所述开入开出单元包括开入模块、开出模块和光电隔离器,其中开出模块的开关量输出接点与继电保护测试仪的开关量输入端子连接,用于按键启动时启动继电保护测试仪输出故障量,开出模块的信号输入端与光电隔离器的输出端连接,开入模块设有16-24对与采集接点连接的接口、以及与继电保护测试仪的开关量输出接点连接的开关量输入端子和与触发按键输出接点连接的开关量输入端子,开入模块的信号输出端与光电隔离器的输入端连接,开入开出单元用于采集接点信息、以及实现开关量启动或按键启动;
所述CPU控制单元包括采集接点信息转换模块、时间记录模块、存储模块和数据处理器,采集接点信息转换模块和时间记录模块的输入端分别与光电隔离器的输出端连接,采集接点信息转换模块和时间记录模块的输出端通过存储模块分别与数据处理器的输入端连接;
所述液晶显示器通过存储模块与数据处理器的输出端连接。
2.根据权利要求1所述的一种主变、母差、备自投出口逻辑测试装置,其特征在于:开入模块设有的与采集接点连接的接口为20对,其中16对与常开接点连接,4对与常闭接点连接。
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