[实用新型]一种高速总线时序错误产生装置有效
| 申请号： | 201120417536.5 | 申请日： | 2011-10-28 |
| 公开（公告）号： | CN202422106U | 公开（公告）日： | 2012-09-05 |
| 发明（设计）人： | 王刚;阎海霞;张淑舫 | 申请（专利权）人： | 中国航天科工集团第三研究院第八三五七研究所 |
| 主分类号： | G06F11/263 | 分类号： | G06F11/263;G06F13/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 300141*** | 国省代码： | 天津;12 |
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| 摘要： | |||
| 搜索关键词： | 一种 高速 总线 时序 错误 产生 装置 | ||
【权利要求书】：
1.一种高速总线时序错误产生装置，其特征在于：包括信号选择模块，信号选择模块控制总线信号源模块和时序错误编码插入模块，总线信号源与DA转换芯片相连，DA转换芯片经耦合器与总线相连；时序错误编码插入模块与AD转换芯片相连，AD转换芯片经耦合器与总线相连；时序错误编码插入模块经滤波模块与外侧总线被测终端连接；信号选择模块与外部主控计算机连接。
2.根据权利要求1所述的一种高速总线时序错误产生装置，其特征在于：所述信号选择模块、总线信号源模块和时序错误编码插入模块由ARM处理器、FPGA芯片实现，所述ARM处理器通过通用异步串口与主控计算机及总线被测终端进行数据交换。
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