[发明专利]实时错误恢复的方法和系统有效
申请号: | 201180045741.6 | 申请日: | 2011-09-23 |
公开(公告)号: | CN103270497A | 公开(公告)日: | 2013-08-28 |
发明(设计)人: | S·穆特拉沙纳鲁;D·达斯夏尔马;J·佩罗奥苏布拉亚;E·R·韦哈格 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F11/08 | 分类号: | G06F11/08;G06F13/14 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 张晰;王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 实时 错误 恢复 方法 系统 | ||
技术领域
本发明涉及错误恢复,并且更具体地而非排它地,涉及不需要重置系统的附加到系统上的设备的错误恢复的方法和系统。
背景技术
平台通常具有数个经由通信接口连接的外围设备。当连接到平台的任意一个设备经历不可纠正的错误时,需要重置平台来纠正所述不可纠正错误。平台的重置防止了不可纠正错误的传播。
虽然平台的重置能够解决设备中的不可纠正错误,但是平台的重置减小了平台的可靠性。在关键任务计算机平台或服务器中,当遇到不可纠正错误时进行平台的重置能对平台所需的99.999%的正常运行时间造成巨大影响。
附图说明
本发明的实施例的特征和优点将从下列主题的详细描述中变得清晰,其中:
图1示出了根据本发明一个实施例的平台的框图。
图2示出了根据本发明一个实施例的控制器。
图3示出了本发明一个实施例的实时错误恢复链路状态机。
图4示出了根据本发明一个实施例的实时错误恢复逻辑的框图。
图5示出了根据本发明一个实施例的实时错误恢复的流程图。
图6示出了根据本发明一个实施例的实时错误恢复的流程图。
图7示出了根据本发明一个实施例的实时错误恢复的流程图。
图8示出了根据本发明一个实施例的实现本文中公开的方法的系统。
图9示出了根据本发明一个实施例的实现本文中公开的方法的系统。
具体实施方式
通过示例方式而非通过在附图中进行限制方式来示出本文描述的本发明的实施例。为了说明的简洁和清楚,附图中说明的元件未必按照比例绘制。例如,为了清楚,可以相对于其他元件放大一些元件的尺寸。此外,当认为合适时,会在附图中重复附图标记以指示相应的或类似的元件。本说明书中引用本发明的“一个实施例”或“实施例”指结合包括在本发明的所描述的特定特征、结构或特性包括在本发明的至少一个实施例中。本说明书中各处出现的短语“在一个实施例中”并不必然全都指同一实施例。
本发明的实施例提供了附加到系统的设备的错误恢复方法和系统,而不需要系统重置。在本发明的一个实施例中,系统或平台检测到所附设备的错误并关闭与所附设备的通信链路。平台纠正错误并自动地重新训练与所附设备的通信链路。通过这种方式,在本发明的一个实施例中,不需要重置平台来纠正检测到的错误。平台或系统包括但不限于:台式计算机、膝上型计算机、上网本、笔记本计算机、个人数字助理(PDA)、服务器、工作站、蜂窝式电话、移动计算设备、互联网装置或任何其它类型的计算设备。
在本发明的一个实施例中,平台能够选择一种或多种类型的错误用于实时错误恢复。所述错误包括但不仅限于:不可纠正错误、可纠正错误、非致命性错误、致命性错误,和其他类型的错误分类。不可纠正错误包括但不仅限于:影响平台接口的功能的错误情况。可纠正错误包括但不仅限于:平台的硬件能恢复而没有任何信息损失的错误情况。致命性错误包括但不仅限于:致使特定通信链路和相关的硬件不可靠的不可纠正错误情况。非致命性错误包括但不仅限于:致使特定事务不可靠但是通信链路是功能完善的不可纠正错误。
图1示出了根据本发明一个实施例的平台105的框图100。在本发明的一个实施例中,平台与由PCI特别兴趣组织(PCI-SIG)维护的外围部件互连(PCI)高速(PCIe)标准或规范至少是部分兼容的。
在本发明的一个实施例中,平台105具有耦合到根联合体120的处理核心110。根联合体120与总线140和存储器130相耦合,并且支持三个根端口142、144和146。根端口142、144和146经由PCIe通信链路152、154和156分别地耦合到PCIe终端设备1-3160、162和164。在本发明的一个实施例中,根联合体120代表处理器核心110生成事务请求。在本发明的一个实施例中,根联合体120与处理核心120相集成。
在本发明的一个实施例中,根端口142、144和146中的每一个均具有当检测到错误时执行实时错误恢复的逻辑。在本发明的一个实施例中,当检测到错误时,根端口142、144和146中的每一个的实时错误恢复促使它们对应的PCIe通信链路进行自动恢复,而不需要重置平台105。
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