[发明专利]用于存储器层次知晓的生产者-消费者指令的装置和方法在审
申请号: | 201180075740.6 | 申请日: | 2011-12-21 |
公开(公告)号: | CN104011694A | 公开(公告)日: | 2014-08-27 |
发明(设计)人: | S·赖金;R·凡伦天;R·萨德;J·Y·曼德尔布莱特;R·夏勒夫;L·诺瓦克夫斯基 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F13/14 | 分类号: | G06F13/14;G06F13/38;G06F12/08 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 毛力 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 存储器 层次 知晓 生产者 消费者 指令 装置 方法 | ||
1.一种用于从中央处理单元(CPU)的生产者核向所述CPU的消费者核转移数据块的方法,包括:
向所述CPU的所述生产者核内的缓冲器写入数据直至指定量的数据已被写入;
一旦检测到所述指定量的数据已被写入,就响应性地生成驱逐循环,所述驱逐循环使得所述数据从所述填充缓冲器被转移到所述生产者核与所述消费者核两者均能访问的高速缓存;
设置向所述消费者核指示数据在所述高速缓存中可用的指示;以及
一旦所述消费者核检测到所述指示,就在接收到来自所述消费者核的读取信号之际从所述高速缓存向所述消费者核提供所述数据。
2.如权利要求1所述的方法,其特征在于,所述指示包括所述核可写入的并且所述消费者核可读取的标志。
3.如权利要求2所述的方法,其特征在于,所述标志包括二进制值指示,所述二进制值指示具有第一值和第二值,所述第一值指示所述数据在所述高速缓存中可用,且所述第二值指示所述数据在所述高速缓存中不可用。
4.如权利要求1所述的方法,其特征在于,所述消费者核通过轮询技术来读取所述指示,在所述轮询技术中所述消费者核周期性地读取对所述指示的轮询。
5.如权利要求1所述的方法,其特征在于,所述消费者核响应于中断信号来读取所述指示。
6.如权利要求1所述的方法,其特征在于,所述方法的操作由所述生产者核响应于第一指令被所述生产者核执行来执行。
7.如权利要求6所述的方法,其特征在于,所述第一指令包括MovNonAllocate存储指令。
8.如权利要求6所述的方法,其特征在于,还包括:
准许所述第一指令与相同指令类型的多个其他指令交织。
9.如权利要求8所述的方法,其特征在于,还包括:
准许所述第一指令与不同指令类型的多个其他指令交织。
10.如权利要求9所述的方法,其特征在于,所述其他指令是写回存储指令,并且所述第一指令是MovNonAllocate存储指令。
11.如权利要求1所述的方法,其特征在于,所述生产者核内的所述缓冲器是填充缓冲器,并且其中所述生产者核与所述消费者核两者均能访问的所述高速缓存是级3(L3)高速缓存。
12.一种指令处理装置,包括:
中央处理器单元(CPU)内为一个或多个消费者核产生数据的生产者核,以及所述生产者核与所述一个或多个消费者核能访问的高速缓存;
核-核生产者-消费者逻辑,其被配置成执行以下操作:
向所述CPU的所述生产者核内的缓冲器写入数据直至指定量的数据已被写入;
一旦检测到所述指定量的数据已被写入,就响应性地生成驱逐循环,所述驱逐循环使得所述数据从所述填充缓冲器被转移到所述生产者核与所述消费者核两者均能访问的高速缓存;
设置向所述消费者核指示数据在所述高速缓存中可用的指示;以及
一旦所述消费者核检测到所述指示,就在接收到来自所述消费者核的读取信号之际从所述高速缓存向所述消费者核提供所述数据。
13.如权利要求12所述的指令处理装置,其特征在于,所述指示包括所述核可写入并且所述消费者核可读取的标志。
14.如权利要求13所述的指令处理装置,其特征在于,所述标志包括二进制值指示,所述二进制值指示具有第一值和第二值,所述第一值指示所述数据在所述高速缓存中可用,且所述第二值指示所述数据在所述高速缓存中不可用。
15.如权利要求12所述的指令处理装置,其特征在于,所述消费者核通过轮询技术来读取所述指示,在所述轮询技术中所述消费者核周期性地读取对所述指示的轮询。
16.如权利要求12所述的指令处理装置,其特征在于,所述消费者核响应于中断信号来读取所述指示。
17.如权利要求12所述的指令处理装置,其特征在于,所述指令处理装置的操作由所述生产者核响应于第一指令被所述生产者核执行来执行。
18.如权利要求17所述的指令处理装置,其特征在于,所述第一指令包括MovNonAllocate存储指令。
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