[发明专利]嵌入式系统及其计时方法有效
申请号: | 201210041592.2 | 申请日: | 2012-02-21 |
公开(公告)号: | CN103257670A | 公开(公告)日: | 2013-08-21 |
发明(设计)人: | 袁堂夫;邹义生 | 申请(专利权)人: | 北京国微集成技术有限公司 |
主分类号: | G06F1/14 | 分类号: | G06F1/14 |
代理公司: | 北京银龙知识产权代理有限公司 11243 | 代理人: | 许静;赵爱军 |
地址: | 100015 北京市朝阳*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 嵌入式 系统 及其 计时 方法 | ||
技术领域
本发明涉及嵌入式系统技术领域,尤其涉及一种嵌入式系统及其计时方法。
背景技术
嵌入式系统是半导体技术和软件技术面向应用的综合,已经有数十年的历史,如今已经随处可找到它们的踪影。各种消费电子产品、交通工具、通信产品、自动化控制系统等其中都会集成嵌入式系统,用于对整个产品、系统进行控制以及进行人机交互,从而让产品更加智能、灵活、易用,使产品具有更加强大的功能。
在集成嵌入式系统的产品中,产品的很多功能是基于时间或定时的,如在特定的时间开/关机、特定时间执行某项功能等。在一些复杂、成本较高的嵌入式系统中,电路中会集成实时时钟电路,软件一般也会包含操作系统,实现较为准确的系统时间比较方便。但针对一些低成本的嵌入式系统,无论是所用微处理器,还是系统电路设计,出于成本等考虑,往往不集成实时时钟电路。另外,很多低成本的嵌入式系统甚至不使用操作系统,整个应用软件运行于单任务状态。在这些低成本的嵌入式系统中,要想获取比较精确的时间,并不是一件容易的事情。
发明内容
有鉴于此,本发明提供一种嵌入式系统及其计时方法,能够在不增加实时时钟电路的基础上实现嵌入式系统的精确计时。
为解决上述问题,本发明提供一种嵌入式系统,包括:
时间校准模块,用于获取系统的校准时间;
时钟电路,用于产生时钟信号;
计时器,用于接收所述时钟信号,并根据接收到的所述时钟信号的数量进行计数,得到一计数数值,在所述计数数值达到预设数值时,生成一中断事件通知,并获取所述计数数值达到预设数值所需的时长;
处理器,用于在接收到所述中断事件通知后,执行中断服务程序,所述执行中断服务程序包括:统计所述中断服务程序的执行次数,并根据所述时长、所述执行次数以及所述校准时间,计算系统当前时间。
可选的,所述计时器还包括:
第一计时模块,用于在每接收到一所述时钟信号时,将所述计数数值加一,并获取所述计数数值从所述计时器的初始值递增计数到第一预设数值所需的时长;或
第二计时模块,用于在每接收到一所述时钟信号时,将所述计数数值减一,并获取所述计数数值从所述初始值递减计数到第二预设数值所需的时长;
可选的,所述处理器还包括:
计时器重置模块,用于在执行所述中断服务程序时,重置所述计时器的初始值。
可选的,所述处理器还包括:
误差获取模块,用于获取从接收到所述中断事件通知至重置所述计时器的初始值之间所述计时器的计数数值,作为误差值,并计算所述误差值与所述初始值的和值;
其中,所述计时器重置模块,还用于将所述和值作为所述计时器的初始值,并重置所述计时器的初始值。
本发明还提供一种嵌入式系统的计时方法,包括:
接收时钟电路产生的时钟信号,并采用计时器根据接收到的所述时钟信号的数量进行计数,得到一计数数值,在所述计数数值达到预设数值时,生成一中断事件通知;
获取所述计数数值达到预设数值所需的时长;
获取系统的校准时间;
在接收到所述中断事件通知后,执行中断服务程序,所述执行中断服务程序包括:统计所述中断服务程序的执行次数,并根据所述时长、所述执行次数以及所述校准时间,计算系统当前时间。
可选的,所述根据接收到的所述时钟信号的数量进行计数,得到一计数数值的步骤之前还包括:
为计数数值设置一初始值;
所述根据接收到的所述时钟信号的数量进行计数,得到一计数数值的步骤包括:
在每接收到一所述时钟信号时,将所述计数数值加一,并获取所述计数数值从所述初始值递增计数到第一预设数值所需的时长;或
在每接收到一所述时钟信号时,将所述计数数值减一,并获取所述计数数值从所述初始值递减计数到第二预设数值所需的时长;
可选的,所述计数数值从所述初始值递增计数到第一预设数值所需的时长的计算公式如下:
δt=(L1-pri)*T
其中,δt为计数数值从所述初始值递增计数到第一预设数值所需的时长,pri为所述初始值,L1为所述第一预设阈值,T为时钟周期;
所述计数数值从所述初始值递减计数到第二预设数值所需的时长的计算公式如下:
δt=(pri-L2)*T
其中,δt为计数数值从所述初始值递减计数到第二预设数值所需的时长,pri为所述初始值,L2为所述第二预设阈值,T为时钟周期。
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