[发明专利]用于硬件锁省略(HLE)的后期锁获取机制有效
申请号: | 201210067422.1 | 申请日: | 2008-11-07 |
公开(公告)号: | CN102722418A | 公开(公告)日: | 2012-10-10 |
发明(设计)人: | H·阿卡瑞;R·拉杰瓦;S·T·斯里尼瓦桑 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F9/52 | 分类号: | G06F9/52 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 毛力 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 硬件 省略 hle 后期 获取 机制 | ||
1.一种设备,包括:
解码逻辑,用于识别在临界段的开始处的、获取用于所述临界段的锁的锁指令;
执行逻辑,用于将所述获取用于所述临界段的锁的锁指令的至少一部分省略,将所述锁指令所参考的地址和锁值存储在锁项中,并执行所述临界段而不需要对所述临界段的锁;以及
后期锁获取逻辑,与所述执行逻辑耦合,所述后期锁获取逻辑用于使得所述执行逻辑响应于在所述临界段的未决期间遇到后期锁获取事件时尝试在所述临界段开始之后执行所述获取用于所述临界段的锁的锁指令的至少一部分,而不需要重新开始所述临界段。
2.如权利要求1所述的设备,其特征在于,还包括:与所述执行逻辑相关联的高速缓存存储器,其中所述锁指令参考所述锁值以及将与高速缓存存储器的线相关联的地址,并且其中所述后期锁获取逻辑用于使得所述执行逻辑尝试执行所述获取用于所述临界段的锁的锁指令包括:如果所述高速缓存存储器的线表示所述临界段的锁是可用的,则所述后期锁获取逻辑用于使得所述执行逻辑执行将所述锁值存储到与所述地址相关联的所述高速缓存存储器的线。
3.如权利要求2所述的设备,其特征在于,还包括:
存储区,耦合到所述执行逻辑和所述后期锁获取逻辑,所述存储区用于将与所述锁值相关联的地址保持在锁项堆栈的锁项中;以及
检测逻辑,耦合到所述解码逻辑和所述执行逻辑,所述检测逻辑用于识别所述锁指令的至少一部分将被省略以及所述执行逻辑省略所述锁指令的至少一部分的原因,其中所述锁指令的至少一部分包括对所述锁值的地址的存储。
4.如权利要求3所述的设备,其特征在于,与所述指令逻辑相关联的存储缓冲器用于保持与所述锁值的地址的存储相关的存储缓冲器项,所述存储缓冲器项用于保持阻塞代码字段,其中与所述存储缓冲器相关联的更新逻辑响应于所遇到的后期锁获取事件而将所述阻塞代码字段更新为阻塞值。
5.如权利要求4所述的设备,其特征在于,所述更新逻辑响应于后期锁获取逻辑使所述执行逻辑成功地完成对获取用于所述临界段的锁的锁指令的尝试执行,而将所述阻塞代码字段更新为解锁值。
6.如权利要求5所述的设备,其特征在于,所述锁指令包括读取修改写入(RMW)指令,且RMW指令的读取操作包括有存储意图的加载(LSI)操作,并且其中所述后期锁获取逻辑使所述执行逻辑成功地完成对获取用于所述临界段的锁的锁指令的尝试执行包括:所述后期锁获取逻辑使所述执行逻辑:执行所述LSI操作以从所述地址加载一加载值;执行修改操作以将所述加载值从可用值修改为所述锁值;并将所述锁值写入所述地址以获取所述锁。
7.如权利要求1所述的设备,其特征在于,所述后期锁获取事件是从包括下述的组中选择的:计时器的到期,其指示在预定量的时间内所述解码逻辑没有检测到与所述锁指令相对应的锁释放指令;高速缓存集合中的所有线均包括投机信息的检测;以及不可撤回事件的发生。
8.一种装置,包括:
处理部件,用于执行当前临界段以及后续临界段,其中所述处理部件进一步用于省略所述当前临界段的开始处以及后续临界段的锁获取;
访问缓冲器,与所述处理部件相关联,所述访问缓冲器用于保持与来自所述后续临界段的访问操作相关联的访问项,所述访问缓冲器项用于括阻塞代码字段,其中响应于所述访问项保持包括阻塞值的阻塞代码字段,而将阻止来自所述后续临界段的访问操作的分派;以及
更新逻辑,与所述访问缓冲器相耦合,所述更新逻辑在所述处理部件省略了用于当前临界段的锁获取之后,响应于所述处理部件尝试用于当前临界段的后期锁获取而更新所述阻塞代码字段为包括阻塞值,而不需要重新开始当前临界段。
9.如权利要求8所述的设备,其特征在于,所述阻塞代码字段用于默认地保持解锁值,其中响应于所述阻塞代码字段包括所述解锁值,所述访问操作无须被分派。
10.如权利要求8所述的设备,其特征在于,尝试用于当前临界段的所述后期锁获取是响应于在所述处理部件省略了用于当前临界段的锁获取之后在所述当前临界段的执行期间检测到后期锁获取事件,并且所述后期锁获取事件是从由计时器期满事件、填满的高速缓存集合事件以及不可撤回事件所组成的组中选择的。
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