[发明专利]一种用于消除具有光发射器的显示板中的重影现象的电路有效

专利信息
申请号: 201210181927.0 申请日: 2012-05-28
公开(公告)号: CN103258499A 公开(公告)日: 2013-08-21
发明(设计)人: 李红化;陈育涛;薛建新;杨文解;李守林;卢纯;温志峰;邱顯益;汤尚宽;内迪·纳德沙汗 申请(专利权)人: 广州硅芯电子科技有限公司
主分类号: G09G3/32 分类号: G09G3/32
代理公司: 北京市金杜律师事务所 11256 代理人: 郑立柱
地址: 510163 广东省*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 用于 消除 有光 发射器 显示 中的 重影 现象 电路
【说明书】:

相关申请

根据35 U.S.C§119,本申请要求享受2011年2月16日提交的第61/443703号的美国临时申请的优先权,并在此将其全文引用作为参考。

技术领域

本公开涉及用于驱动光发射器,诸如发光二极管(LED)的电路。更特别地,本公开涉及用于驱动包括光发射器阵列的LED显示器的电路,以减少、抵消、或消除LED显示器中的重影效应或重影图像。

背景技术

可以以时间复用布局技术驱动显示板,诸如LED显示器。然而时间复用驱动的缺点在于在显示板上出现重影效应或重影图像。

一般地,重影效应是指在显示板上出现的移动对象的拖尾。对于LED显示器,重影现象可能是由杂散平板电容(或寄生电容)导致,其产生重影电流尖峰并迫使时间复用的LED在LED应当已经被关掉时发射短暂的闪光。LED中的重影电路尖峰的确切幅度、持续时间和时序取决于电路中的杂散电容的数量、LED的前向电压特性、开关的时序特性等。短暂的闪光会在不合适的时间发生发光,从而导致质量较差图像。

随着数字LED显示板的大小和分辨率的提高,显示器设计中也越来越需要高杠杆(highly leveraged)的LED驱动器。这通常导致大量的扫描线和为多个LED使用相同的电流驱动器通道的可切换的配置。因此,在这样的设备中,需要大量的功率开关元件以及大量的接头电容。在整体的LED显示器系统设计中,杂散电容变得较为麻烦,因为它们保持了导致重影现象的弱充电。

对于至少一个以上的原因,需要设计能够快速放电杂散或寄生电容的LED驱动电路,以减少或消除在LED显示板上出现的重影现象。

发明内容

在一个实施例中,提供了一种用于为具有多个光发射器的显示板中的寄生电容放电的电路。该电路包括具有门极、源极和漏极的三端设备,其中源极和漏极中的一个电耦接至光发射器的共阳极;以及用于控制该三端设备的机构,该机构电耦接至该三端设备的门极。在先前已选择的光发射器被取消选择之后,所述机构迅速接通三端设备以形成在所述三端设备的源极和漏极之间的导电路径,从而通过该导电路径为所述寄生电容放电。在共阳极处的电压下降到预定电压水平或在最大时间段结束之后,所述机构断开三端设备。

在另一个实施例中,提供了一种用于消除在具有多个光发射器的显示板中的重影图像的电路。该电路包括第一电路分支、第二电路分支以及第三电路分支。第一电路分支、第二电路分支以及所述第三电路分支并联地电耦接在光发射器的共阴极和参考电压之间。第一电路分支形成第一导电路径,以在先前已选择的光发射器被取消选择之后,迅速充电所述显示板中的寄生电容。第二分支形成第二导电路径,以在选择下一个光发射器之后立即充电所述寄生电容。第三分支形成第三导电路径,以在先前所选择的光发射器被取消选择的情况下充电所述寄生电容。

在另一个实施例中,提供了一种显示板。该显示板包括具有共阴极的光发射器的阵列、电耦接至所述光发射器的阳极的电源、选择电路、和用于消除重影现象的电路。选择电路包括用于连续地选择一个或多个光发射器的多个开关。用于消除重影现象的电路包括充电电路,用于消除重影图像,还包括放电电路,用于消除显示板上的重影效应,所述放电电路包括重影效应删除模块,其电耦接至所述光发射器的阳极,并且所述充电电路包括重影图像删除模块,其电耦接至所述光发射器的共阴极。

附图说明

通过结合所附附图理解下述详细的说明能够容易地理解本发明的教导。

图1示出了依据本公开的一个实施例的包括LED阵列的显示板;

图2示出了依据本公开的一个实施例的显示板的连接拓扑图;

图3示出了依据本公开的一个实施例的用于消除显示板中的重影效应的图像校正电路;

图4示出了计时器保护如何在图3所示的图像校正电路中运作;

图5示出了依据本公开的另一个实施例的用于驱动显示板的电路的示意图;

图6示出了图5中驱动电路的时序图;

图7示出了图5中驱动电路的重影效应删除模块的实施方式;

图8示出了图5中驱动电路的重影图像删除模块的实施方式,重影图像删除模块包括第一电路分支、第二电路分支和第三电路分支;

图9示出了图8中重影图像删除模块的第一电路分支的示意图;

图10示出了图9中第一电路分支的延时模块的示意图;

图11示出了图9中第一电路分支的保护模块的示意图;

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