[发明专利]版图逻辑运算方法以及集成电路制造方法有效
申请号: | 201210261784.4 | 申请日: | 2012-07-26 |
公开(公告)号: | CN102760650A | 公开(公告)日: | 2012-10-31 |
发明(设计)人: | 江红;孔蔚然;李冰寒;郑舒静;林晓帆 | 申请(专利权)人: | 上海宏力半导体制造有限公司 |
主分类号: | H01L21/265 | 分类号: | H01L21/265;G06F17/50 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 郑玮 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 版图 逻辑运算 方法 以及 集成电路 制造 | ||
1.一种针对浅层离子注入层的版图逻辑运算方法,其特征在于包括:
首先获取这些浅层离子注入层的版图,版图是版图设计人员画的原始版图,或
者是经过逻辑运算产生的层的版图;
根据版图图案计算出光刻胶图案;
从光刻胶图案中找出位于隔离区上的光刻胶细长线条,所述光刻胶细长线条指的是长度大于第一尺寸且宽度小于第二尺寸的光刻胶部分;
其中,由于光刻胶细长线条邻接部分的器件区域掺杂类型相同,同时隔离区上的该离子注入是无效的,所以可将所述光刻胶细长线条邻接部分与所述光刻胶细长线条合并。
2.根据权利要求1所述的版图逻辑运算方法,其特征在于,逻辑运算仅仅针对浅层离子注入无法打穿的隔离区上的离子注入版图间距,即生产过程中的光刻胶所在位置的版图进行处理。
3.根据权利要求1所述的版图逻辑运算方法,其特征在于,将所述光刻胶细长线条邻接部分与所述光刻胶细长线条合并的步骤可包括:首先找出位于隔离区上的长度大于第一尺寸且宽度小于第二尺寸的光刻胶细长线条;然后合并光刻胶细长线条邻接部分的器件区域的浅层掺杂版图图形,从而使至少一部分所述位于隔离区上的光刻胶细长线条得以消除,使其消除在生产过程中剥离、产生缺陷、降低合格率的可能风险。
4.根据权利要求2所述的版图逻辑运算方法,其特征在于,由于部分隔离区上的光刻胶被消除,所以新增加了部分隔离区上的离子注入区域,即光刻胶连接的新增部分;经过版图逻辑运算后形成的浅层离子注入区域的包含所述新增部分以及原有版图的离子注入区域同时满足原有设计规则以及不再存在隔离区上光刻胶细长线条的新增设计规则检查错误。
5.根据权利要求1至4之一所述的版图逻辑运算方法,其特征在于,只针对完全位于隔离区上的光刻胶图案执行所述版图逻辑运算方法。
6.根据权利要求1至4之一所述的版图逻辑运算方法,其特征在于,所述光刻胶细长线条包括成角度的曲线线条。
7.根据权利要求1至4之一所述的版图逻辑运算方法,其特征在于,所述光刻胶细长线条包括成直角的曲线线条。
8.根据权利要求1至4之一所述的版图逻辑运算方法,其特征在于,所谓细长的光刻胶细长线条长度小于第一尺寸L,宽度小于第二尺寸W,并且L与W的确定是由光刻机生产能力决定的。
9.一种根据权利要求1至8之一所述的版图逻辑运算方法的集成电路制造方法。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造