[发明专利]星载电子系统接口转换模块有效
申请号: | 201210589840.7 | 申请日: | 2012-12-31 |
公开(公告)号: | CN103019997A | 公开(公告)日: | 2013-04-03 |
发明(设计)人: | 张迎春;束磊;刘源;李兵;黄瀚;罗红吉;潘小彤 | 申请(专利权)人: | 哈尔滨工业大学 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 哈尔滨市松花江专利商标事务所 23109 | 代理人: | 牟永林 |
地址: | 150001 黑龙*** | 国省代码: | 黑龙江;23 |
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摘要: | |||
搜索关键词: | 电子 系统 接口 转换 模块 | ||
技术领域
本发明涉及一种接口转换模块,具体涉及星载电子系统接口转换模块。
背景技术
随着电子技术和计算机技术的不断发展,航天任务复杂化的提高,未来星载设备的数据接口形式多样化,因此有必要设计一种高效的接口转换模块,简化卫星内部线路结构,降低设计成本,使卫星综合电子系统达到高度集成性和综合性,充分实现资源共享,信息融合。
随着SpaceWire高速总线在航天领域的快速发展,逐渐成为星载电子系统标准总线,现有技术存在SpaceWire信号与CAN信号、485信号和422信号之间无法相互转换,兼容性差的问题。
发明内容
本发明为了解决现有技术存在SpaceWire信号与CAN信号、485信号和422信号之间无法相互转换,兼容性差的问题,从而提出了星载电子系统接口转换模块。
星载电子系统接口转换模块,它包括基于静态随机存储器的FPGA模块、第二代双倍数据率同步动态随机存取存储器(简称DDR2 SDRAM,全称Double-Data-Rate Two Synchronous Dynamic RandomAccess Memory)、单片机、静态随机存储器和FLASH内存,所述的基于静态随机存储器的FPGA模块包括SpaceWire编译码IP核、信号转换电路、路由电路、CAN编解码模块、485编解码模块、422编解码模块、状态控制电路、监测电路和FPGA配置端口,
信号转换电路共有:三个数据信号输入输出端、一个心跳信号输出端和一个缓存信号端,
路由电路共有:五个数据信号输入输出端和一个心跳信号输出端,
状态控制电路共有:两个数据信号输入输出端、一个数据信号输入端和一个控制信号输出端,
监测电路共有:两个心跳信号输入端和一个数据信号输出端,
单片机共有:一个配置信号输出端,一个控制信号输入端,一个数据信号输入端和一个数据信号输入输出端;
CAN编解码模块的数据信号输入输出端与路由电路的第一数据端连接,
485编解码模块的数据信号输入输出端与路由电路的第二数据端连接,
422编解码模块的数据信号输入输出端与路由电路的第三数据端连接,
路由电路的心跳信号输出端与监测电路的第一心跳信号输入端连接,
路由电路的第四数据信号输入输出端与状态控制电路的第一数据信号输入输出端连接,
路由电路的第五数据信号输入输出端与信号转换电路的第一数据信号输入输出端连接,
信号转换电路的缓存信号端与第二代双倍数据率同步动态随机存取存储器的缓存信号端连接,
信号转换电路的第二数据信号输入输出端与SpaceWire编译码IP核的数据信号输入输出端连接,
信号转换电路的第三数据信号输入输出端与状态控制电路的数据信号输入输出端连接,
信号转换电路的心跳信号输出端与监测电路的第二心跳信号输入端连接,
监测电路的数据信号输出端与状态控制电路的数据信号输入端连接,
状态控制电路的控制信号输出端与单片机的控制信号输入端连接,
单片机的数据信号输入端与FLASH内存的数据信号输入端连接,
单片机的数据信号输入输出端与静态随机存储器的数据信号输入输出端连接,
单片机的配置信号输出端与FPGA配置端口连接。
本发明的优点是:通过将不同总线信号与SpaceWire信号进行相互转换,简化了卫星的线路结构,降低设计成本,使卫星综合电子系统达到高度集成性和综合性,促进资源共享,信息融合。且结构简单,易于实现,具有可重构容错特性。本发明通过将SpaceWire信号与CAN信号、485信号和422信号之间相互转换增加设备间的兼容性,从而促进航天电路的模块化设计。
附图说明
图1为星载电子系统接口转换模块的结构示意图。
具体实施方式
具体实施方式一、结合图1具体说明本实施方式,本实施方式所述的星载电子系统接口转换模块,它包括基于静态随机存储器的FPGA模块1、第二代双倍数据率同步动态随机存取存储器2、单片机3、静态随机存储器4和FLASH内存5,所述的基于静态随机存储器的FPGA模块1包括SpaceWire编译码IP核1-1、信号转换电路1-2、路由电路1-3、CAN编解码模块1-4、485编解码模块1-5、422编解码模块1-6、状态控制电路1-7、监测电路1-8和FPGA配置端口1-9,
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