[实用新型]一种浪涌保护器监视装置有效

专利信息
申请号: 201220001185.4 申请日: 2012-01-04
公开(公告)号: CN202435137U 公开(公告)日: 2012-09-12
发明(设计)人: 胡忠伟;周道平 申请(专利权)人: 航天科工深圳(集团)有限公司
主分类号: H02J13/00 分类号: H02J13/00;G01R31/00
代理公司: 深圳中一专利商标事务所 44237 代理人: 张全文
地址: 518000 广东省深圳市*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 浪涌保护器 监视 装置
【权利要求书】:

1.一种浪涌保护器监视装置,与监控终端连接,且通过电力线与浪涌保护器相连接,其特征在于,所述浪涌保护器监视装置包括充电电路、电池、电源电路、显示电路、载波通信电路以及中央处理电路,所述中央处理电路包括:

电源端接所述电源电路的输出端,充电控制端接所述充电电路的控制端,数显端接所述显示电路的输入端,载波通讯端接所述载波通信电路的通信端,与所述载波通信电路进行双向通信,并对所述载波通信电路反馈回来的浪涌保护器的运行状态数据进行处理的微处理单元;

通讯端接所述微处理单元的RS通信端,对外通讯端与监控终端相连接,第一电源端接所述电池的输出端,第二电源端接所述电源电路的输出端,在所述微处理单元与所述监控终端之间建立基于RS电平协议的通信路径的RS接口电路单元;

输入端接所述电池的输出端,输出端接所述微处理单元的第二电源端,为所述微处理单元提供工作电源的供电单元;

第一时钟输出端和第二时钟输出端分别与所述微处理单元的第一时钟端和第二时钟端相连接,为所述微处理单元提供工作时钟信号的时钟单元;

输入端接所述电源电路的输出端,输出端接所述微处理单元的复位端,看门狗驱动端接所述微处理单元的驱动信号输出端,为所述微处理单元提供复位信号的复位单元。

2.如权利要求1所述的浪涌保护器监视装置,其特征在于,所述中央处理电路还包括:

数据通信端与所述微处理单元的数据存取端相连接,对所述微处理单元需要保存的数据进行存储的存储器;

信号端与所述微处理单元的USB通信端相连接,对外通讯端与所述监控终端相连接,在所述微处理单元与所述监控终端之间建立基于USB通信协议的通信路径的USB接口电路单元;

信号端接所述微处理单元的以太网通信端,对外通讯端接所述监控终端,电源端接所述电源电路的输出端,在所述微处理单元与所述监控终端之间建立基于以太网通信协议的通信路径的以太网接口电路单元。

3.如权利要求1所述的浪涌保护器监视装置,其特征在于,所述微处理单元包括微处理器U1、电感L1及电容C1,所述微处理器U1的第一电源脚至第八电源脚共同构成所述微处理单元的电源端,且所述微处理器U1的第一电源脚至第八电源脚彼此相互连接,所述微处理器U1的第一通用输入输出脚和第二通用输入输出脚共同构成所述微处理单元的RS通信端,所述微处理器U1的第三通用输入输出脚、USB接地脚、USB差分信号正脚及USB差分信号负脚共同构成所述微处理单元的USB通信端,所述微处理器U1的第四通用输入输出脚、第五通用输入输出脚、第六通用输入输出脚、第七通用输入输出脚、第八通用输入输出脚以及第九通用输入输出脚共同构成所述微处理单元的充电控制端,所述微处理器U1的第十通用输入输出脚、第十一通用输入输出脚、PHY接地脚、基带I信号正接入脚、基带I信号负接入脚、基带O信号正输出脚、基带O信号负输出脚、PHY时钟正输入脚以及PHY时钟负输入脚共同构成所述微处理单元的以太网通信端,所述微处理器U1的系统复位脚为所述微处理单元的复位端,所述微处理器U1的第一时钟输入脚和第二时钟输入脚分别为所述微处理单元的第一时钟端和第二时钟端,所述微处理器U1的模拟接地端、第一接地端、第二接地端、第三接地端、第四接地端、第五接地端、第六接地端以及第七接地端均接地,所述微处理器U1的第十二通用输入输出脚、第十三通用输入输出脚、第十四通用输入输出脚、第十五通用输入输出脚、第十六通用输入输出脚、第十七通用输入输出脚、第十八通用输入输出脚、第十九通用输入输出脚、第二十通用输入输出脚、第二十一通用输入输出脚、第二十二通用输入输出脚以及第二十三通用输入输出脚共同构成所述微处理单元的数据存取端,所述微处理器U1的第二十四通用输入输出脚和第二十五通用输入输出脚共同构成所述微处理单元的载波通讯端,所述微处理器U1的第二十六通用输入输出脚至第三十三通用输入输出脚、第三十四通用输入输出脚、第三十五通用输入输出脚、第三十六通用输入输出脚、第三十七通用输入输出脚、第三十八通用输入输出脚、第三十九通用输入输出脚以及第四十通用输入输出脚共同构成所述微处理单元的数显端,所述微处理器U1的第四十一通用输入输出脚为所述微处理单元U1的驱动信号输出端,所述微处理器U1的第一逻辑电源脚、第二逻辑电源脚及稳压脚共同构成所述微处理单元的第二电源端,所述电感L1的第一端接所述微处理器U1的第一电源脚,所述电感L1的第二端同时与所述电容C1的第一端及所述微处理器U1的模拟电源端相连接,所述电容C1的第二端接地。

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