[实用新型]一种可编程的数字逻辑电路基础实验板有效
| 申请号： | 201220114691.4 | 申请日： | 2012-03-22 |
| 公开（公告）号： | CN202502660U | 公开（公告）日： | 2012-10-24 |
| 发明（设计）人： | 王鹏 | 申请（专利权）人： | 苏州市职业大学 |
| 主分类号： | G09B23/18 | 分类号： | G09B23/18 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 215000 江苏省*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 一种 可编程 数字 逻辑电路 基础 实验 | ||
1.一种可编程的数字逻辑电路基础实验板，其特征在于：包括一PCB板(1)，所述PCB板(1)中间设置有CPLD芯片(2)，所述CPLD芯片(2)分别连接独立逻辑门(3)、加法器(4)和触发器(5)；所述PCB板(1)上部设置有电源电路(6)、8位LED(7)和4位LED数码管(8)，所述8位LED(7)和所述4位LED数码管(8)均与所述CPLD芯片(2)连接；所述PCB板(1)的右下角设置有8位开关按键(9)及8位LED指示电路(10)，所述8位开关按键(9)及所述8位输入状态指示LED(10)均与所述所述CPLD芯片(5)连接；所述PCB板(1)的左下角设置有两个拔码开关，所述两个拔码开关为时钟频率选择电路(11)和实验模块选择电路(12)，所述两个拔码开关均与所述CPLD芯片(2)连接；所述CPLD芯片(2)还连接JTAG调试及下载口(13)、信号测量端口(14)。
2.根据权利要求1所述的可编程的数字逻辑电路基础实验板，其特征在于：所述CPLD芯片(2)内部设置有10个组合逻辑电路，所述组合逻辑电路包括计数器、译码器、分频器。
3.根据权利要求1所述的可编程的数字逻辑电路基础实验板，其特征在于：所述CPLD芯片(2)内部设置有6个时序逻辑电路，所述时序逻辑电路包括寄存器、分频器。
4.根据权利要求1所述的可编程的数字逻辑电路基础实验板，其特征在于：所述PCB板(1)上预留了若干组独立的非门、与门、或门电路及D触发器接口。
5.根据权利要求1所述的可编程的数字逻辑电路基础实验板，其特征在于：所述PCB板(1)的尺寸大小为11*10cm。
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