[实用新型]一种基于双口RAM数据共享和422串口通信的数据交换器有效
申请号: | 201220371045.6 | 申请日: | 2012-07-30 |
公开(公告)号: | CN202694337U | 公开(公告)日: | 2013-01-23 |
发明(设计)人: | 董玉花 | 申请(专利权)人: | 四川九洲电器集团有限责任公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 成都九鼎天元知识产权代理有限公司 51214 | 代理人: | 徐宏;吴彦峰 |
地址: | 621000*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 基于 ram 数据 共享 422 串口 通信 交换 | ||
技术领域
本实用新型涉及一种数据交换器,特别是涉及一种基于双口RAM数据共享和422串口通信的数据交换器。
背景技术
双口RAM是在1个RAM存储器上具有两套完全独立的数据线、地址线和读写控制线,并允许两个独立的系统同时对其进行随机性访问的存储器,即共享多端口存储器。双口RAM最大的特点是可实现存储数据共享。
随着电子技术的飞速发展,大量的高速数据采集和在线测试对现代工业测控系统和仪器仪表的功能和性能提更高要求,CPU并行工作(双 单片机系统)方式得到广泛应用。为了使两个单片机能够快速有效交换信息,充分利用系统资源,采用双口RAM实现存储器共享是目前较为流行的方法。但这种方法仅仅只能实现两个系统之间的数据交换。
如果在两个以上的系统之间进行数据交换,由于所选CPU系统资源的局限性,则不能全部采用共享双口RAM的方式进行数据交换,否则就得增加CPU的使用数量,导致增大电路设计的难度,而需采用其它的方式来满足两个以上系统之间的数据交换的需求。
在本专利中,为了最大限度的利用CPU的系统资源,就针对它唯一的串口进行了扩展,因此采用了422串口通信与共享双口RAM的方式相结合的方式来完成了这一设计需求。之所以采用422串口通信是因为422串口通信比起同类别的232串口通信具有接口芯片体积小,配置电路简单,通信可靠性更高的优点存在。所以本专利是两种数据交换方式相结合的复合型的数据交换器。这种设计能够减少电路设计的复杂性,增强设计的灵活性和资源的可配置性能,降低了设计成本,是一项实用的新型设计。
实用新型内容
本实用新型的目的是提供一种基于双口RAM数据共享和422串口通信的数据交换器,该交换器外部与双口RAM相连,采用422接口与多个受控单元相连,实现一个供多个受控单元的多方通信数据交换的平台。电路简单,设计灵活,资源可配置性强。
本实用新型或发明采用的技术方案如下:一种基于双口RAM数据共享和422串口通信的数据交换器,包括依次相连的总线驱动器A3、地址锁存器A 2、微处理器A 1、可编程逻辑器件A4和对外接口单元A 5,其特征在于:
所述总线驱动器A 3与双口RAM相连;
所述对外接口单元A 5与受控单元相连。
作为优选,还包括供电电路,供电电路分别与总线驱动器A3、地址锁存器A 2、微处理器A 1、可编程逻辑器件A 4、对外接口单元A 5相连。
作为优选,所述对外接口单元A 5包括至少两个对外接口芯片;
所述对外接口芯片分别与可编程逻辑器件A 4相连;
所述对外接口芯片又与受控单元一一对应相连。
作为优选,可编程逻辑器件A 4为电可擦除可编程逻辑器件。
作为优选,所述总线驱动器A3为双线总线驱动器。
与现有技术相比,本实用新型的有益效果是:
1、基于双口RAM的设计,实现了数据共享;
2、基于422串口通信的方式实现了多方通信的数据交换,电路结构简单,可配置性强;
3、使用微处理器单片机及可编程逻辑器件,使得设计灵活,可扩展性强。
附图说明
图1为本实用新型的结构框图。
图2为本实用新型其中一实施例的地址锁存器结构示意图。
图3为图2所示实施例的P0口双向总线驱动器连接示意图。
图4为图2所示实施例的微处理器系统扩展示意图。
图5为图2所示实施例的单片机工作流程图。
图6为图2所示实施例的MBI()终端子程序流程图。
图7为图2所示实施例的BCON()子程序流程图。
图8为图2所示实施例的串口连接示意图。
图9为图2所示实施例的微处理器数据发送逻辑关系示意图。
图10为图2所示实施例的受控单元数据回传逻辑关系示意图。
具体实施方式
为了使本实用新型的目的、技术方案及优点更加清楚明白,以下结合附图及实施例,对本实用新型进行进一步详细说明。应当理解,此处所描述的具体实施例仅用以解释本实用新型,并不用于限定本实用新型。
在本具体实施例中以三方通信的数据交互平台为例进行具体实施方式的说明。
如图1所示,一种基于双口RAM数据共享和422串口通信的数据交换器,包括依次相连的总线驱动器A3、地址锁存器A 2、微处理器A 1、可编程逻辑器件A 4和对外接口单元A 5。
所述总线驱动器A 3与双口RAM相连;
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