[实用新型]系统级封装结构有效

专利信息
申请号: 201220494810.3 申请日: 2012-09-25
公开(公告)号: CN202905697U 公开(公告)日: 2013-04-24
发明(设计)人: 赵立新 申请(专利权)人: 格科微电子(上海)有限公司
主分类号: H01L23/488 分类号: H01L23/488;H01L25/065
代理公司: 北京戈程知识产权代理有限公司 11314 代理人: 程伟;孙向民
地址: 201203 上海市*** 国省代码: 上海;31
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摘要:
搜索关键词: 系统 封装 结构
【说明书】:

技术领域

实用新型涉及半导体制造领域,特别涉及一种系统级封装结构。

背景技术

随着集成电路芯片变得越来越小,集成度越来越高,同时必须不断的减小集成电路芯片的封装尺寸,为了达到上述目的,目前广泛的使用系统级封装技术,从而达到减小封装的尺寸。

系统级封装是在一个半导体封装结构内将多个不同类型或功能的芯片封装在一起,构成一个集成度高、功能更加完整的封装结构。

目前采用的系统级封装是先设计出能够实现某种具体功能的系统级芯片,在根据所设计出来的系统级芯片的尺寸、焊垫数量和结构以及所需的存储容量等参数来设计与系统级芯片相对应的存储器芯片。在实际的应用中,不同的仪器、设备、电子产品等所需要的系统级芯片都是不同的,这样需要根据不同的系统级芯片设计出对应的储存器芯片,这样会造成储存器设计的工艺繁杂,针对不同的系统级芯片要设计出不同的存储器芯片。而一旦生产出多余的存储器芯片后,也会造成这种储存器的浪费,不利于工业上节约成本。

实用新型内容

本实用新型要解决的技术问题就是提供一种系统级封装结构,这种系统级封装结构能够预先统一地设计出第一芯片单元,简化了第一芯片单元的设计,根据第二芯片的尺寸和/或所需的存储容量,确定与第二芯片对应的第一芯片单元的数量,能够方便的实现第二芯片所需容量的扩展。

为了解决上述问题,本实用新型所利用的技术方案是提供一种系统级封装结构,包括:

第一衬底,所述第一衬底包括一个或多个第一芯片单元和位于所述第一芯片单元上的第一焊垫;

第二衬底,所述第二衬底包括一个或多个第二芯片和位于所述第二芯片上的第二焊垫;

所述第一衬底和所述第二衬底键合连接,所述第二芯片和与所述第二芯片对应的一个或多个第一芯片单元键合连接,且所述第一焊垫和所述第二焊垫键合连接。

优选的,所述第一芯片单元包括一个或多个结构相同的存储器芯片。

优选的,所述第一芯片单元包括多个具有不同结构的存储器芯片。例如,第一芯片单元中的多个存储器芯片可以是存储器芯片上的焊垫数量不同,也可以是焊垫大小、形状或位置的不同,还可以是存储器芯片的尺寸的不同。

优选的,第一芯片单元中的多个存储器芯片具有相同的存储容量或不同的存储容量。

优选的,所述存储器为易失性存储器或非易失性存储器。更优选的,所述存储器为闪存、DRAM或相变存储器。

优选的,所述第二芯片为能够实现多种逻辑功能的系统级芯片。

优选的,根据所述第二芯片所需的存储容量,确定与所述第二芯片对应的第一芯片单元的数量,根据确定的所述第一芯片单元的数量和布置方式,确定第二芯片的尺寸及布置方式。例如,根据第二芯片所需的储存容量,可以是第二芯片对应一个第一芯片单元,可以是第二芯片对应多个第一芯片单元,还可以是第二芯片对应第一芯片单元中的一部分或半个第一芯片单元。

优选的,根据所述第二芯片的尺寸,确定与所述第二芯片对应的第一芯片单元的数量,根据确定的所述第一芯片单元的数量和布置方式,确定第二芯片的布置方式。例如,根据第二芯片的尺寸大小,可以是第二芯片对应一个第一芯片单元,可以是第二芯片对应多个第一芯片单元,还可以是第二芯片对应第一芯片单元中的一部分或半个第一芯片单元。

优选的,根据确定使用的所述第一芯片单元中的第一焊垫的数量及布置确定所述第二芯片中的第二焊垫的数量及布置。

本实用新型还提供一种系统级封装方法,包括下列步骤:

在第一衬底上形成具有一个或多个第一芯片单元和位于所述第一芯片单元上的第一焊垫;

在第二衬底上形成具有一个或多个第二芯片和位于所述第二芯片上的第二焊垫;

将所述第一衬底和所述第二衬底键合连接,使得所述第二芯片和与所述第二芯片对应的一个或多个第一芯片单元键合连接,且所述第一焊垫和所述第二焊垫键合连接。

优选的,第一芯片单元包括一个或多个结构相同的存储器芯片。

优选的,第一芯片单元包括多个具有不同结构的存储器芯片。

优选的,多个存储器芯片具有相同的存储容量或不同的存储容量。

优选的,根据所述第二芯片所需的存储容量,确定与所述第二芯片对应的第一芯片单元的数量,根据确定的所述第一芯片单元的数量和布置方式,确定第二芯片的尺寸及布置方式。

优选的,根据所述第二芯片的尺寸,确定与所述第二芯片对应的第一芯片单元的数量,根据确定的所述第一芯片单元的数量和布置方式,确定第二芯片的布置方式。

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