[发明专利]用于将逻辑核动态地重新映射到物理核的处理器和方法有效
申请号: | 201280018246.0 | 申请日: | 2012-04-13 |
公开(公告)号: | CN103477324B | 公开(公告)日: | 2017-09-08 |
发明(设计)人: | 迈克尔·J·奥斯本;塞巴斯蒂安·J·努斯鲍姆 | 申请(专利权)人: | 超威半导体公司 |
主分类号: | G06F9/50 | 分类号: | G06F9/50 |
代理公司: | 上海胜康律师事务所31263 | 代理人: | 李献忠 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 逻辑 动态 映射 | ||
技术领域
本公开内容一般涉及处理器,更确切地来说,涉及将工作负荷分布在多个处理器核之间。
背景技术
延长集成电路的寿命常常是重要的设计目标,因为在许多情况中,消费者需要能够超长时间以及在显著应力下可靠地工作的电路。开发者因此尝试将影响集成电路的使用寿命的多种因素纳入考虑。
影响处理器的寿命预期值的一个重要因素是处理器随时间推移所经受的工作负荷。超长时间高工作负荷下运行的处理器(如用于服务器系统中的处理器)可能经受与电子迁移、电介质击穿或热引发的磨耗相关的更大量的硅应力。这些因素进而可能显著地缩短处理器的使用寿命。相应地,在一些情况中,降低处理器的工作负荷对于改善其寿命预期值可能是值得期望的。
发明内容
本公开内容描述将逻辑核动态地重新映射到物理核的结构和方法的多种实施方案。
在一个实施方案中,公开了一种处理器。该处理器包括多个物理核,并且配置成存储逻辑核至多个物理核的映射。该处理器还包括分配单元,该分配单元配置成在处理器引导进程之后将逻辑核重新映射到多个物理核。
在一个实施方案中,公开了一种方法。该方法包括处理器上的多个物理核执行一组任务,其中该组任务基于逻辑核至多个物理核的映射来分配。该方法还包括在操作系统执行时处理器将逻辑核重新映射到多个物理核。基于重新映射分配一组附加任务。
在一个实施方案中,公开了一种计算机可读存储介质。该存储介质包括数据结构,由计算机系统上可执行的程序对该数据结构操作。程序操作数据结构是可执行的以执行一部分进程以制造包括由数据结构描述的电路的处理器。由数据结构描述的电路包括多个物理核。该处理器配置成存储逻辑核至多个物理核的映射。该电路还包括分配单元,该分配单元配置成在处理器引导进程之后将逻辑核重新映射到多个物理核。
附图说明
图1是示出包括多核处理器的计算机系统的一个实施方案的方框图,该多核处理器配置成将逻辑核动态地重新映射到物理核。
图2是示出可以包括在多核处理器中的分配单元的一个实施方案的方框图。
图3是示出可以包括在分配单元中的确定单元的一个实施方案的方框图。
图4是示出用于将逻辑核动态地重新映射到物理核的方法的一个实施方案的流程图。
图5是示出示例性计算机系统的一个实施方案的方框图。
具体实施方式
本说明书包括对“一个实施方案”或“实施方案”的引述。因此,短语“在一个实施方案中”或“在实施方案中”的出现不一定是指同一实施方案。可以与本公开内容一致的任何适合方式将特定的特征、结构或特性进行组合。
术语。下文段落提供本公开内容(包括所附权利要求)中出现的术语的定义和/或语境。
“包括”。此术语是开放式的。正如所附权利要求中所使用的,此术语不排除另外的结构或步骤。考虑权利要求,其列举:“一种装置,其包括一个或多个处理器单元…”此类权利要求不排除该装置包括另外的组件(例如,网络接口单元、图形电路等)。
“配置成”。可以将多种单元、电路或其他组件描述为或要求权利为“配置成”执行一个或多个任务。在此类语境中,“配置成”用于通过指示单元/电路/组件包括在操作期间执行这些一个或多个任务的结构(例如电路)来暗含结构。因此,当指定的单元/电路/组件当前未工作(例如,未开启),可以说单元/电路/组件配置成执行该任务。与“配置成”语言一起使用的单元/电路/组件包括硬件–例如,电路、存储可执行以执行操作的程序指令的存储器等。列举单元/电路/组件“配置成”执行一个或多个任务显性地意味着不对该单元/电路/组件援用35U.S.C.§112,第六段。此外,“配置成”还可以包括由软件和/或固件(例如,FPGA或执行软件的通用处理器)操控以能够执行涉及的任务的方式工作的通用结构(例如,通用电路)。“配置成”还可以包括调适制造进程(例如半导体加工设施)以加工调适成实现或执行一个或多个任务的装置(例如集成电路)。
“第一”、“第二”等。正如本文所使用的,这些术语用作它们所引导的名词的标记,而不意味着任何类型的排序(例如,空间上、时间上、逻辑上等)。例如,在具有8个处理元件或核的处理器中,术语“第一”和“第二”处理元件可以用于指代8个处理元件中的任何两个。换言之,“第一”和“第二”处理元件不限于逻辑处理元件0和1。
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