[发明专利]用于降低平台中空闲链路功率的方法和装置有效
申请号: | 201280042566.X | 申请日: | 2012-07-02 |
公开(公告)号: | CN103765345A | 公开(公告)日: | 2014-04-30 |
发明(设计)人: | P·S·迪芬鲍;R·E·高夫;Y·巴克拉克;M·C·亨塞克;R·本-塔尔;I·帕尔多;G·普拉特;D·J·哈里曼 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F1/32 | 分类号: | G06F1/32;G06F13/14 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 王英;张立达 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 降低 平台 空闲 功率 方法 装置 | ||
技术领域
本发明涉及平台,并且更具体但非排它地涉及用于降低平台中空闲链路功率的方法和装置。
背景技术
高速串行通信链路经常用于平台中以便提供快速数据访问。然而,这些高速的串行通信链路经常要求高空闲功率。在诸如手持和平板电脑的功率敏感的平台中,由于高空闲功率要求,高速串行通信链路可能不适合。
附图说明
通过以下对本主题的详细描述,本发明实施例的特征和优势将变得明显,其中:
图1说明了根据本发明一个实施例的平台的框图;
图2说明了根据本发明一个实施例的主机设备和端点设备的框图;
图3说明了根据本发明一个实施例的链路状态的框图;
图4说明了根据本发明一个实施例的上游端口发起的链路状态退出的时序图;
图5说明了根据本发明一个实施例的下游端口发起的链路状态退出的时序图;
图6说明了根据本发明一个实施例的上游端口发起的链路状态退出的时序图;
图7说明了根据本发明一个实施例的下游端口发起的链路状态退出的时序图;
图8说明了根据本发明一个实施例用于实现本文公开的方法的系统。
具体实施方式
在附图中通过示例而非限制的方式说明了本文描述的本发明的实施例。为了说明的简单与清晰,图中说明的元素不必按比例绘制。例如,为了清晰起见,一些元件的尺寸可以相对于其它元件被放大。此外,在被认为合适的情况下,在附图中重复附图标记以便指示相对应或类似的元件。
在说明书中对本发明“一个实施例”或“实施例”的引述意味着结合所述实施例描述的特定特征、结构或特性包括在本发明的至少一个实施例中。因此,贯穿本说明书多处出现的短语“在一个实施例中”不必全部指代相同的实施例。
术语“上游”和“下游”用于说明在本发明一个实施例的平台中业务或数据流的方向,并且并不意在是限制性的。术语“上游”和“下游”在本发明的另一实施例中可以互换。在不影响本发明的工作的情况下,可以使用用于描述平台中的业务或数据流的方向的其它术语。
本发明的实施例提供用于降低平台中空闲功率的方法和装置。在本发明的一个实施例中,平台中的主机以及其耦接的端点分别具有低功率空闲链路状态,其允许主机以及其耦接的端点二者中的高速链路电路的禁用。在本发明的一个实施例中,由于主机设备以及其耦接的端点二者能够关闭它们的高速链路电路,因此这允许平台降低其空闲链路功率。所述高速链路电路的禁用包括但不局限于:电压输入的功率门控、切断输入时钟以及用于降低高速链路电路功率的功耗的任何其它技术。
在本发明的一个实施例中,低功率空闲链路状态是现有的低功率链路状态的子状态。在本发明的另一实施例中,所述低功率空闲链路作为所述平台的新链路状态而被添加。所述平台包括但不局限于:台式计算机、膝上型计算机、上网本计算机、手持计算机、平板计算机、笔记本计算机、个人数字助理(PDA)、服务器、工作站、蜂窝电话、智能手机、移动计算设备、互联网装置或任何其它类型的计算设备。
图1说明了根据本发明一个实施例的平台105的框图100。在本发明的一个实施例中,平台105至少部分地符合外围部件互连(PCI)高速(PCIe)标准或由PCI特别兴趣组(PCI-SIG)维持的规范。在本发明的一个实施例中,所述平台至少部分地符合高级配置与功率接口规范(ACPI标准,“高级配置与功率接口规范”,版本4.0a,2010年4月5日出版)。在本发明的另一实施例中,所述平台至少部分地符合ACPI标准的早期和/或未来版本。
在本发明的一个实施例中,平台105具有耦接到根组件120的处理核心110。根组件120与总线140和存储器130耦接并且支持三个根端口142、144和146。根端口142、144和146分别经由PCIe通信链路152、154和156与PCIe端点设备1-3160、162和164耦接。在本发明的一个实施例中,每一个根端口142、144和146具有与PCIe端点设备1-3160、162和164的各自下游端口耦接的上游端口。
在本发明的一个实施例中,根组件120代表处理器核心110生成事务请求。在本发明的一个实施例中,根组件120与处理核心120集成。在本发明的另一实施例中,根组件120支持多于三个根端口。在本发明的又一实施例中,根组件120支持少于三个根端口。
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