[发明专利]D/A转换器有效
申请号: | 201310058162.6 | 申请日: | 2013-02-25 |
公开(公告)号: | CN103297056A | 公开(公告)日: | 2013-09-11 |
发明(设计)人: | 铃木久雄 | 申请(专利权)人: | 富士通半导体股份有限公司 |
主分类号: | H03M1/66 | 分类号: | H03M1/66 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 朱胜;陈炜 |
地址: | 日本神奈*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 转换器 | ||
1.一种数模D/A转换器,其生成与数字输入信号相对应的模拟信号,所述D/A转换器包括:
多个D/A转换电路;以及
以负反馈方式耦接在所述多个D/A转换电路之间的放大器电路;
其中:
所述多个D/A转换电路包括:第一级D/A转换电路,被配置成接收包括所述数字输入信号的最低有效位的多位数字输入信号;以及其他D/A转换电路,被配置成接收比其前一级D/A转换电路接收到的数字输入信号的位更高阶的位,并且
每个D/A转换电路均包括:
与所述D/A转换电路接收到的数字输入信号相对应的R-2R梯型电阻器网络,
多个第一晶体管,耦接在所述电阻器网络与处于第一电压电平的第一接线之间,所述多个第一晶体管的尺寸以2的幂为比率来进行设置,以及
多个第二晶体管,耦接在相应的电阻器网络与处于第二电压电平的第二接线之间,并且根据所述数字输入信号来与所述多个第一晶体管互补地分别导通和关断,所述多个第二晶体管的尺寸以2的幂为比率来进行设置。
2.根据权利要求1所述的D/A转换器,其中:
每个R-2R梯型电阻器网络均包括:
多个第一电阻器,串联耦接在第一节点与输出节点之间,
多个第二电阻器,被设置为具有为所述第一电阻器的电阻值两倍的电阻值,具有耦接到所述第一电阻器的第一端子,并且与输入数字信号的位数相对应,以及
第三电阻器,被设置为具有与所述第二电阻器的电阻值相等的电阻值,并且具有耦接到所述第一节点的第一端子;
所述第二电压被提供到所述第一级D/A转换电路的所述第三电阻器的第二端子;并且
所述放大器电路的输出信号被提供到所述其他D/A转换电路的所述第三电阻器的第二端子。
3.根据权利要求1所述的D/A转换器,其中:
所述放大器电路包括:
用于高电压的第一放大器电路,被提供了从所述前一级D/A转换电路输出的模拟信号,并且以负反馈方式耦接,
用于低电压的第二放大器电路,被提供了从所述前一级D/A转换电路输出的模拟信号,并且以负反馈方式耦接,
第一开关,耦接在所述第一放大器电路的输出端子与下一级D/A转换电路之间,以及
第二开关,耦接在所述第二放大器电路的输出端子与所述下一级D/A转换电路之间;并且
所述第一开关和所述第二开关根据与所述前一级D/A转换电路相对应的数字输入信号的最高有效位来互补地闭合和断开。
4.根据权利要求2所述的D/A转换器,其中:
所述放大器电路包括:
用于高电压的第一放大器电路,被提供了从所述前一级D/A转换电路输出的模拟信号,并且以负反馈方式耦接,
用于低电压的第二放大器电路,被提供了从所述前一级D/A转换电路输出的模拟信号,并且以负反馈方式耦接,
第一开关,耦接在所述第一放大器电路的输出端子与下一级D/A转换电路之间,以及
第二开关,耦接在所述第二放大器电路的输出端子与所述下一级D/A转换电路之间;
所述多个D/A转换电路包括耦接在所述第一节点与所述第二接线之间的第三晶体管,所述第三晶体管的尺寸与响应于相应的数字输入信号的最低有效位的第二晶体管的尺寸;
所述第一级D/A转换电路的所述第三晶体管的栅极端子耦接到所述第一接线;
包括有控制信号生成电路,所述控制信号生成电路根据与所述前一级D/A转换电路相对应的数字输入信号来生成要被提供到所述下一级D/A转换电路中所包括的第三晶体管的栅极端子的控制信号,并生成用于控制所述第一开关和所述第二开关的控制信号;并且
所述第一开关和所述第二开关根据与所述前一级D/A转换电路相对应的数字输入信号的最高有效位来互补地闭合和断开。
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