[发明专利]移位寄存器、栅极驱动单元与显示装置有效
申请号: | 201310178466.6 | 申请日: | 2013-05-14 |
公开(公告)号: | CN103236248A | 公开(公告)日: | 2013-08-07 |
发明(设计)人: | 何剑 | 申请(专利权)人: | 合肥京东方光电科技有限公司;京东方科技集团股份有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G09G3/20;G11C19/28 |
代理公司: | 北京银龙知识产权代理有限公司 11243 | 代理人: | 许静;安利霞 |
地址: | 230011 安徽*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 移位寄存器 栅极 驱动 单元 显示装置 | ||
技术领域
本发明涉及显示领域,尤其涉及一种移位寄存器、栅极驱动单元与显示装置。
背景技术
液晶显示装置(LCD)包括配备有多条栅极线和多条数据线的液晶面板,向栅极线输出栅极信号的栅极驱动单元和向数据线输出数据信号的源极驱动单元。
随着技术的不断发展,各种降低成本的驱动技术被应用于液晶显示器产品之中,包括Dual gate(对栅)技术和GIP技术。
Dual gate技术是将液晶面板的数据线数量减少一半、栅极线数量增加一倍的驱动技术,将源极驱动IC的数量减半,将栅极驱动IC的数量加倍,因为栅极驱动IC的单价比源极驱动IC的单价便宜,从而实现成本降低,但是Dual gate技术会带来TFT充电不足问题。
GIP(gate in panel)技术是将栅极驱动电路集成在LCD面板的显示区外围区域的技术,由于省去了栅极驱动IC,从而实现成本降低。
为了进一步降低成本,有些液晶显示器产品同时采用了Dual gate技术和GIP技术。
目前采用GIP技术的栅极驱动电路只能按照单一方向的扫描方式来进行显示,例如顺扫描或者逆扫描,和Dual gate技术搭配使用时,由于TFT充电不足问题会产生Vertical mura(垂直线亮度不均)问题,造成画质不良。
发明内容
本发明提供一种移位寄存器、栅极驱动单元与显示装置,从而可以解决现有技术中所存在的Vertical mura(垂直线亮度不均)问题,提高显示装置的显示画质。
本发明提供方案如下:
本发明实施例提供了一种移位寄存器单元,包括扫描顺序控制电路、第一控制电路和第二控制电路;其中:
扫描顺序控制电路,分别与第一扫描顺序控制信号输入端、第二扫描顺序控制信号输入端、第一时钟信号输入端、第二时钟信号输入端、设置信号输入端、复位信号输入端、第一栅极信号输出端、第二栅极信号输出端、进位信号输出端、复位信号输出端连接,用于根据接收的第一扫描顺序控制信号和第二扫描顺序控制信号,控制第一栅极信号和第二栅极信号的输出顺序;
第一控制电路,用于根据所述扫描顺序控制电路输入的控制信号,进行第一栅极信号输出和复位,所述第一控制电路分别与帧复位信号输入端、电源电压输入端、第一栅极信号输出端以及所述扫描顺序控制电路连接;
第二控制电路,用于根据所述扫描顺序控制电路输入的控制信号,进行第二栅极信号输出和复位,所述第二控制电路分别与帧复位信号输入端、电源电压输入端、第二栅极信号输出端以及所述扫描顺序控制电路连接。
优选的,所述扫描顺序控制电路包括:
第一控制单元,用于向所述第一控制电路输入第一子设置信号、第一子复位信号,以及接收所述第一控制电路输入的第一子进位信号,所述第一控制单元分别与第一扫描顺序控制信号输入端、设置信号输入端、复位信号输入端、第一栅极信号输出端、进位信号输入端、复位信号输出端连接;
第二控制单元,用于向所述第二控制电路输入第二子设置信号、第二子复位信号,以及接收所述第二控制电路输入的第二子进位信号,所述第二控制单元分别与第二扫描顺序控制信号输入端、设置信号输入端、复位信号输入端、第二栅极信号输出端、进位信号输出端、复位信号输出端连接;
时钟信号控制单元,用于向所述第一控制电路或第二控制电路,输入第一时钟子信号和第二时钟子信号,所述时钟信号控制单元分别与所述第一扫描顺序控制信号输入端、第二扫描顺序控制信号输入端、第一时钟信号输入端、第二时钟信号输入端连接。
优选的,所述第一控制单元包括:
第一晶体管TC1、第三晶体管TC3、第五晶体管TC5、第七晶体管TC7、第九晶体管TC9、第十一晶体管TC11;其中:
第一晶体管TC1的源极连接所述设置信号输入端,第一晶体管TC1的栅极连接所述第一扫描顺序控制信号输入端、第一晶体管TC1的漏极连接所述第一控制电路;
第三晶体管TC3的源极连接所述第一控制电路,第三晶体管TC3的栅极连接所述第一扫描顺序控制信号输入端、第三晶体管TC3的漏极连接所述第二控制电路;
第五晶体管TC5的源极连接所述第二栅极信号输出端,第五晶体管TC5的栅极连接第一扫描顺序控制信号输入端、第五晶体管TC5的漏极连接所述第一控制电路;
第七晶体管TC7的源极连接所述第二控制电路,第七晶体管TC7的栅极连接第一扫描顺序控制信号输入端、第七晶体管TC7的漏极连接所述进位信号输出端;
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