[发明专利]一种标清电视转码的实现方法无效

专利信息
申请号: 201310242518.1 申请日: 2013-06-19
公开(公告)号: CN103281540A 公开(公告)日: 2013-09-04
发明(设计)人: 袁三男;王绍徐 申请(专利权)人: 上海电力学院
主分类号: H04N7/26 分类号: H04N7/26
代理公司: 上海申汇专利代理有限公司 31001 代理人: 吴宝根
地址: 200090 *** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 电视 实现 方法
【说明书】:

技术领域

发明涉及一种数据信息处理技术,特别涉及一种标清电视转码的实现方法。

背景技术

目前数字电视基本普及,但分辨率主要还是标清电视。每一路标清电视的流量基本是几兆比特每秒,以3Mbps计算,一个2小时的电视节目需要3Mbps*2*3600/8=2700MB,对于一个频道的电视节目而言,一天24小时则需要32.4GB,若需要存储3个月则需要约3TB的容量,由此可见,如果按照标清电视原来的压缩率进行传输或存储则将是一个庞大的工程。因此数字电视的监测监管必须将原来的视频压缩方式或压缩率进行改变才能满足实现要求。

发明内容

本发明是针对标清电视传输和存储数据量过于庞大的问题,提出一种标清电视转码的实现方法,用嵌入式CPU+FPGA+视音频编解码实现数字电视的视频转码,降低了网络流量和存储容量。

本发明的技术方案为:一种标清电视转码的实现方法,具体包括如下步骤:

1)数字电视解调器解调后输出标准的TS流,TS流进过数据解密后送给通用视音频解码器进行解码,解码后输出标准的CCIR656未压缩数字视频格式的数据,送入FPGA现场可编程门阵列进行处理;

2)FPGA现场可编程门阵列中输入处理模块接收标准的CCIR656未压缩数字视频格式的数据,然后按CCIR656定义检测视频的行首标记、帧首标记后,将数据按照行列位置存入SDRAM对应的帧地址中;FPGA现场可编程门阵列中数据处理模块按系统要求配置视频帧率、分辨率各项参数,调用SDRAM中数据按照配置的帧率、分辨率处理数据,将输出后数据结果存入对应输出视频缓冲区中;FPGA现场可编程门阵列中输出处理模块按照配置的帧率、分辨率从输出视频缓冲区中提取数据,构建输出视频帧格式,输出行首标记、帧首标记、消隐数据,将数据输出到视音频编码器;

3)视音频编码器生成的压缩数据码流再通过嵌入式CPU处理后,作为监管监测数据送至监管系统网络平台进行查看、网络存储、历史回放。

所述SDRAM地址分配按照二维格式,以每帧720*576计算,分配地址空间计算按照2的幂次方进行,存储时按照AB BUF机制,即存储A BUF时,处理B BUF,如此循环进行。

本发明的有益效果在于:本发明标清电视转码的实现方法,转换后信号流量将极大地降低,并且新的帧率和分辨率可由系统进行灵活设置。大大降低了网络流量和存储容量。

附图说明

图1为本发明标清电视转码系统框图;

图2为本发明标清电视转码的实现方法中FPGA实现流程图。

具体实施方式

如图1所示标清电视转码系统框图,系统可以应用于广电总局或各省市广电部门、网络公司进行的数字电视监管监测中的码流转换。系统输入数字电视信号,该信号是调制后的传输流TS格式。首先应用数字电视专用解调器对该信号进行解调,解调后输出标准的TS流。将该TS流进行数据解密,然后送给通用视音频解码器进行解码。目前通用解码器可以自适应实现数字电视的不同格式如MPEG2、MPEG4、H.264等,解码后输出标准的CCIR656未压缩数字视频格式的数据,并送给FPGA现场可编程门阵列进行处理,FPGA按照设置的参数将该视频的帧率、分辨率进行调整,从而获得低的帧率和分辨率,FPGA现场可编程门阵列处理后的视频数据再传输给视音频编码器,视音频编码器生成的压缩数据码流再通过嵌入式CPU处理后,作为监管监测数据送至监管系统网络平台进行查看、网络存储、历史回放,从而实现整个数字电视系统的监管监测。

其中A点信号为调制加密的原始数字电视信号TS流,B点信号为解调解密后的压缩视音频信号,C点信号为视音频解码后的未压缩视音频数据,D点信号为经过处理的修改了分辨率和帧率的未压缩视音频数据,E点信号为处理后的视音频数据再经过编码压缩的视音频数据。

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