[发明专利]用于OFDM-WLAN系统的定时同步方法有效

专利信息
申请号: 201310244903.X 申请日: 2013-06-19
公开(公告)号: CN103298100A 公开(公告)日: 2013-09-11
发明(设计)人: 俞菲;缪小龙;林翰;杨绿溪 申请(专利权)人: 东南大学
主分类号: H04W56/00 分类号: H04W56/00;H04W84/12
代理公司: 江苏永衡昭辉律师事务所 32250 代理人: 齐旺
地址: 210096*** 国省代码: 江苏;32
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摘要:
搜索关键词: 用于 ofdm wlan 系统 定时 同步 方法
【说明书】:

技术领域

发明属于无线通信技术领域,具体涉及到一种用于OFDM-WLAN系统的定时同步方法。

背景技术

正交频分复用(OFDM)是一种多载波调制技术,被广泛用于高速无线局域网(WLAN)传输中,例如IEEE802.11a协议。但是OFDM系统对接收机的同步要求特别高,尤其是定时同步,这是接收机的第一步也是最关键的一步,定时不准确将引起系统性能的大幅度下降。对于OFDM-WLAN系统这种突发性数据传输模式,一般采用前导序列来实现同步。例如IEEE802.11a中,采用短训练序列(STF)实现粗同步和长训练序列(LTF)实现精同步。很多文献都提出基于此的算法,但此类算法计算量大,复杂度高。

K Wang,JSingh and M Faulkner在FPGA Implementation of an OFDM-WLAN Synchronizer一文中提出了基于STF序列的定时同步方案,虽然该算法计算量小,但准确性却不高。其主要思想是利用STF自身的强相关性,STF和LTF之间的弱相关性形成峰值。但此方案却容易形成误判,如图1所示的仿真图中,仿真中信号没有经过信道,没有任何噪声。第一个峰值为STF与LTF过度时产生的峰值,但数据字段也出现了较高的峰值,这就形成了峰值检测的误判,因此仅仅利用此方法很难准确估计出数据符号的起始位置。

FPGA(Filed-Programmable Gate Array),即现场可编程门阵列,作为专用集成电路领域的一种半定制电路,即解决了定制电路的不足,而且克服了可编程器件门电路数太少的缺点。利用FPGA实现WLAN-OFDM系统,具有快速低延迟以及低功耗的特性。但是基于STF和LTF的同步方案需要花费大量的逻辑资源,而FPGA的资源是有限的,因此寻求低复杂度和高效准确的算法是非常有必要的。

发明内容

针对现有技术存在的缺陷和不足,本发明旨在提供一种用于OFDM-WLAN系统的定时同步方法,其算法复杂度低而且可以准确快速的找到数据符号的起始位置。

为达成上述目的,本发明所采用的技术方案如下:

一种用于OFDM-WLAN系统的定时同步方法,包括以下步骤:

1)OFDM-WLAN系统实时接收到的信号,通过延时自相关算法实现粗同步,具体步骤如下:

(1)定义C(n)为接收到的信号与前L时刻的信号相关累加和

C(n)=Σk=0L-1r(n+k)·r*(n+k+L)]]>

(2)定义P(n)为接收信号能量的累加和

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