[发明专利]通用串行接口有效
申请号: | 201310262867.X | 申请日: | 2013-06-27 |
公开(公告)号: | CN103389958A | 公开(公告)日: | 2013-11-13 |
发明(设计)人: | 卢一鸣 | 申请(专利权)人: | 三星半导体(中国)研究开发有限公司;三星电子株式会社 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 韩明星;王兆赓 |
地址: | 215021 江苏省苏*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 通用 串行 接口 | ||
1.一种通用串行接口,其特征在于:所述通用串行接口包括集成电路总线(IIC)收发器、通用异步接收/发送装置(UART)收发器和串行外设接口(SPI)收发器中的至少两个,其中,IIC收发器、UART收发器和SPI收发器中的所述至少两个共用全部的收发先入先出(FIFO)逻辑。
2.根据权利要求1所述的通用串行接口,其特征在于:IIC收发器、UART收发器和SPI收发器中的所述至少两个共用全部的直接存储器存取(DMA)控制逻辑。
3.根据权利要求1所述的通用串行接口,其特征在于:IIC收发器、UART收发器和SPI收发器中的所述至少两个共用部分的特殊功能寄存器(SFR)控制逻辑,所述部分的SFR控制逻辑的部分包括SFR控制逻辑中的与所述收发FIFO逻辑的功能相应的部分和/或与打开/结束功能相应的部分。
4.根据权利要求1所述的通用串行接口,其特征在于:IIC收发器、UART收发器和SPI收发器中的所述至少两个共用部分的时钟逻辑,所述部分的时钟逻辑包括时钟逻辑中的与所述收发FIFO逻辑的功能相应的部分。
5.根据权利要求1所述的通用串行接口,其特征在于:IIC收发器、UART收发器和SPI收发器中的所述至少两个共用部分的中断(INT)控制逻辑,所述INT控制逻辑的部分包括INT控制逻辑中的与所述收发FIFO逻辑的功能相应的部分。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于三星半导体(中国)研究开发有限公司;三星电子株式会社,未经三星半导体(中国)研究开发有限公司;三星电子株式会社许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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