[发明专利]一种数模转换中数据平均的处理方法及装置有效
申请号: | 201310376391.2 | 申请日: | 2013-08-26 |
公开(公告)号: | CN103401558A | 公开(公告)日: | 2013-11-20 |
发明(设计)人: | 郑健华;邸岳淼 | 申请(专利权)人: | 华为技术有限公司 |
主分类号: | H03M1/66 | 分类号: | H03M1/66 |
代理公司: | 深圳中一专利商标事务所 44237 | 代理人: | 贾振勇 |
地址: | 518129 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 数模 转换 数据 平均 处理 方法 装置 | ||
1.一种数模转换中数据平均的处理方法,其特征在于,所述方法包括:
在数模转换中,接收数字信号A,判断所述数字信号A为奇数或偶数,当判断出所述数字信号A为奇数时,切换数字状态Z的状态;
依据数字状态Z的状态确定数据平均DWA环路1和DWA环路2的输入数据;
所述数字状态Z包括两个状态,分别为第一状态和第二状态。
2.根据权利要求1所述的方法,其特征在于,依据数字状态Z的状态确定DWA环路1和DWA环路2的输入数据具体包括:
如数字状态Z的状态为第一状态,则将DWA环路1的输入数据设置为(A—设定奇数)/2,将DWA环路2的输入数据设置为(A+设定奇数)/2+8;
如数字状态Z的状态为第二状态,则将DWA环路1的输入数据设置为(A+设定奇数)/2,将DWA环路2的输入数据设置为(A—设定奇数)/2+8。
3.根据权利要求2所述的方法,其特征在于,所述设定奇数为:1、3或5。
4.根据权利要求1所述的方法,其特征在与,判断所述数字信号A为奇数或偶数的方法具体包括:
判断数字信号A的最后一个数字是1或是0,如所述数字信号A的最后一个数字是1,则判断出所述数字信号为奇数;如所述数字信号A的最后一个数字是0,则判断出所述数字信号为偶数。
5.一种数模转换中数据平均的处理装置,其特征在于,所述装置包括:
接收单元,用于在数模转换中,接收数字信号A;
判断单元,用于判断所述数字信号A为奇数或偶数,当判断出数字信号A为奇数时,切换数字状态Z的状态;
输入单元,用于依据数字状态Z的状态确定数据平均DWA环路1和DWA环路2的输入数据;
所述数字Z的状态包括两个状态,分别为第一状态和第二状态。
6.根据权利要求5所述的装置,其特征在于,所述输入单元具体用于
如数字状态Z的状态为第一状态,则将DWA环路1的输入数据设置为(A—设定奇数)/2,将DWA环路2的输入数据设置为(A+设定奇数)/2+8;
如数字状态Z的状态为第二状态,则将DWA环路1的输入数据设置为(A+设定奇数)/2,将DWA环路2的输入数据设置为(A—设定奇数)/2+8。
7.根据权利要求5所述的装置,其特征在于,所述设定奇数为:1、3或5。
8.根据权利要求5所述的装置,其特征在于,所述判断单元具体用于判断数字信号A的最后一个数字是1或是0,如所述数字信号A的最后一个数字是1,则判断出所述数字信号为奇数;如所述数字信号A的最后一个数字是0,则判断出所述数字信号为偶数。
9.一种数模转换器,其特征在于,所述数模转换器包括:数字信号输入口、数字硬核、数据平均DWA环路1、DWA环路2和模拟信号输出口;其中,数字信号输入口与数字硬核的输入端连接,数字硬核输出端连接DWA环路1以及DWA环路2的输入端,DWA环路1以及DWA环路2的输出端与模拟信号输出口连接;
数字信号输入口在数模转换中,接收数字信号A;数字硬核判断该数字信号A为奇数或偶数,当判断出数字信号A为奇数时,切换数字状态Z的状态;依据数字状态Z的状态确定DWA环路1和DWA环路2的输入数据;
所述数字Z的状态包括两个状态,分别为第一状态和第二状态。
10.根据权利要求9所述的数模转换器,其特征在于,所述数字硬核在数字状态Z的状态为第一状态,则送给DWA环路1的输入数据具体可以为(A—设定奇数)/2,送给DWA环路2的输入数据具体可以为(A+设定奇数)/2+8;
在数字状态Z的状态为第二状态,则送给DWA环路1的输入数据具体可以为(A+设定奇数)/2,送给DWA环路2的输入输入数据具体可以为(A—设定奇数)/2+8。
11.根据权利要求9或10所述数模转换器,其特征在于,所述设定奇数为:1、3或5。
12.根据权利要求9所述的数模转换器,其特征在于,所述数字硬核判断数字信号A的最后一个数字是1或是0,如所述A的最后一个数字为0,则判断数字信号A为偶数,如最后一个数字为1则判断出数字信号A为奇数。
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