[发明专利]一种高清多媒体显示屏控制系统无效

专利信息
申请号: 201310421401.X 申请日: 2013-09-16
公开(公告)号: CN104464588A 公开(公告)日: 2015-03-25
发明(设计)人: 不公告发明人 申请(专利权)人: 柏世强
主分类号: G09G3/20 分类号: G09G3/20;G09G3/36
代理公司: 暂无信息 代理人: 暂无信息
地址: 230031 安*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 多媒体 显示屏 控制系统
【说明书】:

技术领域

发明涉及LED,LCD显示屏控制技术,尤其涉及满足嵌入式高清视频播放需求的多媒体LED,LCD显示屏控制系统。

背景技术

目前市场上大部分LED显示屏都采用配置一台电脑,通过电脑控制LED显示屏,成本较大;由于现有的电脑都采用软件解码,控制系统的分辨率很低、视频播放不流畅;且由于各类屏体的走线的不同,现有的控制系统无法满足所有种类的屏体的需求,功能不齐全、无法对各中屏体兼容。

发明内容

由于现有技术存在着上述问题,本发明提出一种高清多媒体显示屏控制系统,其可有效地解决上述问题并可用于LCD屏体。

本发明通过以下技术方案解决上述问题:

一种高清多媒体显示屏控制系统,其包括一单板硬件电路,所述单板硬件电路包括数据存储器、arm处理器、高速内存、网络通信接口、usb声卡接口、usb扩展接口、传感器接口、时钟电路、超大规模可编程逻辑门阵列、内存、并行移位数据模块、电平转换模块;所述数据存储器、高速内存、网络通信接口、usb声卡接口、usb扩展接口、传感器接口、时钟电路、超大规模可编程逻辑门阵列分别连接于所述arm处理器上,所述内存、并行移位数据模块及电平转换模块连接于所述超大规模可编程逻辑门阵列上。

所述arm处理器包括一Static Memory Controller(简写smc)接口,所述超大规模可编程逻辑门阵列通过该smc接口与所述arm处理器相连。

还包括一运行于所述arm处理器上具有多种驱动的linux系统和一运行于超大规模可编程逻辑门阵列上的具有模块任意裁剪、高实时性及高效率功能的niosⅡ操作系统。

所述驱动包括网络驱动、usb驱动、时钟驱动、存储驱动、通用IO扩展驱动、超大规模可编程逻辑门阵列加载驱动和传感器驱动。

所述niosⅡ操作系统包括一LED驱动程序及LCD驱动程序。

所述linux操作系统上还运行有应用程序,且该应用程序包括:用户网络通信程序、用户usb扩展程序、用户usb声卡程序、时钟程序、文字解码程序、图片解码程序、视频解码程序、传感器程序、图像特技程序、测试程序、节目文件更新程序、屏幕多区域管理程序、屏体智能设置程序、Ip管理程序。

所述niosⅡ操作系统上运行有应用程序,且该应用程序包括:Gama校正程序、灰度提取程序。

所述arm处理器和超大规模可编程逻辑门阵列都是采用了高速32位的片上系统芯片,且arm处理器采用了硬件解码器。

所述并行数据移位模块及电平转换模块通过50pin插针与各种屏体连接。

本发明的优点在于:

1、本发明的高清多媒体显示屏控制系统可以代替电脑,直接控制LED显示屏,并且售价最低为380元,大大低于电脑价格,从而节约客户成本;

2、本发明的高清多媒体显示屏控制系统,采用硬件解码器,效率高,视频清晰流畅,效果远远高于软件解码;

3、本发明的高清多媒体显示屏控制系统,具有智能设置系统,可以满足市场上各种屏体的走线,兼容各种LED显示屏。

4、本发明的高清多媒体显示屏控制系统,扩展接口丰富,可以通过usb声卡接口扩展音乐播放,通过usb扩展接口可以存储大容量用户数据,通过传感器接口,实现温湿度数据采集,以及超大规模可编程逻辑门阵列数据输出模块配合发送卡扣板把数据通过千兆网传输至接收卡,通过增加接收卡的级联实现大屏幕显示。

5、本发明的高清多媒体显示屏控制系统,可用与LCD屏体集群显示。

附图说明

图1为本发明高清多媒体显示屏控制系统的结构框图;

图2为本发明通过50pin插针外接功能示意图一;

图3为本发明通过50pin插针外接功能示意图二。

具体实施方式

下面结合具体实施方式,详细描述本发明。

结合图1所示,本发明的高清多媒体显示屏控制系统包括一单板硬件电路,所述单板硬件电路包括数据存储器1、arm处理器(mcu)2、高速内存3、网络通信接口4、usb声卡接口5、usb扩展接口6、传感器接口7、时钟电路8、超大规模可编程逻辑门阵列9、内存10、并行移位数据模块11、电平转换模块12;所述数据存储器1、高速内存2均通过一总线连接于所述arm处理器2上,网络通信接口4、usb声卡接口5、usb扩展接口6、传感器接口7、时钟电路8、超大规模可编程逻辑门阵列9分别连接于所述arm处理器2上,所述内存10、并行移位数据模块11及电平转换模块12连接于所述超大规模可编程逻辑门阵列9上。

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