[实用新型]课室时间显示及同步响铃装置有效
申请号: | 201320129910.0 | 申请日: | 2013-03-20 |
公开(公告)号: | CN203178685U | 公开(公告)日: | 2013-09-04 |
发明(设计)人: | 赖树明;胡玥;韩清涛;任斌;李艳霞 | 申请(专利权)人: | 东莞理工学院 |
主分类号: | G04C21/30 | 分类号: | G04C21/30;G04R20/02;G04R20/10 |
代理公司: | 广州三环专利代理有限公司 44202 | 代理人: | 张艳美;郝传鑫 |
地址: | 523808 广东省*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 课室 时间 显示 同步 响铃 装置 | ||
技术领域
本实用新型涉及时间显示技术领域,更具体地涉及一种课室时间显示及同步响铃装置。
背景技术
目前,学校常用的打铃装置多采用单片机计时,计时误差每日达0.5s,日积月累走时误差会达数分钟,甚至十多分钟,对学生和管理者造成不便。而随着人们时间观念的不断加强,特别是近年来来各种考试,如高考、公务员考试、英语四六级考试等对时间的把握更加严格,为体现公平公正的原则,人们对时间精度提出了更高的要求。
另一方面,老师在上课时,常常比较难把握住宝贵的45分钟,因为学生上课时,要听到铃声后才会陆续返到自己的座位,这需要一点时间,待学生坐好后,老师上课时,要不断的来回看手表或手机,来合理安排这45分钟,以把备好的内容全部讲完,这对老师的状态与上课的效果有一定的影响。同时现在对于比较严格的考试来说,一般要通过安检,考生和考务人员不能带手机或手表,学生和考务人员只能靠响铃来识别时间,这就会严重影响到考生的临场发挥和对考务人员带来不便。
因此,急需一种时间精准、没有累计误差的课室时间显示及同步响铃装置来克服上述缺陷。
实用新型内容
本实用新型的目的是提供一种课室时间显示及同步响铃装置,以提供没有累计误差的精准时间显示及同步响铃,方便老师、学生对时间的把握,进而提高教学效率。
为实现上述目的,本实用新型提供了一种课室时间显示及同步响铃装置,包括GPS模块、存储模块、显示模块、响铃模块及中央处理模块,所述GPS模块与所述中央处理模块连接、用于实时获取标准时间并传输至所述中央处理模块,所述存储模块与所述中央处理模块连接、用于存储预先设置的课程表信息,所述中央处理模块与所述显示模块及所述响铃模块连接、用于接收来自所述GPS模块的所述标准时间并将所述标准时间与所述课程表信息进行比对以得到显示时间及响铃时间并控制所述显示模块实时显示以及控制所述响铃模块在所述响铃时间到的时刻同步响铃。
与现有技术相比,本实用新型课室时间显示及同步响铃装置首先通过存储模块存储预先设置的课程表信息,之后GPS模块实时获取标准时间并将所述标准时间传输至中央处理模块,中央处理模块接收所述标准时间并将所述标准时间与存储的课程表信息进行比对以得到显示时间及响铃时间、之后控制所述显示模块进行实时显示并控制所述响铃模块在响铃时间到的时刻同步响铃,由于本实用新型采用GPS模块获取时间、从而实现了提供没有累计误差的精准时间显示及同步响铃,方便老师、学生对时间的把握,进而提高了教学效率。
较佳地,所述中央处理模块包括单片机U3_1及单片机U3_1的时钟电路,所述单片机U3_1与所述GPS模块、存储模块、显示模块及响铃模块连接。
较佳地,所述课室时间显示及同步响铃装置还包括与所述中央处理模块连接、用于控制所述中央处理模块复位的复位模块,所述复位模块包括电阻R3_1、电容C3_1及复位按钮SB1_1,所述复位按钮SB1_1的一端与电源VDD5V及电容C3_1的一端连接、复位按钮SB1_1的另一端与电阻R3_1的一端及电容C3_1的另一端连接,电阻R3_1的另一端接地,复位按钮SB1_1的另一端同时与单片机U3_1的脚9连接以实现对单片机U3_1的复位。
具体地,所述响铃模块包括电阻R1_2、三极管Q2_1、继电器K2_1及电铃L1_1,所述单片机U3_1的脚12与电阻R1_2的一端连接,电阻R1_2的另一端与三极管Q2_1的基极连接,三极管Q2_1的集电极与继电器K2_1的一端连接,三极管Q2_1的发射极与电源VDD5V连接,继电器K2_1的另一端与电铃L1_1连接从而实现了单片机U3_1控制电铃L1_1在所述响铃时间到的时刻进行同步响铃。
具体地,所述显示模块包括可调电阻R4_1和液晶屏U4_1,所述单片机U3_1的脚16、17分别与液晶屏U4_1的脚5、15连接,单片机U3_1的脚27、28、32至39分别与液晶屏U4_1的脚6、4、14至7连接,液晶屏U4_1的脚3与可调电阻R4_1的滑动接点连接,可调电阻R4_1的一端与电源VDD5V连接、另一端接地,液晶屏U4_1的脚2、17、19连接电源VDD5V。
具体地,所述存储模块包括存储芯片U2_1和电阻R1_1、R2_1,存储芯片U2_1的脚1、2、3、4及7接地,存储芯片U2_1的脚8接电源VDD5V,存储芯片U2_1的脚5与单片机U3_1的脚2及电阻R2_1的一端连接,存储芯片U2_1的脚6与单片机U3_1的脚1及电阻R1_1的一端连接,电阻R1_1、R2_1的另一端与电源VDD5V连接。
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