[实用新型]SDI中继线有效
| 申请号： | 201320567083.3 | 申请日： | 2013-09-13 |
| 公开（公告）号： | CN203435079U | 公开（公告）日： | 2014-02-12 |
| 发明（设计）人： | 蔡意兴 | 申请（专利权）人： | 蔡意兴 |
| 主分类号： | H04N7/10 | 分类号： | H04N7/10 |
| 代理公司： | 深圳市金笔知识产权代理事务所(特殊普通合伙) 44297 | 代理人： | 胡清方;彭友华 |
| 地址： | 516600 广东省深圳*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | sdi 中继线 | ||
1.一种SDI中继线，其特征在于，包括：单芯同轴线缆、上级侧连接器和下级侧连接器，所述单芯同轴线缆被配置为即传输视频信号，同时也为下级提供电源；
所述上级侧连接器被设置在所述单芯同轴线缆的一端处，并且被配置为将所述单芯同轴线缆连接到上级设备；所述下级侧连接器被设置在所述单芯同轴线缆的另一端处，并且被配置为将所述单芯同轴线缆连接到下级设备；
在所述单芯同轴线缆之中串接有中继器；所述中继器至少包括用于从上级接收视频信号的均衡器、用于提高时钟品质的时钟恢复去抖芯片，以及用于加强驱动能力的线缆驱动器，所述均衡器将所接收到的视频信号传输给所述时钟恢复去抖芯片，所述时钟恢复去抖芯片将时钟去抖后的视频信号传输给线缆驱动器，经加强驱动力后传输给下级；取电模块从单芯同轴线缆获取电流，并通过加电模块将所述电流传输给后级；
在所述单芯同轴线缆和中继器外设有被覆层，将所述上级侧连接器、单芯同轴线缆、中继器和下级侧连接器做成一根整体的线状结构。
2.根据权利要求1所述的SDI中继线，其特征在于，还包括FPGA芯片，所述FPGA芯片包括，
SDI接收模块，用于从均衡器接收串行视频信号，将串行视频信号转换为并行视频信号，并同时将并行视频的原时钟信号输入给时钟恢复去抖芯片；
缓存模块，用于缓存并行视频信号；
SDI发送模块，将并行视频信号重新加载去抖后的时钟信号，并将并行视频信号转换为串行视频信号后传输给线缆驱动器；
所述时钟恢复去抖芯片从SDI接收模块获取原始时钟信号，恢复去抖后重新输送给SDI发送模块。
3.根据权利要求1所述的SDI中继线，其特征在于，还包括FPGA芯片和内存模块，所述FPGA芯片包括，
SDI接收模块，用于从均衡器接收串行视频信号，将串行视频信号转换为并行视频信号，并同时将并行视频的原时钟信号输入给时钟恢复去抖芯片；
压缩处理模块，与内存模块配合，将从SDI接收模块获得的视频信号按预定格式压缩后，输送给缓存模块；
缓存模块，用于缓存并行视频信号；
SDI发送模块，将并行视频信号重新加载去抖后的时钟信号，并将并行视频信号转换为串行视频信号后传输给线缆驱动器；
所述时钟恢复去抖芯片从SDI接收模块获取原始时钟信号，恢复去抖后通过降频模块降低频率后，再输送给SDI发送模块。
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