[实用新型]模拟开关电路和具备它的电气设备有效
申请号: | 201320688910.4 | 申请日: | 2013-11-04 |
公开(公告)号: | CN203590182U | 公开(公告)日: | 2014-05-07 |
发明(设计)人: | 土桥正典 | 申请(专利权)人: | 罗姆股份有限公司 |
主分类号: | H03K17/08 | 分类号: | H03K17/08;H03K17/687 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 郭定辉 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 模拟 开关电路 具备 电气设备 | ||
1.一种模拟开关电路,其特征在于,包括:
输入端子;
输出端子;
控制端子;
第一导电型的第一晶体管,具有电连接所述输入端子的第一电极、电连接所述输出端子的第二电极、以及控制电极;
第二导电型的第二晶体管,具有分别电连接第一电压节点和所述第一晶体管的控制电极的第1电极和第二电极、以及电连接所述控制端子的控制电极;
所述第二导电型的第三晶体管,具有:第一电极;电连接相对于所述第一电压节点有电位差的第二电压节点的第二电极;以及电连接所述第一晶体管的第二电极的控制电极;以及
恒压电路,电连接所述第一晶体管的控制电极和所述第三晶体管的第一电极,生成比所述第一晶体管的控制电极和第二电极间的耐压与所述第三晶体管的控制电极和第一电极间的电压之差小的恒压。
2.如权利要求1所述的模拟开关电路,其特征在于,还包括:
所述第一导电型的第四晶体管,
所述第四晶体管具有:分别与所述输出端子和所述第一晶体管的第二电极电连接的第1电极和第二电极;以及与所述第一晶体管的控制电极电连接的控制电极。
3.如权利要求1所述的模拟开关电路,其特征在于,还包括:
第一电荷除去电路,电连接所述第一晶体管的控制电极,在所述第二晶体管截止的情况下,除去所述第一晶体管的控制电极的电荷;以及
第二电荷除去电路,电连接所述第三晶体管的控制电极,在所述第二晶体管截止的情况下,除去所述第三晶体管的控制电极的电荷。
4.如权利要求2所述的模拟开关电路,其特征在于,还包括:
第一电荷除去电路,电连接所述第一晶体管的控制电极和所述第四晶体管的控制电极,在所述第二晶体管截止的情况下,除去所述第一晶体管的控制电极和所述第四晶体管的控制电极的电荷;以及
第二电荷除去电路,电连接所述第三晶体管的控制电极,在所述第二晶体管截止的情况下,除去所述第三晶体管的控制电极的电荷。
5.如权利要求4所述的模拟开关电路,其特征在于,
所述第一电荷除去电路包括所述第一导电型的第五晶体管,
所述第二电荷除去电路包括所述第一导电型的第六晶体管,
所述第五晶体管具有:分别电连接所述第二晶体管的第二电极和所述第二电压节点的第一电极和第二电极;以及电连接所述控制端子的控制电极,
所述第六晶体管具有:分别电连接所述第三晶体管的控制电极和所述第二电压节点的第一电极和第二电极;以及电连接所述控制端子的控制电极。
6.如权利要求1至5中任何一项所述的模拟开关电路,其特征在于,
所述恒压电路包括:n型晶体管;以及具有串联连接的第一电阻和第二电阻的串联电路,
所述n型晶体管具有:分别电连接所述第一晶体管的控制电极和所述第三晶体管的第一电极的第一电极和第二电极;以及控制电极,
在所述n型晶体管的第一电极和第二电极间,连接所述串联电路,
所述n型晶体管的控制电极电连接所述第1电阻和第二电阻的连接点。
7.如权利要求1至5中任何一项所述的模拟开关电路,其特征在于,
所述恒压电路包括齐纳二极管,
所述齐纳二极管具有分别电连接所述第一晶体管的控制电极和所述第三晶体管的第一电极的阴极和阳极。
8.如权利要求6所述的模拟开关电路,其特征在于,
所述恒压电路还包括齐纳二极管,
所述齐纳二极管具有分别电连接所述第一晶体管的控制电极和所述第三晶体管的第一电极的阴极和阳极。
9.一种电气设备,其特征在于,包括:
模拟开关电路;
发送电路,对所述模拟开关电路发送信号;
接收电路,接受来自所述模拟开关电路的信号;以及
控制电路,控制所述模拟开关电路,
所述模拟开关电路包括:
输入端子,电连接所述发送电路;
输出端子,电连接所述接收电路;
控制端子,电连接所述控制电路;
第一导电型的第一晶体管,具有:电连接所述输入端子的第一电极、电连接所述输出端子的第二电极;以及控制电极;
第二导电型的第二晶体管,具有:分别电连接第一电压节点和所述第一晶体管的控制电极的第一电极和第二电极;以及电连接所述控制端子的控制电极;
所述第二导电型的第三晶体管,具有:第一电极、电连接相对于所述第一电压节点有电位差的第二电压节点的第二电极;以及电连接所述第一晶体管的第二电极的控制电极;以及
恒压电路,电连接所述第一晶体管的控制电极和所述第三晶体管的第一电极,生成比所述第一晶体管的控制电极和第二电极间的耐压与所述第三晶体管的控制电极和第一电极间的电压之差小的恒压。
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