[发明专利]处理设备中的非易失性逻辑阵列和电源域分割有效
| 申请号： | 201380046961.X | 申请日： | 2013-09-10 |
| 公开（公告）号： | CN104620192B | 公开（公告）日： | 2018-03-23 |
| 发明（设计）人： | S·C·巴特玲;S·汉纳 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | G06F1/26 | 分类号： | G06F1/26 |
| 代理公司： | 北京纪凯知识产权代理有限公司11245 | 代理人： | 赵蓉民 |
| 地址： | 美国德*** | 国省代码： | 暂无信息 |
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| 摘要： | |||
| 搜索关键词： | 处理 设备 中的 非易失性 逻辑 阵列 电源 分割 | ||
1.一种计算装置，其提供基于非易失性逻辑的计算，该装置包括：
多个非易失性逻辑元件阵列；
多个易失性存储元件；
处理核；
至少一个非易失性逻辑控制器，其被配置为控制所述多个非易失性逻辑元件阵列，以存储由所述多个易失性存储元件表示的机器状态，并将存储的机器状态从所述多个非易失性逻辑元件阵列读出到所述多个易失性存储元件；
第一电源域，其被配置为向所述计算装置的所述易失性存储元件的第一逻辑元件供电；
其中所述多个非易失性逻辑元件阵列中的至少一个阵列中的第一组与所述计算装置的第一功能关联，且所述多个非易失性逻辑元件阵列中的至少一个阵列中的第二组与所述计算装置的第二功能关联，所述第一功能与所述处理核关联，所述第二功能与所述处理核关联；
其中所述多个非易失性逻辑元件阵列中的至少一个阵列中的所述第一组的操作独立于所述多个非易失性逻辑元件阵列中的至少一个阵列中的所述第二组的操作；
第二电源域，其被配置为向所述易失性存储元件的第二逻辑元件供电，所述第二逻辑元件被配置为控制信号用于将数据存储到所述多个非易失性逻辑元件阵列或从所述多个非易失性逻辑元件阵列读取数据；
第三电源域，其被配置为向所述多个非易失性逻辑元件阵列供电；
其中所述第一电源域、所述第二电源域和所述第三电源域中的每个电源域被配置为独立于所述第一电源域、所述第二电源域和所述第三电源域中的其他电源域而断电或加电；
其中所述第三电源域被配置为在所述计算装置的常规操作期间断电。
2.一种计算装置，其提供基于非易失性逻辑的计算，该装置包括：
多个非易失性逻辑元件阵列；
多个易失性存储元件；
处理核；
至少一个非易失性逻辑控制器，其被配置为控制所述多个非易失性逻辑元件阵列，以存储由所述多个易失性存储元件表示的机器状态，并将存储的机器状态从所述多个非易失性逻辑元件阵列读出到所述多个易失性存储元件；
第一电源域，其被配置为向所述计算装置的所述易失性存储元件的第一逻辑元件供电；
其中所述多个非易失性逻辑元件阵列中的至少一个阵列中的第一组与所述计算装置的第一功能关联，且所述多个非易失性逻辑元件阵列中的至少一个阵列中的第二组与所述计算装置的第二功能关联，所述第一功能与所述处理核关联，所述第二功能与所述处理核关联；
其中所述多个非易失性逻辑元件阵列中的至少一个阵列中的所述第一组的操作独立于所述多个非易失性逻辑元件阵列中的至少一个阵列中的所述第二组的操作；
第二电源域，其被配置为向所述易失性存储元件的第二逻辑元件供电，所述第二逻辑元件被配置为控制信号用于将数据存储到所述多个非易失性逻辑元件阵列或从所述多个非易失性逻辑元件阵列读取数据；
第三电源域，其被配置为向所述多个非易失性逻辑元件阵列供电；
其中所述第一电源域、所述第二电源域和所述第三电源域中的每个电源域被配置为独立于所述第一电源域、所述第二电源域和所述第三电源域中的其他电源域而断电或加电；
其中所述第一电源域被配置为在从所述多个非易失性逻辑元件阵列向所述多个易失性存储元件回写数据期间断电。
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