[发明专利]二维环面拓扑有效
申请号: | 201380078525.0 | 申请日: | 2013-07-30 |
公开(公告)号: | CN105453713B | 公开(公告)日: | 2018-09-14 |
发明(设计)人: | 占·V·华;德怀特·L·巴罗恩;赛厄马克·塔瓦莱伊 | 申请(专利权)人: | 慧与发展有限责任合伙企业 |
主分类号: | G06F13/00 | 分类号: | G06F13/00 |
代理公司: | 北京德琦知识产权代理有限公司 11018 | 代理人: | 康泉;宋志强 |
地址: | 美国德*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 二维 拓扑 | ||
1.一种包括二维环面拓扑的印刷电路板,包括:
板连接器阵列,所述板连接器阵列中的每个板连接器被形成均用于容纳电子连接器;
输入端口和输出端口,被形成在所述板连接器阵列中的每个板连接器上,所述输入端口的集合和所述输出端口的集合被设置在每个板连接器上,用于提供同样的轨迹路由方向;以及
互连集合,被形成用于将所述板连接器阵列中的每个板连接器连接到另一板连接器,所述互连集合包括第一板连接器和最后的板连接器之间的缩短的信号路径,所述缩短的信号路径包括小于所述板连接器阵列中的所述第一板连接器和所述最后的板连接器之间的距离的长度,所述第一板连接器和所述最后的板连接器被设置在所述印刷电路板的相对端;
其中,所述最后的板连接器沿着所述同样的轨迹路由方向连接到未直接位于物理上与所述最后的板连接器相邻的位置的另一板连接器。
2.根据权利要求1所述的印刷电路板,其中所述缩短的信号路径包括所述第一板连接器和所述最后的板连接器之间的沿所述印刷电路板的行的距离的百分比,所述百分比小于百分之百。
3.根据权利要求1所述的印刷电路板,其中所述输入端口包括多个输入引脚,并且所述输出端口包括多个输出引脚。
4.根据权利要求1所述的印刷电路板,其中所述印刷电路板包括母板。
5.根据权利要求1所述的印刷电路板,其中所述输入端口位于所述板连接器中的第一位置处,并且所述输出端口位于所述板连接器中的第二位置处,以提供所述互连集合之间的同样的轨迹路由方向以及使所述电子连接器能够互换地插入到所述板连接器中。
6.一种具有二维环面拓扑的计算系统,包括:
插槽阵列,被形成用于容纳多个电子模块;
印刷电路板,包括:
板连接器阵列,所述板连接器阵列中的每个板连接器包括输入端口和输出端口,所述输入端口和所述输出端口被设置在每个板连接器上,以提供同样的轨迹路由方向;以及
互连集合,用于将每个板连接器的所述输入端口和所述输出端口连接到另一板连接器,所述互连集合中的每个互连包括小于所述板连接器阵列中的第一板连接器和最后的板连接器之间的距离的长度,以在所述第一板连接器和所述最后的板连接器之间提供缩短的信号路径,所述第一板连接器和所述最后的板连接器被设置在所述印刷电路板的相对端;以及
所述多个电子模块,每个电子模块经由所述互连集合联接到另一电子模块,每个电子模块具有至少一个输入电子连接器和至少一个输出电子连接器,所述至少一个输入电子连接器被形成为连接到对应的输入端口,并且所述至少一个输出电子连接器被形成为连接到对应的输出端口;
其中,所述插槽阵列中的最后的插槽沿着所述同样的轨迹路由方向连接到未直接位于物理上与所述最后的插槽相邻的位置的另一插槽。
7.根据权利要求6所述的计算系统,其中沿所述同样的轨迹路由方向形成的所述互连集合包括至少一个互连以减小插槽之间的所述互连集合的长度。
8.根据权利要求6所述的计算系统,其中每个板连接器包括被统一地设置在每个板连接器上的所述输入端口和所述输出端口。
9.根据权利要求6所述的计算系统,其中所述缩短的信号路径包括小于所述第一板连接器和所述最后的板连接器之间的距离的百分之百的百分比。
10.根据权利要求6所述的计算系统,其中每个电子模块包括选自网络交换机、内存模块、存储器模块和计算模块中的至少一个模块。
11.根据权利要求6所述的计算系统,其中所述插槽阵列被形成为与所述电子模块兼容,所述电子模块包括尺寸选自单倍长度和单倍宽度模块、双倍宽度模块、双倍长度模块、三倍长度模块和三倍宽度模块中的至少一个模块。
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