[发明专利]晶圆缺陷密度获得方法、测试方法及半导体装置形成方法有效

专利信息
申请号: 201410007099.8 申请日: 2014-01-07
公开(公告)号: CN104766808B 公开(公告)日: 2017-04-26
发明(设计)人: 陈亚威 申请(专利权)人: 无锡华润上华半导体有限公司
主分类号: H01L21/66 分类号: H01L21/66
代理公司: 无锡互维知识产权代理有限公司32236 代理人: 庞聪雅
地址: 214028 江苏省无*** 国省代码: 江苏;32
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摘要:
搜索关键词: 缺陷 密度 获得 方法 测试 半导体 装置 形成
【权利要求书】:

1.一种晶圆缺陷密度获得方法,其特征在于,包括:

获得所述晶圆上各芯片的各导电层的致命缺陷率;

根据每个芯片的各导电层的致命缺陷率获得致命缺陷率系数,所述致命缺陷率系数为所述各导电层的致命缺陷率之和;

结合所述致命缺陷率系数及理论缺陷密度计算模型获得修正缺陷密度计算公式;

根据所述修正缺陷密度计算公式获得所述晶圆的缺陷密度,

所述致命缺陷率系数记为C,所述修正缺陷密度计算公式为:

或者,

其中,WaferYield为晶圆随机良率:晶圆上的合格芯片数量与有效芯片总数的比值;DieArea为单个芯片的面积;FD0是修正后缺陷密度,计算公式为FD0=D0+0.0001×GDPW-0.08,其中,D0为缺陷密度,单位是缺陷个数/每平方英寸,GDPW是所述有效芯片总数缺陷密度;N为工艺复杂度。

2.根据权利要求1所述的晶圆缺陷密度获得方法,其特征在于,所述理论缺陷密度计算模型包括玻尔-爱因斯坦方程式。

3.根据权利要求2所述的晶圆缺陷密度获得方法,其特征在于,所述玻尔-爱因斯坦方程式为:

WaferYield=1/(1+DieArea*D0)^N,其中,WaferYield为晶圆随机良率:晶圆上的合格芯片数量与有效芯片总数的比值;DieArea为单个芯片的面积;D0为缺陷密度,单位为缺陷个数/平方英寸;N为工艺复杂度。

4.根据权利要求1所述的晶圆缺陷密度获得方法,其特征在于,所述晶圆为多晶硅晶圆。

5.根据权利要求1所述的晶圆缺陷密度获得方法,其特征在于,所述致命缺陷包括短路或断路。

6.一种晶圆测试方法,其特征在于,包括如权利要求1至5中任一项所述的晶圆缺陷密度获得方法。

7.一种半导体装置形成方法,所述半导体装置在晶圆上形成,其特征在于,包括如权利要求6所述的晶圆测试方法。

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