[发明专利]面向高速贴片机的双总线控制模式的多IO控制装置无效

专利信息
申请号: 201410027255.7 申请日: 2014-01-22
公开(公告)号: CN103728909A 公开(公告)日: 2014-04-16
发明(设计)人: 高会军;彭鹏;孙光辉;张增杰;孙一勇 申请(专利权)人: 哈尔滨工业大学
主分类号: G05B19/042 分类号: G05B19/042
代理公司: 哈尔滨市松花江专利商标事务所 23109 代理人: 岳泉清
地址: 150001 黑龙*** 国省代码: 黑龙江;23
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摘要:
搜索关键词: 面向 高速 贴片机 总线 控制 模式 io 装置
【权利要求书】:

1.面向高速贴片机的双总线控制模式的多IO控制装置,其特征是在于,它包括CPLD控制模块(1)、单片机模块(2)、CAN总线通信模块(3)、电平转换模块(4)和ISA二级总线(5);

CPLD控制模块(1)通过电平转换模块(4)和ISA二级总线(5)与ISA二级总线(5)其他设备通信;

单片机模块(2)通过CAN总线通信模块(3)与CAN总线其他设备通信;

单片机模块(2)的外中断/地址复用端口与CPLD控制模块(1)的负责中断IO端口连接;

单片机模块(2)的第一通用IO端口通过7位专用地址并行总线与CPLD控制模块(1)的负责地址IO端口连接;

单片机模块(2)的第二通用IO端口通过16位专用数据并行总线与CPLD控制模块(1)的负责数据IO端口连接。

2.根据权利要求1所述的面向高速贴片机的双总线控制模式的多IO控制装置,其特征在于,它还包括32位数字输入模块(6)、第一信号隔离电路(7)、32位数字功率输出模块(8)、第二信号隔离电路(9)和8位数字信号输出模块(10);

32位数字输入模块(6)的数字信号输出端与第一信号隔离电路(7)的数字信号输入端连接,第一信号隔离电路(7)的24V数字信号输出端与CPLD控制模块(1)的24V数字信号输入端连接;

CPLD控制模块(1)的数字信号输出端与第二信号隔离电路(9)的数字信号输入端连接;

第二信号隔离电路(9)的24V数字信号输出端与32位数字功率输出模块(8)的24V数字信号输入端连接;

单片机模块(2)的8位数字信号输出端与8位数字信号输出模块(10)的8位数字信号输入端连接。

3.根据权利要求1或2所述的面向高速贴片机的双总线控制模式的多IO控制装置,其特征在于,它还包括FLASH存储及断电保护模块(11);

所述FLASH存储及断电保护模块(11),用于定时写入单片机模块(2)的工作状态,还用于在突发的断电情况下为单片机模块(2)供电,直到电源恢复正常供电。

4.根据权利要求2所述的面向高速贴片机的双总线控制模式的多IO控制装置,其特征在于,它还包括逻辑电源输入模块(12)和驱动电源输入模块(13);

逻辑电源输入模块(12)为CPLD控制模块(1)、单片机模块(2)、CAN总线通信模块(3)、电平转换模块(4)、ISA二级总线(5)、第一信号隔离电路(7)和第二信号隔离电路(9)提供工作电源;

驱动电源输入模块(13)为32位数字输入模块(6)、32位数字功率输出模块(8)和8位数字信号输出模块(10)提供工作电源。

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