[发明专利]采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法有效
申请号: | 201410059958.8 | 申请日: | 2014-02-21 |
公开(公告)号: | CN103887195B | 公开(公告)日: | 2017-01-04 |
发明(设计)人: | 范荣伟;倪棋梁;龙吟;陈宏璘 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/66 | 分类号: | H01L21/66;G01N23/00 |
代理公司: | 上海申新律师事务所31272 | 代理人: | 吴俊 |
地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 采用 离子 击穿 检测 多晶 底部 刻蚀 不足 缺陷 方法 | ||
1.采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,包括下述步骤:
步骤1.建立测试结构;
步骤2.将所述测试结构放置于电子束检测仪的监控产品测试位置,在所述测试结构的表面沉积掩模层,根据前段工艺进行流片;
步骤3.采用刻蚀工艺对所述测试结构进行刻蚀;
步骤4.对刻蚀后的所述测试结构进行离子击穿;
步骤5.采用所述电子束检测仪对刻蚀后的所述测试结构进行检测,判断所述测试结构的底部的多晶硅是否与有源区互联,若是则存在多晶硅底部刻蚀不足缺陷,若否则所述测试结构不存在刻蚀不足缺陷。
2.如权利要求1所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,步骤1所述测试结构包括:有源区、多晶硅和栅氧化层,所述有源区上等间距的设有多条所述栅氧化层,每条所述栅氧化层上设有多晶硅,所述多晶硅宽度与栅氧化层的宽度相同。
3.如权利要求2所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,所述多晶硅线间距离与监控产品的多晶硅的线间距离相同,所述有源区结构与所述监控产品的有源区结构相同,所述栅氧化层的结构与所述监控产品的栅氧化层结构相同。
4.如权利要求1所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,步骤2所述测试位置为切割道的位置。
5.如权利要求1所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,步骤2所述掩模层沉积于所述电容测试结构的所述有源区、所述多晶硅和所述栅氧化层表面。
6.如权利要求1所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,步骤4所述离子击穿采用的离子杂质为N型。
7.如权利要求6所述采用离子击穿检测多晶硅底部刻蚀不足缺陷的方法,其特征在于,所述离子杂质的剂量大于或等于后续正常流程中N型超浅结和N型源漏区离子注入的剂量总和,离子注入的深度与后续N型源流区离子注入的深度相等。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造