[发明专利]像素电路及驱动方法、有机发光显示面板和显示装置在审

专利信息
申请号: 201410102943.5 申请日: 2014-03-19
公开(公告)号: CN103903564A 公开(公告)日: 2014-07-02
发明(设计)人: 张春兵;郭瑞;王峥;金香华 申请(专利权)人: 京东方科技集团股份有限公司;北京京东方显示技术有限公司
主分类号: G09G3/32 分类号: G09G3/32
代理公司: 北京银龙知识产权代理有限公司 11243 代理人: 许静;安利霞
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 像素 电路 驱动 方法 有机 发光 显示 面板 显示装置
【权利要求书】:

1.一种像素电路,包括:驱动晶体管、存储电容、有机发光二极管,其特征在于,所述像素电路还包括:

第一信号输入端,用于在充电阶段接收持续第一时间的充电信号;

第一开关单元,连接于所述存储电容的第一端和所述第一信号输入端之间,所述第一开关单元能够在所述持续第一时间的充电信号的控制下处于导通状态,以使所述充电信号对所述存储电容充电所述第一时间,使所述存储电容达到第一电量;

其中,所述第一时间与一显示灰阶等级对应,所述存储电容处于所述第一电量时,所述有机发光二极管在发光阶段的发光亮度与所述显示灰阶等级对应。

2.如权利要求1所述的像素电路,其特征在于,所述驱动晶体管的源极连接第二信号输入端;

所述驱动晶体管的栅极与所述存储电容的第一端连接;

所述驱动晶体管的漏极与所述存储电容的第二端、所述有机发光二极管的阳极连接;

所述有机发光二极管的阴极与第三信号输入端连接。

3.如权利要求1所述的像素电路,其特征在于,所述充电信号为具有预设占空比的信号,所述预设占空比决定所述第一时间。

4.如权利要求1所述的像素电路,其特征在于,所述第一开关单元包括第一薄膜晶体管;

所述第一薄膜晶体管的源极和栅极,与所述第一信号输入端连接,所述第一薄膜晶体管的漏极与所述存储电容的第一端连接。

5.如权利要求1所述的像素电路,其特征在于,所述第一开关单元包括第一压敏电阻;

所述第一压敏电阻的第一端与所述第一信号输入端连接,所述第一压敏电阻的第二端与所述存储电容的第一端连接。

6.如权利要求5所述的像素电路,其特征在于,所述第一压敏电阻为正温度系数压敏电阻。

7.如权利要求1至6任一项所述的像素电路,其特征在于,所述第一信号输入端,还用于在放电阶段接收持续第二时间的放电信号;

所述第一开关单元能够在所述持续第二时间的放电信号的控制下处于导通状态,以使所述放电信号对所述存储电容放电所述第二时间。

8.如权利要求1所述的像素电路,其特征在于,还包括:

第四信号输入端,用于在放电阶段接收持续第二时间的放电信号;

第二开关单元,连接于所述存储电容的第一端和所述第四信号输入端之间,所述第二开关单元能够在所述放电信号的控制下处于导通状态,以使所述放电信号对所述存储电容放电所述第二时间。

9.如权利要求8所述的像素电路,其特征在于,所述第二开关单元包括第二薄膜晶体管;

所述第二薄膜晶体管的源极和栅极,与所述第四信号输入端连接,所述第二薄膜晶体管的漏极与所述存储电容的第一端连接。

10.如权利要求8所述的像素电路,其特征在于,所述第二开关单元包括第二压敏电阻;

所述第二压敏电阻的第一端与所述第四信号输入端连接,所述第二压敏电阻的第二端与所述存储电容的第一端连接。

11.如权利要求10所述的像素电路,其特征在于,所述第二压敏电阻为负温度系数压敏电阻。

12.一种像素电路驱动方法,其特征在于,包括:

确定像素电路所在像素单元当前显示画面的显示灰阶等级;

基于所述显示灰阶等级,确定为像素电路中存储电容充电的第一时间,所述第一时间与所述显示灰阶等级对应;

在充电阶段,向像素电路中的第一信号输入端输入持续所述第一时间的充电信号,其中,像素电路中的第一开关单元能够在所述充电信号的作用下处于导通状态,以使所述充电信号对所述存储电容充电所述第一时间,使所述存储电容达到第一电量,所述存储电容处于所述第一电量时,像素电路中的有机发光二极管在发光阶段的发光亮度与所述显示灰阶等级对应。

13.如权利要求12所述的像素电路驱动方法,其特征在于,还包括;

在放电阶段,向像素电路中的第一信号输入端输入放电信号,其中,第一开关单元能够在所述放电信号控制下处于导通状态,以使所述放电信号为所述存储电容放电;或者,

在放电阶段,向像素电路中的第四信号输入端输入放电信号,其中,第二开关单元能够在所述放电信号控制下处于导通状态,以使所述放电信号为所述存储电容放电。

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