[发明专利]一种标准总线控制器有效
申请号: | 201410114996.9 | 申请日: | 2014-03-26 |
公开(公告)号: | CN103885421B | 公开(公告)日: | 2017-04-05 |
发明(设计)人: | 关宁;孙逸帆;罗唤霖 | 申请(专利权)人: | 上海航天电子通讯设备研究所 |
主分类号: | G05B19/418 | 分类号: | G05B19/418 |
代理公司: | 上海汉声知识产权代理有限公司31236 | 代理人: | 胡晶 |
地址: | 200082 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 标准 总线 控制器 | ||
1.一种标准总线控制器,其特征在于,包括指令接口、总线输出接口、总线输入接口、数据接口、接点配置和使能接口、配置寄存器接口、时钟输入接口,与所述指令接口、总线输出接口、总线输入接口、数据接口、节点配置和使能接口、配置寄存器接口、时钟输入接口对应连接的IFU模块、TXU模块、RXU模块、LSU模块、CTU模块、REG模块、CKU模块;
所述指令接口控制所述IFU模块读取指令,所述LSU模块通过所述数据接口接收数据,所述TXU模块按IFU传递来的所述指令将所述LSU模块传递来的数据组成帧并通过所述总线输出接口发送到总线上;
所述RXU用于通过所述总线输入接口接收所述总线上的数据,所述CTU模块通过所述节点配置和使能接口获取配置信息和使能信号并监控节点的当前工作状态,所述配置寄存器接口通过读写所述REG模块中的寄存器的方式,对当前节点的总线控制器进行操作并可对节点的当前状态进行查询,所述CKU模块通过所述时钟输入接口接收已基准时钟信号经过分频处理,产生一个总线时钟。
2.如权利要求1所述的标准总线控制器,其特征在于,所述的RXU模块,接收总线上发来的数据,解码后比对数据的有效性,若满足协议规定的有效性,则将数据传给LSU模块;当节点发送数据时,RXU模块同时监视TXU模块发出的数据,出现发送错误,RXU模块将禁止TXU模块继续发送;当总线运行到同步窗口时,RXU模块会根据收到的同步信息通知TXU模块调整时钟,以达到与总线上其他节点的同步。
3.如权利要求1所述的标准总线控制器,其特征在于,所述总线输入接口具有16个输入信号,所述总线输出接口具有6个输出接口;
当前总线控制器为接收节点时,内部的RXU模块通过这12个输入信号接收总线数据;
当前总线控制器为发送节点时,内部的TXU模块通过这6个输出信号向总线上发送数据。
4.如权利要求1所述的标准总线控制器,其特征在于,所述节点的状态包括同步状态、失同步状态、进入同步状态、调试状态。
5.如权利要求1所述的标准总线控制器,其特征在于,所述的LSU模块,在数据窗口中:当前节点为发送节点时,LSU模块将按IFU发来的指令从数据接口读取数据并传递给TXU,此时LSU还会判断当前的数据是否已更新,并据此决定是否将数据传递给TXU发送;当前节点为接收节点时,将RXU传递来的接收数据按IFU发来的指令通过数据接口存入相应地址中。
6.如权利要求1所述的标准总线控制器,其特征在于,外部输入的120MHz基准时钟信号经过分频处理,产生一个30MHz的时钟作为总线时钟;CKU模块会将总线时钟和基准时钟一起输出给其他工作模块,CKU模块会根据当前节点的工作状态调整时钟的输出:在进入同步状态时,通过向30MHz的总线时钟内插入120MHz基准时钟周期长度的低电平来调整当前节点时间,使当前节点的时钟上升沿与总线上的时钟上升沿对齐,以达到节点时间与总线时间的同步。
7.如权利要求1所述的标准总线控制器,其特征在于,在所述的REG模块中,主机可操作、查询的寄存器包括:发送数据状态寄存器、指令表常量寄存器、总线时间因子寄存器、调试寄存器、节点状态与控制寄存器、中断地址寄存器、中断时间寄存器、长同步使能寄存器。
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