[发明专利]一种使用单端口存储单元的双端口静态随机存储器有效

专利信息
申请号: 201410126524.5 申请日: 2014-03-31
公开(公告)号: CN103886887B 公开(公告)日: 2017-05-31
发明(设计)人: 熊保玉;拜福君 申请(专利权)人: 西安紫光国芯半导体有限公司
主分类号: G11C7/10 分类号: G11C7/10
代理公司: 西安西交通盛知识产权代理有限责任公司61217 代理人: 王萌
地址: 710055 陕西省西安*** 国省代码: 陕西;61
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摘要:
搜索关键词: 一种 使用 端口 存储 单元 静态 随机 存储器
【权利要求书】:

1.一种使用单端口存储单元的双端口静态随机存储器,其特征在于,包括行译码器、单端口存储单元阵列、复制单元a、复制单元b、控制电路与预译码器、列译码器及读写数据通路、复制电路a、复制电路b、预译码选择器、读写控制状态机、读出数据串并转换电路和写入数据并串转换电路;

行译码器通过多条字线(wl)连接单端口存储单元阵列、复制单元a和复制单元b;行译码器还通过多条行预译码输出(rp)连接预译码选择器;

单端口存储单元阵列通过多条位线(BL)连接列译码器及读写数据通路;

复制单元a通过复制位线a(dbla)连接复制电路a;

复制单元b通过复制位线b(dblb)连接复制电路b;

控制电路与预译码器通过多条端口a预译码输出(pa)和多条端口b预译码输出(pb)连接预译码选择器;控制电路与预译码器还通过本地写使能(lwe)和灵敏放大器使能(sae)连接列译码器及读写数据通路;控制电路与预译码器还通过写数据时钟(clk_d)连接写入数据并串转换电路;

列译码器及读写数据通路通过多条列预译码输出(cp)连接预译码选择器;列译码器及读写数据通路还通过读出数据(q)和灵敏放大器使能连接读出数据串并转换电路;列译码器及读写数据通路还通过写入数据(d)连接写入数据并串转换电路;

复制电路a通过复制字线a(dwla)和端口a复位信号(rseta)连接读写控制状态机;

复制电路b通过复制字线b(dwlb)和端口a复位信号(rsetb)连接读写控制状态机;

预译码选择器通过端口a/b选择信号(sel),端口a自定时信号(sa)和端口b自定时信号(sb)连接读写控制状态机;

读写控制状态机还通过端口a/b选择信号(sel)连接读数据串并转换电路和写入数据并串转换电路。

2.如权利要求1所述的一种使用单端口存储单元的双端口静态随机存储器,其特征在于,所述单端口存储单元阵列由若干6管静态随机存储器单元构成。

3.如权利要求1所述的一种使用单端口存储单元的双端口静态随机存储器,其特征在于,预译码选择器根据端口a/b选择信号(sel)对端口a预译码输出(pa)和端口b预译码输出(pb)做出选择;当sel为低电平时,选择端口a预译码输出(pa)为预译码器的输出(pr/pc);当sel为高电平时,选择端口b预译码输出(pb)为预译码器的输出(pr/pc);端口a自定时信号(sa)决定端口a预译码输出(pa)有效时预译码输出信号(pr/pc)的脉冲宽度;端口b自定时信号(sb)决定端口b预译码输出(pb)有效时预译码输出信号(pr/pc)的脉冲宽度。

4.如权利要求1所述的一种使用单端口存储单元的双端口静态随机存储器,其特征在于,所述写入数据并串转换电路,根据端口a/b选择信号(sel),将端口a的写入数据(da)或端口b的写入数据(db)作为写入数据并串转换电路的输出数据(d);当sel为低电平时,将端口a的写入数据(da)作为作写入数据并串转换电路的输出数据(d);当sel为高电平时,将端口b的写入数据(db)作为写入数据并串转换电路的输出数据(d)。

5.如权利要求1所述的一种使用单端口存储单元的双端口静态随机存储器,其特征在于,所述读出数据串并转换电路,根据端口a/b选择信号(sel),将读出数据(q)并行输出到端口a和端口b;当sel为低电平时,将读出数据(q)输出到端口a读出数据(qa);当sel为高电平时,将读出数据(q)输出到端口b读出数据(qb)。

6.如权利要求1所述的一种使用单端口存储单元的双端口静态随机存储器,其特征在于,所述读写控制状态机分别为端口a复制电路和端口b复制电路分别提供复制字线a信号(dwla)和复制字线b信号(dwlb);为写入数据并串转换电路,读出数据串并转换电路和预译码选择器提供端口a/b选择信号(sel);为预译码选择器提供端口a自定时信号(sa)和端口b自定时信号(sb)。

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