[发明专利]信号处理电路、分解器数字转换器和多路径嵌套镜像放大器有效
申请号: | 201410204362.2 | 申请日: | 2014-05-14 |
公开(公告)号: | CN104167996B | 公开(公告)日: | 2018-06-15 |
发明(设计)人: | 船户是宏;熊本敏夫;吉泽知晃;黑冈一晃 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H03F3/45 | 分类号: | H03F3/45;H03F1/26 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 信号处理电路 差分放大器电路 放大器 嵌套 加法器电路 数字转换器 斩波放大器 相加信号 多路径 分解器 斩波器 差分输入信号 输出信号相加 差分信号 输出信号 相加 互换 放大 中和 | ||
本发明提供了一种信号处理电路、分解器数字转换器和多路径嵌套镜像放大器,该信号处理电路包括:斩波放大器,其具有放大差分输入信号Vsp(t)和Vsm(t)的差分放大器电路;以及加法器电路,其通过将斩波放大器生成的斩波器输出信号Vsub(t)相加来生成相加信号Vfil(t)。针对每个第一相位时段和第二相位时段而互换向差分放大器电路中输入的差分信号,并且加法器电路通过将在第一相位时段中和在第二相位时段中的斩波器输出信号相加来生成相加信号。
包括说明书、说明书附图和说明书摘要的、于2013年5月15日提交的第2013-103150号日本专利申请的公开内容通过完全引用而结合于此。
技术领域
本发明涉及一种信号处理电路和包括该信号处理电路的半导体器件,例如包括斩波放大器的半导体器件。
背景技术
对于放大器或者比较器而言,由于从它的输入部分器件的不匹配所产生的偏移电压而难以保证放大输入信号和比较的准确性。
第2008-219404号日本待审专利申请公开文本公开一种包括斩波放大器和求平均电路的放大器电路。求平均电路在多个采样时间对斩波放大器的输出电压进行采样,并且生成在采样时间的输出电压的平均电压。
第2011-135225号日本待审专利申请公开文本公开一种在如下第一定时与如下第二定时之间将斩波放大器的输出电压与第一采样和保持电路的保持电压相加的加法器电路,在该第一定时在斩波放大器的输出电压上叠加偏移电压的正/负值,在该第二定时,第一采样和保持电路执行采样和保持。
第7292095号美国专利公开一种包括斩波放大器和开关电容器的放大器电路。放大器电路通过使用开关电容器技术进行斩波来去除正/负极性以预定周期反转的偏移电压。
发明内容
第2008-219404号日本待审专利申请公开文本未公开如下配置,该配置通过斩波来去除正/负极性反转的偏移电压的影响。第2011-135225号日本待审专利申请公开文本公开一种旨在通过斩波来去除正/负极性反转的偏移电压的影响的处理电路。然而由于处理电路包括具有运算放大器和加法器的采样保持电路,所以从运算放大器产生的偏移在它的输出信号上被进一步叠加。另外,处理电路的配置变得复杂并且部件数目增加。其它问题和新特征将从本说明的描述和附图中变得清楚。
根据本发明的一个方面,一种信号处理电路包括:斩波放大器,其通过放大差分输入信号来生成斩波器输出信号;以及加法器电路,其通过将斩波器输出信号相加来生成相加信号。斩波放大器具有放大差分输入信号的差分放大器电路,针对控制电路的每个第一相位时段和第二相位时段而互换向差分放大器电路中输入的差分输入信号,并且斩波放大器基于差分放大器电路的输出来生成在第一相位时段和第二相位时段中分别在其上叠加非反转偏移信号和反转偏移信号的斩波器输出信号。加法器电路通过将在第一相位时段中和在第二相位时段中的斩波器输出信号相加来生成相加信号。
根据本发明的该方面,实现如下信号处理电路,其中去除它的差分放大器电路的偏移电压的影响。
附图说明
图1是根据第一实施例的信号处理电路的框图;
图2A是根据第一实施例的信号处理电路的主要部分的等效电路示意图而图2B和图2C是信号波形曲线图,其中图2B示出斩波时钟、差分输入信号Vsp(t)、差分输入信号Vsm(t)、信号Vsig(t)和斩波器输出信号的波形,并且图2C示出斩波器输出信号的放大波形;
图3是在根据第一实施例的信号处理电路中包括的调制斩波器电路和解调斩波器电路的电路图;
图4是在根据第一实施例的信号处理电路中包括的加法器电路的电路图;
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