[发明专利]半导体存储器、半导体存储阵列及其操作方法有效
申请号: | 201410218841.X | 申请日: | 2014-05-22 |
公开(公告)号: | CN105097814B | 公开(公告)日: | 2019-05-17 |
发明(设计)人: | 胡建强 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L29/417;H01L21/28 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 李仪萍 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 半导体 存储器 存储 阵列 及其 操作方法 | ||
1.一种半导体存储器,其特征在于,所述半导体存储器至少包括半导体衬底,所述半导体衬底上至少包括一存储位结构,所述存储位结构包括:
形成在半导体衬底中的源极掺杂区和漏极掺杂区;
形成在源极掺杂区和漏极掺杂区之间的半导体衬底上的存储器栅极堆栈结构;
形成在存储器栅极堆叠结构两侧的侧墙,包括位于源极掺杂区一侧的源极侧墙和位于漏极掺杂区一侧的漏极侧墙;
形成在侧墙外侧的金属接触结构,包括位于源极掺杂区上的源极金属接触结构和位于漏极掺杂区上的漏极金属接触结构;
其中,所述漏极侧墙的厚度小于所述存储位结构中,同一行的所述存储位结构的漏极金属接触结构互相电性连接至位线,同一列的所述存储位结构的源极金属接触结构互相电性连接至字线,同一行的所述存储位结构的存储器栅极堆栈结构互相电性连接至控制栅线;当对所述半导体存储器进行擦除操作时,被选中的所述存储位结构中的所述控制栅线和所述半导体衬底提供相同电压。
2.根据权利要求1所述的半导体存储器,其特征在于:所述漏极金属接触结构低于所述存储器栅极堆栈结构。
3.根据权利要求1所述的半导体存储器,其特征在于:所述存储器栅极堆栈结构包括:位于所述半导体衬底表面的隧穿氧化层;位于所述隧穿氧化层上的浮栅层;位于所述浮栅层上的ONO层;位于所述ONO层上的控制栅层。
4.根据权利要求3所述的半导体存储器,其特征在于:所述浮栅层和控制栅层为多晶硅层。
5.根据权利要求1所述的半导体存储器,其特征在于:所述漏极侧墙为上下厚度一致的长条状。
6.一种半导体存储阵列,其特征在于:所述半导体存储阵列包括至少两行两列如权利要求1所述存储位结构。
7.根据权利要求6所述的半导体存储阵列,其特征在于:所述半导体存储阵列至少包括一存储单元,所述存储单元包括两相对设置的第一存储位结构和第二存储位结构,所述第一存储位结构的漏极侧墙和第二存储位结构的漏极侧墙之间共用一漏极金属接触结构。
8.根据权利要求7所述的半导体存储阵列,其特征在于:所述半导体存储阵列至少包括相对设置的第一存储单元和第二存储单元,所述第一存储单元和第二存储单元相邻的源极侧墙之间共用一源极金属接触结构。
9.一种半导体存储阵列的操作方法,其特征在于:所述半导体存储阵列的操作方法至少包括:
提供如权利要求6所述的半导体存储阵列;
进行写入操作:选中所述半导体存储阵列中的存储位结构,对被选中的存储位结构所连接的位线提供电压3.5V~5.5V,对被选中的存储位所连接的字线提供电压0V,对被选中的存储位结构所连接的控制栅线提供电压8V~10V,对所述半导体衬底提供电压0V;
进行擦除操作:选中所述半导体存储阵列中的存储位结构,对被选中的存储位结构所连接的位线提供电压6V,对被选中的存储位结构所连接的字线提供电压-11V。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的