[发明专利]显示面板与栅极驱动器有效

专利信息
申请号: 201410226032.3 申请日: 2014-05-26
公开(公告)号: CN103971656B 公开(公告)日: 2017-04-12
发明(设计)人: 廖伟见;庄铭宏 申请(专利权)人: 友达光电股份有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 隆天知识产权代理有限公司72003 代理人: 张浴月,苏捷
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 显示 面板 栅极 驱动器
【说明书】:

技术领域

发明涉及一种显示面板,且特别涉及一种显示面板的栅极驱动器。

背景技术

近来,各种液晶显示器的产品已经相当地普及。为了有效地提升液晶显示器的可视面积,适用于窄边框的显示面板技术不断地被提出。

图1为一种已知的移位暂存电路100的示意图。移位暂存电路100为一种常见的移位暂存电路架构。如图1所示,移位暂存电路100接收移位信号SS,而改变控制节点A的电压电位,以产生栅极驱动信号SR_OUT。

详细而言,当前级移位暂存电路100输出栅极驱动信号SR_OUT时,本级移位暂存电路100的控制节点A会被扫描控制信号CS拉升至高电位电压。而当本级的移位暂存电路100进行输出栅极驱动信号SR_OUT时,控制节点A为浮接(floating),此时控制节点A仅可能会经由寄生电容而被时间脉冲信号CLK/XCLK再次进行充电,以使本级移位暂存电路100可正确地输出栅极驱动信号SR_OUT。

然而,若开关N1~N3因为元件老化或工艺变异的影响,造成元件的临界电压变小与漏电流Ioff变大,可能会使浮接的控制节点A的电压电位无法正确地维持在高电位电压。也就是说,当本级的移位暂存电路100进行输出栅极驱动信号SR_OUT时,控制节点A的电压电位可能会被时间脉冲信号CLK/XCLK充电至更高电位的电压。或者,控制节点A的电压电位会因为漏电流过大而被拉低至低电位电压,进而造成电路操作失效。

此外,已知的移位暂存电路100使用了较多的开关数进行实现,此架构具有较大的电路面积,而难以适用于窄边框的显示面板上。

因此,如何能改善移位暂存电路因漏电流的影响而造成操作失效的问题,并同时减少其电路面积,实属当前重要研发课题之一,也成为当前相关领域亟需改进的目标。

发明内容

为解决上述问题,本公开内容的一形式提供了一种显示面板。显示面板包含多条栅极线以及栅极驱动器。栅极驱动器包含多个串联的驱动级。每一驱动级用以输出栅极驱动信号至多条栅极线的对应一个。每一驱动级包含输入单元、输出单元、下拉单元与控制单元。输入单元用以输出移位信号至第一控制节点。输出单元用以根据移位信号产生栅极驱动信号。下拉单元用以根据第二控制节点的电压电位而选择性地将栅极驱动信号下拉至第一预设电压。控制单元包含反相器。反相器用以根据移位信号产生控制信号。控制单元在控制信号的禁能期间内,将第二控制节点下拉至第一预设电压,并在控制信号的致能期间内,将第二控制节点上拉至第二预设电压。

本公开内容的另一形式提供了一种栅极驱动器。栅极驱动器包含多个串联的驱动级。驱动级中每一个包含输入单元、输出单元、控制单元与下拉单元。输入单元具有输出端。输出单元包含第一输入端与输出端,其中输出单元的第一输入端电性耦接输入单元的输出端,且输出单元的输出端用以输出栅极驱动信号。控制单元包含一反相器、第一开关与第二开关。反相器包含输入端与输出端,其中反相器的输入端电性耦接输入单元的输出端。第一开关包含第一端、第二端以及控制端,其中第一开关的控制端电性耦接反相单元的输出端,第一开关的第一端用以接收电压。第二开关包含第一端、第二端以及控制端,其中第二开关的控制端电性耦接输入单元的该输出端,第二开关的第一端用以接收第一开关的第二端,且第二开关的第二端用以接收电源信号。下拉单元包含第三开关。第三开关包含第一端、第二端以及控制端,其中第三开关的该控制端电性耦接第二开关的第一端,第三开关的第一端电性耦接输出单元的输出端,且第三开关的第二端用以接收电源信号。

综上所述,本公开内容所公开的显示面板与栅极驱动器可使内部电路的节点在操作过程中均维持于一特定电压,以避免受到电压浮接造成操作失效的问题,并具有较低的电路面积。

附图说明

为让本发明的上述和其他目的、特征、优点与实施例能更明显易懂,附图的说明如下:

图1为一种已知的移位暂存电路的示意图;

图2为根据本公开内容的一实施例示出一种显示面板的示意图;

图3A为根据本公开内容的一实施例示出栅极驱动器的示意图;

图3B为根据本公开内容的一实施例示出图3A中的栅极驱动器执行由上往下扫描的操作信号时序示意图;

图3C为根据本公开内容的一实施例示出图3A中的栅极驱动器执行由下往上扫描的操作信号时序示意图;

图4为根据本公开内容的一实施例示出驱动级的示意图;

图5根据本公开内容的一实施例示出图4所示的驱动级的操作信号时序示意图;

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