[发明专利]半导体装置、显示装置以及信号提取方法有效

专利信息
申请号: 201410269719.5 申请日: 2014-06-17
公开(公告)号: CN104240655B 公开(公告)日: 2018-09-11
发明(设计)人: 今吉崇博 申请(专利权)人: 拉碧斯半导体株式会社
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 舒艳君;李洋
地址: 日本神*** 国省代码: 日本;JP
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摘要:
搜索关键词: 半导体 装置 显示装置 以及 信号 提取 方法
【权利要求书】:

1.一种半导体装置,其特征在于,具备:

输入部,其被输入第1差动信号以及与所述第1差动信号不同的第2差动信号的任意一方,并根据第1时钟信号提取被输入了的所述第1差动信号或者所述第2差动信号而输出;

保持部,其根据第2时钟信号提取从所述输入部输出的所述第1差动信号,并在保持后输出;

选择部,在所述输入部被输入了所述第1差动信号的情况下,该选择部选择从所述保持部输出的所述第1差动信号并向根据第3时钟信号提取所述第1差动信号或者所述第2差动信号而输出的输出部输出,在所述输入部被输入了所述第2差动信号的情况下,该选择部选择从所述输入部输出的所述第2差动信号并向根据第3时钟信号提取所述第1差动信号或者所述第2差动信号而输出的输出部输出;以及

时钟信号供给部,其向所述输出部供给与输入到所述输入部的所述第1差动信号或者所述第2差动信号对应的所述第3时钟信号。

2.根据权利要求1所述的半导体装置,其特征在于,

所述输入部具备提取所述第1差动信号而输出的第1输入电路、和提取所述第1差动信号或者所述第2差动信号而输出的第2输入电路。

3.根据权利要求1或2所述的半导体装置,其特征在于,

所述输入部根据所述第1时钟信号的电平的第1变动以及第2变动来进行被输入的所述第1差动信号以及所述第2差动信号的任意一方的提取,并根据所述第1时钟信号的所述第1变动以及所述第2变动的任意一方,来一并输出根据所述第1变动以及所述第2变动而提取了的所述第1差动信号或者所述第2差动信号,

所述保持部根据所述第2时钟信号的电平的所述第1变动以及所述第2变动来进行所述第1差动信号的提取,并根据所述第2时钟的信号的电平的所述第1变动以及所述第2变动的任意一方,来一并输出根据所述第1变动以及所述第2变动提取了的所述第1差动信号。

4.根据权利要求1或2所述的半导体装置,其特征在于,

所述输出部具备根据所述第3时钟信号来提取所述第1差动信号或者所述第2差动信号而输出的输出电路、和切换所述输出电路的输出目的地的切换开关。

5.根据权利要求1或2所述的半导体装置,其特征在于,

所述第2时钟信号以及所述第3时钟信号为比所述第1时钟信号低速的时钟。

6.根据权利要求1或2所述的半导体装置,其特征在于,

所述输入部、所述保持部、以及所述输出部为所述输出部的输出数比所述输入部的输出数多的竞赛图方式的结构。

7.根据权利要求1或2所述的半导体装置,其特征在于,

所述输入部、所述保持部、以及所述输出部由保持并输出数据的多个触发器电路构成,所述多个触发器电路配置成以所述时钟信号供给部为轴的线对称。

8.根据权利要求1或2所述的半导体装置,其特征在于,

所述第1差动信号是基于mini-LVDS输入方式的信号。

9.根据权利要求1或2所述的半导体装置,其特征在于,

所述第2差动信号是基于RSDS输入方式的信号。

10.一种显示装置,其特征在于,具备:

显示面板;

驱动用IC,其具备所述权利要求1~所述权利要求9中任意一项所述的半导体装置,所述驱动用IC向所述显示面板输出通过所述半导体装置提取的所述第1差动信号或者所述第2差动信号亦即基于图像数据而生成的信号;以及

时序控制器,其对所述半导体装置进行与所述图像数据的提取有关的指示。

11.根据权利要求10所述的显示装置,其特征在于,

从所述半导体装置的输出部输出的所述第1差动信号或者所述第2差动信号的输出数为所述显示面板的子像素数的两倍的倍数。

12.一种信号提取方法,其特征在于,具备:

通过输入部被输入第1差动信号以及与所述第1差动信号不同的第2差动信号的任意一方,并根据第1时钟信号提取被输入了的所述第1差动信号或者所述第2差动信号而输出的工序;

通过保持部根据第2时钟信号提取从所述输入部输出的所述第1差动信号,并在保持后输出的工序;

通过选择部在所述输入部被输入了所述第1差动信号的情况下,选择从所述保持部输出的所述第1差动信号并向根据第3时钟信号提取所述第1差动信号或者所述第2差动信号而输出的输出部输出,在所述输入部被输入了所述第2差动信号的情况下,选择从所述输入部输出的所述第2差动信号并向根据第3时钟信号提取所述第1差动信号或者所述第2差动信号而输出的输出部输出的工序;以及

通过时钟信号供给部向所述输出部供给与输入到所述输入部的所述第1差动信号或者所述第2差动信号对应的所述第3时钟信号的工序。

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