[发明专利]数据驱动电路、显示面板驱动方法及显示装置有效

专利信息
申请号: 201410433197.8 申请日: 2014-08-28
公开(公告)号: CN104217691B 公开(公告)日: 2017-04-12
发明(设计)人: 郑喆奎 申请(专利权)人: 京东方科技集团股份有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 北京银龙知识产权代理有限公司11243 代理人: 许静,黄灿
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 数据 驱动 电路 显示 面板 方法 显示装置
【说明书】:

技术领域

发明涉及显示技术领域,具体可以涉及一种可适用于四原色像素单元的数据驱动电路、显示面板驱动方法及显示装置。

背景技术

薄膜晶体管液晶显示器(TFT-LCD)的驱动电路可分为电源电路(Power IC)、时序控制电路(Timing Controller IC)、灰阶电路、数据驱动电路(Source Driver IC)、扫描驱动电路(Gate Driver IC)和系统接口(System I/F)等。

其中,如图1所示,时序控制电路基于外部输入的图像数据,生成与显示有关的驱动控制信号及数据并发送至数据驱动电路,以便数据驱动电路将这些与显示有关的驱动控制信号转换对应的模拟电压信号,输出至显示面板中。这些驱动控制信号中可以包括用于控制数据驱动电路在每帧之间输出数据极性的极性反转信号(POL)等。

图2为现有数据驱动电路与采用三基色像素单元(Dot)的显示面板之间数据输出示意图。如图2可见,现有的像素驱动方法可实现三基色像素单元中,在顺序排列单数位置处的子像素与双数位置处的子像素驱动电压的正(Positive)、负(Negative)极性不同,即具有180度的相位差,且相邻像素单元中,相同位置处的子像素的极性也不同,从而可防止水平间极性倾斜,避免显示串扰(Crosstalk)情况的发生。图2中,Dn用于标识第n条连接数据驱动电路与像素单元的数据线,无阴影区域例如R1,B1等表示该子像素处于正极性驱动,有阴影区域,例如G1、R2等表示该子像素处于负极性驱动。Rn、Gn、Bn表示第n个像素单元中用于呈现对应基色颜色的子像素所在位置区域。后续所列举附图中对应字母所代表的含义与此相同。

随着显示技术的发展,目前显示面板中每一个像素单元所包括的子像素由三基色(例如红、绿、蓝)演变为四基色(例如红、绿、蓝、白等),从而显示面板所呈现的色彩更加丰富逼真。

那么,如果仍然采用现有的像素驱动方法,则会使四基色像素单元出现如图3所示的情况,即会导致相邻像素单元中的,相同位置处(例如R1和R2)的子像素的驱动电压极性相同,从而导致显示面板出现显示串扰的情况。

发明内容

本发明提供一种数据驱动电路、显示面板驱动方法及显示装置,从而可以避免显示面板出现显示串扰的情况,确保画面显示质量。

本发明提供方案如下:

本发明实施例提供了一种数据驱动电路,与一显示面板对应连接,所述显示面板中包括多个像素单元,每个像素单元包括水平方向上依次设置的第一子像素、第二子像素、第三子像素和第四子像素;

其特征在于,所述数据驱动电路包括:

第一子驱动电路,分别与每一像素行中位于奇数位置处的像素单元所对应的像素电极连接,用于在一时间周期内,向所述奇数位置处的像素单元所对应的像素电极发送对应电位的电压信号,以在所述时间周期内控制所述奇数位置处的像素单元中的第一子像素和第三子像素的驱动电压极性,与所述奇数位置处的像素单元中的第二子像素和第四子像素驱动电压极性相反;

第二子驱动电路,分别与每一像素行中位于偶数位置处的像素单元所对应的像素电极连接,用于在所述时间周期内,向所述偶数位置处的像素单元所对应的像素电极发送对应电位的电压信号,以控制所述偶数位置处的像素单元中的第一子像素和第三子像素的驱动电压极性,与所述奇数位置处的像素单元中的第二子像素和第四子像素的驱动电压极性相同,以及控制所述偶数位置处的像素单元中的第二子像素和第四子像素驱动电压极性,在所述时间周期内与所述奇数位置处的像素单元中的第一子像素和第三子像素的驱动电压极性相同。

优选的,所述第一子驱动电路包括:

用于基于输入的逻辑数字信号,生成具有第一电位的第一电压信号的第一控制模块,所述第一电位数值大于显示面板中公共电极的电位数值,所述第一控制模块分别与一逻辑数字信号生成装置、第一模拟电压输入端、第二模拟电压输入端连接;

用于基于所述逻辑数字信号,生成具有第二电位的第二电压信号的第二控制模块,所述第二电位数值小于所述公共电极的电位数值,所述第二控制模块分别与所述逻辑数字信号生成装置、第二模拟电压输入端、第三模拟电压输入端连接;

用于向所述奇数位置处的像素单元中的第一子像素和第三子像素所对应的像素电极传输第一电压信号或第二电压信号的第一输出端,所述第一输出端与所述奇数位置处的像素单元中的第一子像素和第三子像素所对应的像素电极连接;

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