[发明专利]通信单元以及切片的射频模块有效

专利信息
申请号: 201410444535.8 申请日: 2014-09-03
公开(公告)号: CN104601193B 公开(公告)日: 2018-05-01
发明(设计)人: 尼瑞克方;吕思壮;张君玮 申请(专利权)人: 联发科技(新加坡)私人有限公司
主分类号: H04B1/40 分类号: H04B1/40
代理公司: 北京市万慧达律师事务所11111 代理人: 杨颖,张金芝
地址: 新加坡启汇城*** 国省代码: 暂无信息
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摘要:
搜索关键词: 通信 单元 以及 切片 射频 模块
【权利要求书】:

1.一种通信单元,其特征在于,包括:

至少一个分频器模块,用于接收时钟信号以及输出该时钟信号的分频代表信号;

多个切片的射频模块,其中,该多个切片的射频模块中的每一个包括:

用于接收该时钟信号的输入;

时序同步模块,用于接收该时钟信号的分频代表信号,以及在该多个切片的射频模块中,将该时钟信号的分频代表信号与该时钟信号同步;

至少一个逻辑模块,与该时序同步模块耦接,用于接收该时钟信号以及来自该时序同步模块的同步输出;

其中,该多个切片的射频模块中的每一个的输出与合并端口耦接,该合并端口用于耦接来自该多个切片的射频模块的输出;

其中,该时序同步模块耦接在该至少一个分频器模块与该至少一个逻辑模块之间,用于减少所述至少一个分频器模块所需要的电流量。

2.根据权利要求1所述的通信单元,其特征在于,该时序同步模块用于输出随时间变化的该分频代表信号。

3.根据权利要求1所述的通信单元,其特征在于,该时序同步模块包括至少一个触发器模块。

4.根据权利要求3所述的通信单元,其特征在于,该至少一个触发器模块是D型触发器,所述D型触发器的时钟输入端接收该时钟信号,所述D型触发器的D输入端接收该时钟信号的分频代表信号。

5.根据权利要求1所述的通信单元,其特征在于,该时序同步模块是驱动器模块。

6.根据权利要求1所述的通信单元,其特征在于,该每一个切片的射频模块包括该至少一个分频器模块。

7.根据权利要求1所述的通信单元,其特征在于,该至少一个逻辑模块包括逻辑与模块。

8.根据权利要求1所述的通信单元,其特征在于,该时钟信号是本地振荡信号,以及该至少一个分频器模块包括二分频模块。

9.根据权利要求1所述的通信单元,其特征在于,该通信单元进一步包括控制器,用于选择性的启用一个或者多个切片的射频模块。

10.一种切片的射频模块,其特征在于,包括:

第一输入端口,用于从至少一个分频器模块接收时钟信号的分频代表信号;

第二输入端口,用于接收该时钟信号;

时序同步模块,用于接收该时钟信号的分频代表信号,以及将该时钟信号的分频代表信号与该时钟信号同步;

至少一个逻辑模块,耦接到该时序同步模块,用于接收该时钟信号以及来自该时序同步模块的同步输出;以及

输出端口,用于输出该切片的射频模块的输出信号;

其中,该时序同步模块耦接在该至少一个分频器模块与该至少一个逻辑模块之间,用于减少所述至少一个分频器模块所需要的电流量。

11.根据权利要求10所述的切片的射频模块,其特征在于,该时序同步模块用于输出随时间变化的该分频代表信号。

12.根据权利要求10所述的切片的射频模块,其特征在于,该时序同步模块包括至少一个触发器模块;或者该时序同步模块是驱动器模块。

13.根据权利要求12所述的切片的射频模块,其特征在于,在该时序同步模块包括至少一个触发器模块时,该至少一个触发器模块是D型触发器,所述D型触发器的时钟输入端接收该时钟信号,所述D型触发器的D输入端接收该时钟信号的分频代表信号。

14.根据权利要求10所述的切片的射频模块,其特征在于,该切片的射频模块还包括该至少一个分频器模块。

15.根据权利要求10所述的切片的射频模块,其特征在于,该至少一个逻辑模块包括逻辑与模块。

16.根据权利要求10或者14所述的切片的射频模块,其特征在于,该时钟信号是本地振荡信号,以及该至少一个分频器模块包括二分频模块。

17.根据权利要求10所述的切片的射频模块,其特征在于,该切片的射频模块包括启用电路,该启用电路用于选择性的启用该切片的射频模块。

18.根据权利要求10所述的切片的射频模块,其特征在于,该输出端口,用于输出该切片的射频模块的输出信号到合并端口,该合并端口可操作的与至少一个其他的切片的射频模块耦接。

19.一种切片的射频模块,其特征在于,包括:第一输入端口、第二输入端口、驱动器模块以及输出端口,其中

该第一输入端口,用于从至少一个分频器模块接收时钟信号的分频代表信号;

该第二输入端口,用于接收时钟信号;

该驱动器模块,用于接收该时钟信号的分频代表信号,并驱动至少一个逻辑模块;

该至少一个逻辑模块,耦接到该驱动器模块,以及用于接收该时钟信号以及来自该驱动器模块的输出信号;以及

该输出端口,用于输出该切片的射频模块的输出信号;

其中,该驱动器模块耦接在该至少一个分频器模块与该至少一个逻辑模块之间,用于减少所述至少一个分频器模块所需要的电流量。

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