[发明专利]一种多通道任意定时器的实现方法有效

专利信息
申请号: 201410444963.0 申请日: 2014-09-03
公开(公告)号: CN104168149B 公开(公告)日: 2017-04-12
发明(设计)人: 刘雁行;胡强;许鹏 申请(专利权)人: 成都朗锐芯科技发展有限公司
主分类号: H04L12/24 分类号: H04L12/24;H04L12/26
代理公司: 四川力久律师事务所51221 代理人: 林辉轮,王芸
地址: 610041 四川省成都*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 通道 任意 定时器 实现 方法
【说明书】:

技术领域

发明涉及网络通讯定时领域,具体涉及一种多通道任意定时器的实现方法。

背景技术

在通讯系统中,经常需要大量定时器完成多信道超时告警。比如对多通道信令监测,信道上每隔一定时间收发一串报文,报文收发正常说明信道正常,报文异常就需要重新检测或发出告警信息。根据信道不同,信令收发周期不同,信令收发时间过长,信道故障不能及时发现,信道保护处理不及时,引起通信故障;信令收发时间过短,信道利用率大大降低,如果多通道同时以短时间收发信令,会占用很大的频率带宽,通信系统效率大大降低。

通信系统中常把信令收发时长固定为几种,如3.3ms、10ms、1s…等,但对一些特殊信令,这种收发时长不合适,改变收发时长时,系统配置参数更改比较困难。

发明内容

为解决以上问题,采用较少的资源同时为几百上千个通道提供多层次报警,本发明提供一种多通道任意定时器的实现方法,所述多通道任意定时器包括读写控制模块、用于储存定时计数数据的存储模块、用于存储与所述定时计数数据一一对应的定时配置数据的定时配置模块、用于判断定时计数数据是否到达定时配置数据定时判断模块、用于将定时计数数据加一或清零的累加模块,所述读写控制模块同时与所述存储模块和所述定时配置模块连接,所述存储模块和所述定时配置模块还同时与所述定时判断模块连接,所述定时判断模块与所述累加模块连接,所述累加模块与所述读写控制模块连接,所述定时判断模块还包括用于在定时计数数据达到设定时间时输出定时信号的定时输出端口,其特征在于包含如下工作步骤:

包含由读写控制模块控制读取存储模块内存储的定时计数数据与定时配置模块内存储的各个定时计数数据一一对应比较的定时配置数据作比较的步骤。

包含如所述定时计数数据未达到与之对应的定时配置数据时,所述累加模块将所述定时计数数据加一后由读写控制模块重新写入存储模块并替换原定时计数数据的步骤。

包含如所述定时计数数据达到与之对应的定时配置数据时,所述定时判断模块输出定时信号,同时累加模块将所述定时计数数据清零后由读写控制模块重新写入存储模块并替换原定时计数数据的步骤。

进一步的,所述定时器的存储模块包含有一个以上的寄存器,每个寄存器为一个定时通道,定时通道内存储有相应通道的定时计数数据。 

所述定时配置模块包含有与所述存储模块数量相同的寄存器,每个寄存器对应一个存储模块中的定时通道,并存储相应通道的定时配置数据;所述读写控制模块对存储模块中包含的一个以上的定时通道从第1定时通道到第n定时通道依次读写一次,并循环进行。

在某些实施例中,所述存储模块包含有1024个寄存器,每个寄存器为一个定时通道,定时通道内存储有相应通道的定时计数数据;读写控制模块对存储模块包含的1024个定时通道从第1定时通道到第1024定时通道依次读写一次,并循环进行。

进一步的,读写控制模块对存储模块中所有定时通道依次读写一次为一个定时步长,所述定时步长=读写控制模块的时钟周期*3*定时通道数。

进一步的,定时配置模块中各个寄存器存储的定时配置数据为对应定时通道所需定时时间与定时步长的比值,即定时配置数据=对应定时通道所需定时时间/定时步长。

定时开始后,读写控制模块分别从存储模块中的第一寄存器(第一定时通道)和定时配置模块的第一寄存器读取定时计数数据和定时配置数据,并将读出的定时计数数据与定时配置数据进行比较,如果定时技术数据未达到定时配置数据,则由累加模块对定时计数数据进行加一处理,然后通过读写控制模块写回存储模块的第一寄存器(第一定时通道)取代原定时计数数据。随后读写控制模块对存储模块中第二寄存器(第二定时通道)至第n(n≥1)寄存器(第n定时通道)中的定时计数数据依次与其对应的定时配置数据进行读取比较,完成后从第一寄存器(第一定时通道)重新开始循环读取比较。

读写控制模块对第一定时通道到第n(n≥1)定时通道依次读写比较一次为一个定时步长,读写控制模块对一个定时通道读写一次包括读、改、写三个步骤,共需要三个时钟周期,因此一个定时步长=读写控制模块的时钟周期*3*存储模块包含的定时通道数n。

根据需要在定时判断模块相应寄存器中设定不同的定时配置数据,定时判断模块中存储的定时配置数据=所需定时时间/定时步长。

存储模块中各通道存储的定时计数数据达到相应定时判断模块中的定时配置数据时,定时判断模块对相应通道输出定时信号,同时累加模块将该定时计数数据归零,该定时通道定时重新开始。

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