[发明专利]用于跨越指令高速缓冲存储器线的指令的预解码修复高速缓冲存储器有效
申请号: | 201410446244.2 | 申请日: | 2008-10-31 |
公开(公告)号: | CN104267927A | 公开(公告)日: | 2015-01-07 |
发明(设计)人: | 罗德尼·韦恩·史密斯;布莱恩·迈克尔·斯坦普尔;戴维·约翰·曼德扎克;詹姆斯·诺里斯·迪芬德尔费尔 | 申请(专利权)人: | 高通股份有限公司 |
主分类号: | G06F9/30 | 分类号: | G06F9/30;G06F9/38 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 宋献涛 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 跨越 指令 高速 缓冲存储器 解码 修复 | ||
1.一种用于执行跨越两个高速缓冲存储器线的指令的方法,所述方法包括:
提取跨越两个高速缓冲存储器线的指令的第一部分,所述指令的所述第一部分存储在指令高速缓冲存储器中的第一高速缓冲存储器线中;
从与所述指令高速缓冲存储器分离的预解码修复高速缓冲存储器中提取与所述指令相关联的预解码信息;
提取存储在处在所述第一高速缓冲存储器线之后的下一高速缓冲存储器线中的所述指令的第二部分;以及
响应于所述预解码信息来执行所述指令。
2.根据权利要求1所述的方法,其进一步包括:
组合所述预解码信息与所述指令的所述第一部分和所述第二部分,以创建具有有效的经对准预解码信息的经重新汇编的指令。
3.根据权利要求2所述的方法,其中,所述组合所述预解码信息与所述指令的所述第一部分和所述第二部分进一步包括:
选择所述预解码信息的第一部分和第二部分;
从所述指令高速缓冲存储器选择所述指令的所述第一部分和所述第二部分;以及
对准所述预解码信息的所述第一部分和所述第二部分与所述指令的所述第一部分和所述第二部分,以产生具有有效的经对准预解码信息的所述经重新汇编的指令。
4.根据权利要求1所述的方法,其中所述指令的所述第一部分包括第一组指令位和相关联的第一组预解码位,且所述指令的所述第二部分包括第二组指令位和相关联的第二组预解码位。
5.根据权利要求4所述的方法,其进一步包括:
预解码所述第一组指令位以形成第一组经修复的预解码位;以及
预解码所述第二组指令位以形成第二组经修复的预解码位。
6.根据权利要求5所述的方法,其进一步包括:
选择所述第一组经修复的预解码位以代替所述第一组预解码位;
选择所述第二组经修复的预解码位以代替所述第二组预解码位;以及
响应于已修复所述预解码信息而绕过处理器预解码器级。
7.根据权利要求1所述的方法,其中,所述指令具有对应的预解码器位,以及,其中,
提取所述指令的所述第二部分包括:在存储在所述预解码修复高速缓冲存储器处的所述已修复预解码信息与所述预解码位之间进行选择。
8.根据权利要求1所述的方法,其进一步包括:确定所述预解码修复高速缓冲存储器是否包含与所述指令相关联的预解码信息。
9.根据权利要求8所述的方法,其中,确定所述预解码修复高速缓冲存储器是否包含与所述指令相关联的预解码信息使用命中或未中信号。
10.一种用于使用预解码修复高速缓冲存储器的设备,所述设备包括:
指令高速缓冲存储器,其可操作以在指令高速缓冲存储器线中存储具有至少第一长度和第二长度的指令,所述第二长度比所述第一长度长;
预解码器,其可操作以预解码从所述指令高速缓冲存储器中提取的具有无效预解码信息的指令,以形成经修复的预解码信息;
预解码修复高速缓冲存储器,其可操作以存储与跨越所述指令高速缓冲存储器中两个高速缓冲存储器线的具有所述第二长度的指令相关联的所述经修复的预解码信息;以及
处理器,其用于响应于所述经修复的预解码信息而执行所述指令。
11.根据权利要求10所述的设备,其进一步包括:
组合器,其可操作以将从所述预解码修复高速缓冲存储器中提取的经修复的预解码信息与具有所述第二长度的指令的第一部分和第二部分组合,以产生具有有效的经对准预解码信息的经重新汇编的指令。
12.根据权利要求10所述的设备,其进一步包括:
围绕所述预解码器的旁路路径,其可操作以针对从所述指令高速缓冲存储器中提取的具有有效预解码信息的指令绕过所述预解码器。
13.根据权利要求11所述的设备,其进一步包括:
围绕所述预解码器的旁路路径,其可操作以针对所述具有有效的经对准预解码信息的经重新汇编的指令绕过所述预解码器。
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